雙線性變換的頻率對應關系雙線性變換法雖然避免了“頻率混疊效應”，但出現了模擬頻率與數字頻率為一種非線性的關系情形。即：可見：模擬濾波器與數字濾波器的響應在對應的頻率關系上發生了“畸變”，也造成了相位的非線性變化，這是雙線性變換法的主要缺點。具體而言，在上刻度為均勻的頻率點映射到上時變成了非均勻的點，而且隨頻率增加越來越密。 雙線性變換法除了不能用于線性相位濾波器設計外，仍然是應用最為廣泛的設計IIR數字濾波器的方法。
上傳時間： 2013-10-12
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在數字濾波器中，FIR濾波器是一種結構簡單且總是穩定的濾波器，同時也只有FIR濾波器擁有線性相位的特性。傳統的直接型濾波器運算速度過慢，而改進型的DA結構的濾波器需要過高的芯片面積消耗大量的邏輯資源很難達到運算速度以及邏輯資源節約的整體優化。本文提出了一種基于RAG算法的FIR濾波器，與傳統的基于DA算法的濾波器結構的濾波器相比，RAG算法簡化了FIR濾波器乘法模塊的結構，減少了邏輯資源的消耗和硬件實現面積，提高了計算速度。本文設計的16階FIR濾波器用VerilogHDL進行描述，并綜合到Altera公司的CycloneⅡ系列FPGA中。仿真實驗表明基于RAG算法的FIR濾波器達到了邏輯資源的節約和運算速度的提高的整體優化效果。
上傳時間： 2014-12-28
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設計采用Altera公司CycloneII系列EP2C5Q208作為核心器件，采用直接數字頻率合成技術實現了一個頻率、相位可控的基本信號發生器。該信號發生器可以產生正弦波、方波、三角波和鋸齒波四種波形。仿真及硬件驗證的結果表明，該信號發生器精度高，抗干擾性好，此設計方案具有一定的實用性。
上傳時間： 2013-11-10
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頻率特征測試儀是用來測量電路傳輸特性和阻抗特性的儀器，簡稱掃頻儀。掃頻信號源是掃頻儀的主要功能部件，作用是產生測量用的正弦掃頻信號，其 掃頻范圍可調，輸出信號幅度等幅。本設計采用DDS（數字頻率合成技術）產生掃頻信號，以Xilinx FPGA為控制核心，通過A/D和D/A等接口電路，實現掃頻信號頻率的步進調整、幅度與相位的測量，創新的使用了計算機軟件作為儀器面板來顯示被測網絡 幅頻特性與相頻特性，并且測試結果可保存到各種存儲介質中。
上傳時間： 2013-10-19
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描述了基于FPGA的FIR濾波器設計。根據FIR的原理及嚴格線性相位濾波器具有偶對稱的性質給出了FIR濾波器的4種結構，即直接乘加結構、乘法器復用結構、乘累加結構、DA算法。在本文中給出上述幾種算法的結構框圖，并通過FPGA編程實現上述幾種算法，并給出所用的資源來比較各種算法的優劣。
上傳時間： 2013-12-09
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提出一種利用FPGA實現相關干涉儀測向算法的方法，給出了測向系統的結構和組成框圖，并詳細介紹了FPGA內部模塊的劃分及設計流程，最后結合實際設計出一種實現方案，并討論了該方案在寬帶測向中較原有實現方式的優勢。為了使算法更適于FPGA實現，提出了一種新的相位樣本選取方法，并仿真驗證了該方法與傳統方法的等效性。
上傳時間： 2013-11-11
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GMSK信號具有很好的頻譜和功率特性，特別適用于功率受限和信道存在非線性、衰落以及多普勒頻移的移動突發通信系統。根據GMSK調制的特點，提出 亍一種以FPGA和CMX589A為硬件裁體的GMSK調制器的設計方案，并給出了方案的具體實現，包括系統結構、利用CMX589A實現的高斯濾波器、 FPGA實現的調制指數為O．5的FM調制器以及控制器。對系統功能和性能測試結果表明，指標符合設計要求，工作穩定可靠。 關鍵詞：GMSK；DDS；FM調制器；FPGAl 引 言 由于GMSK調制方式具有很好的功率頻譜特性，較優的誤碼性能，能夠滿足移動通信環境下對鄰道干擾的嚴格要求，因此成為GSM、ETS HiperLANl以及GPRS等系統的標準調制方式。目前GMSK調制技術主要有兩種實現方法，一種是利用GMSK ASIC專用芯片來完成，典型的產品如FX589或CMX909配合MC2833或FX019來實現GMSK調制。這種實現方法的特點是實現簡單、基帶信 號速率可控，但調制載波頻率固定，沒有可擴展性。另外一種方法是利用軟件無線電思想采用正交調制的方法在FPGA和DSP平臺上實現。其中又包括兩種實現 手段，一種是采用直接分解將單個脈沖的高斯濾波器響應積分分成暫態部分和穩態部分，通過累加相位信息來實現；另一種采用頻率軌跡合成，通過采樣把高斯濾波 器矩形脈沖響應基本軌跡存入ROM作為查找表，然后通過FM調制實現。這種利用軟件無線電思想實現GMSK調制的方法具有調制參數可變的優點，但由于軟件 設計中涉及到高斯低通濾波、相位積分和三角函數運算，所以調制器參數更改困難、實現復雜。綜上所述，本文提出一種基于CMX589A和FPGA的GMSK 調制器設計方案。與傳統實現方法比較具有實現簡單、調制參數方便可控和軟件剪裁容易等特點，適合于CDPD、無中心站等多種通信系統，具有重要現實意義。
上傳時間： 2013-10-24
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數字三相鎖相環中含有大量乘法運算和三角函數運算，占用大量的硬件邏輯資源。為此，提出一種數字三相鎖相環的優化實現方案，利用乘法模塊復用和CORDIC算法實現三角函數運算，并用Verilog HDL硬件描述語言對優化前后的算法進行了編碼實現。仿真和實驗結果表明，優化后的數字三相鎖相環大大節省了FPGA的資源，并能快速、準確地鎖定相位，具有良好的性能。
上傳時間： 2013-11-15
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設計了一種由直接數字頻率合成(DDS)、倍頻鏈構成的三次變頻直接頻率合成方案，實現了低相噪捷變頻高分辨率毫米波雷達頻率合成器設計。利用直接頻率合成器的倍頻輸出取代傳統三次變頻毫米波頻率源的鎖相環(PLL),同時提供線性調頻(LFM)信號，優化DDS和變頻方案的頻率配置關系。利用FPGA電路進行高速控制，較好地解決了毫米波頻率合成器各技術指標之間的矛盾。實測結果表明，采用該方案的毫米波頻率合成器在本振跳頻帶寬為160 MHz時，線性調頻頻率分辨率可達0.931 Hz，最大頻率轉換時間小于2 ?滋s，最大雜散低于-60 dBc，相位噪聲優于-90 dBc/Hz。
上傳時間： 2014-01-06
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為了研制一種鎖定時間短、相位噪聲低、雜散抑制度高的頻率合成技術，采用了直接數字式頻率合成器（DDS）驅動鎖相環（PLL）的結構。該頻率合成器綜合了DDS頻率轉換速度快、頻率分辨率高和PLL輸出頻帶寬、輸出雜散低的優點。基于該結構研制實現了輸出頻率范圍為700～800 MHz的寬帶頻率合成器，實驗結果表明該頻率合成器掃描模式Δf=1 MHz鎖定時間不超過20 μs，跳頻模式Δf=50 MHz的定時間不超過30 μs，近端雜散抑制度優于-50 dBc。
上傳時間： 2014-12-28
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