[AN218238]在電源適配器應用中使用EZ-PD CCG3PA器件的硬件設計指南電源適配器（Power adapter）是小型便攜式電子設備及電子電器的供電電源變換設備，一般由外殼、變壓器、電感、電容、控制IC、PCB板等元器件組成，它的工作原理由交流輸入轉換為直流輸出；按連接方式可分為插墻式和桌面式。廣泛配套于安防攝像頭，機頂盒，路由器,燈條，按摩儀等設備中。
標簽： 電源適配器
上傳時間： 2022-06-25
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有源電力濾波器是一種新型諧波，無功補償裝置。和傳統無源的補償裝置相比，有源電力濾波器具有很大的優勢，可以對諧波，無功以及負序電流實現實時、準確的補償。因此，有源電力濾波器得到了廣泛的研究，并開始進入工業應用階段。隨著數字信號處理技術的高速發展，以全數字化控制技術實現的有源電力濾波器必將成為電力電子技術中新的研究熱點。 本論文闡述了諧波抑制的背景和目的以及國內外諧波抑制技術的發展現狀，深入分析、比較了目前常用的有源濾波器的結構和工作原理，本論文探討了單相系統的諧波檢測算法的各種方案及其特點，選用負荷電流基波有功分量法對諧波電流進行檢測。該方法結構簡單，不僅適用于單相系統而且適用于三相系統。本文對單相有源電力濾波器進行了硬件和軟件設計，對各硬件部分實現的功能進行了具體的介紹，并給出了實現原理圖。軟件設計部分給出了主要程序的設計流程圖。以上設計方案在MATLAB 仿真軟件包的SIMULINK 環境下進行了仿真實現，仿真結果證實了本文設計的有源電力濾波器的正確性和諧波補償的實時性。 在理論分析和仿真研究的基礎上，設計了基于TMS320F2812 DSP 控制的單相并聯型電力有源濾波器，研制了實驗樣機，對并聯型有源電力濾波器進行了初實驗結果表明，本論文采用的負載電流基波有功分量算法能夠實時，準確地提取出諧波和無功分量，同時也表明，這種基于TMS320F2812 DSP 的單相有源電力濾波器具有優良的諧波補償特性。
上傳時間： 2013-06-19
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本文對感應電動機軟起動過程中存在的電流、電磁轉矩以及轉速振蕩問題進行了系統的理論分析和實驗研究.論文首先根據感應電動機的數學模型,利用MATLAB仿真工具建立了感應電動機軟起動的通用仿真模型,其次分析了晶閘管觸發角度、機組的轉動慣量、負載轉矩以及轉子電阻這四個因素對振蕩的影響,進而探討了感應電動機軟起動過程中出現電流、電磁轉矩以及轉速振蕩的原因.結果表明:在感應電動機軟起動過程中,當轉子轉速達到同步轉速并在其附近變化時,電動機的續流角會大幅度變化,當續流角圍繞晶閘管的觸發角變化時,三相交流調壓電路的輸出電壓會產生振蕩,在電動機定、轉子磁場的相互作用下會使振蕩加劇,因而就會造成電動機電流、電磁轉矩以及轉速的振蕩.特別需要指出的是電動機在軟起動過程中出現的轉速振蕩是在同步轉速附近振蕩而并非象有些文章所說的在低速下振蕩.根據上述原因,本文提出了采用關斷角控制的新型控制策略,這種控制策略是使電動機在起動過程中的電流關斷角由某一初始值逐漸減小到零,利用該方法可以使感應電動機起動過程中的續流角始終小于晶閘管的觸發角,這樣續流角的變化就不會引起電動機端電壓的振蕩,因而就從根本上消除了感應電動機軟起動過程中的振蕩現象.文中首先通過仿真驗證了該控制策略的正確性,在此基礎上研制了基于關斷角控制的感應電動機軟起動裝置的硬件電路和軟件程序,并進行了樣機試驗,實驗結果驗證了理論分析的正確性.另外,文中還探討了軟起動對于感應電動機起動過程中轉軸扭矩振蕩的影響.大型感應電動機驅動大轉動慣量負載直接起動時,其轉子軸上會出現過大的扭矩振蕩,這是由于定子繞組中電源頻率的電流與轉子中直流電流相互作用產生的具有轉差頻率的電磁轉矩分量造成的.采用軟起動會使電動機起動時轉子中產生的直流電流分量大為減小,進而可以減小電磁轉矩的轉差頻率分量,故可以有效地抑制感應電動機起動過程中作用在轉軸上過大的扭矩振蕩.
上傳時間： 2013-07-13
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低壓斷路器是電力系統中低壓配電網中的主要電器開關之一，它不僅可以接通和分斷正常負載電流和過載電流，而且可以接通和分斷短路電流。主要在頻繁操作的低壓配電線路或開關柜中作為電源開關使用，并對線路、電器設備等實行保護，當它們發生嚴重過流、過載、短路、斷相、漏電等故障時，能自動切斷線路，起保護作用，應用十分廣泛。智能控制器是斷路器上的保護裝置，也是斷路器的核心控制裝置。 20世紀90年代，隨著電力電子技術、微電子技術、計算機技術和通信技術的飛速發展，斷路器的保護裝置己由傳統的電磁式過流脫扣器發展成采用集成電路的電子式脫扣器，直至目前出現了帶高性能微處理器的智能控制器。新一代的智能控制器采用了模塊化結構設計，集測量、監視、控制、通信、保護等功能于一體，在低壓系統中得到了廣泛的應用。 在本課題中，該智能控制器在硬件上以美國Microchip公司推出的公司生產的PIC148F448為核心處理器，主要進行數據的實時采集處理和斷路器的故障保護，實時顯示線路運行時電流或故障信息等。利用帶有CAN接口的高性能的PIC18F448單片機設計了CAN總線接口，給出了CAN接口的硬件電路、軟件流程。該電路具有硬件設計簡單、可靠性高、實時性強等特點。實現了智能控制器與PC機的雙向通信功能，通過總線系統達到遙調、遙控的目的，使得智能控制器的性能得到增強，符合配電系統的要求，達到了本課題研究要求。
上傳時間： 2013-04-24
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電梯在垂直升降的過程中，由于功率變化范圍很大，節能潛力巨大。本文主要工作在于結合電梯系統的特點，對超級電容儲能系統中超級電容容量需求及其他相關參數的設置進行詳細討論。也對與之配套的雙向DC/DC變換器進行研究。 本文在研究了電梯系統的結構和運行特點的基礎上，對其運行過程中能量狀態的變化進行了詳細分析，得到了儲能裝置中超級電容器容量的計算方法，并在此基礎上，根據超級電容器容量需求與系統前級雙向整流器功率的關系，提出了一套簡單有效的能量管理方案，減少了儲能裝置中超級電容器的容量需求。并且對于超級電容容量設置給出了一般的原則。 儲能裝置與系統直流母線之間需要雙向變換器進行能量傳遞，本文對于各種雙向直流變換器拓撲的優缺點進行了比較，結合在超級電容儲能裝置中的具體應用需要，得出BUCK/BOOST型變換器更適合本文中的應用。 本文為儲能裝置設計了基于DSP（數字信號處理器）全數字控制的具有多種工作方式的雙向DC/DC變換器的小功率樣機，在電容器放電時，以恒流模式向直流母線輸送能量；在電容器充電時，以分段恒流模式或恒壓模式進行充電。文中給出了詳細的硬件電路以及數字控制部分的設計過程，并通過實驗進行了驗證。
上傳時間： 2013-04-24
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現場可編程門陣列(FPGA，Field Programmable Gate Array)是可編程邏輯器件的一種，它的出現是隨著微電子技術的發展，設計與制造集成電路的任務已不完全由半導體廠商來獨立承擔。系統設計師們更愿意自己設計專用集成電路(ASIC，Application Specific Integrated Circuit)．芯片，而且希望ASIC的設計周期盡可能短，最好是在實驗室里就能設計出合適的ASIC芯片，并且立即投入實際應用之中。現在，FPGA已廣泛地運用于通信領域、消費類電子和車用電子。 本文中涉及的I/O端口模塊是FPGA中最主要的幾個大模塊之一，它的主要作用是提供封裝引腳到CLB之間的接口，將外部信號引入FPGA內部進行邏輯功能的實現并把結果輸出給外部電路，并且根據需要可以進行配置來支持多種不同的接口標準。FPGA允許使用者通過不同編程來配置實現各種邏輯功能，在IO端口中它可以通過選擇配置方式來兼容不同信號標準的I/O緩沖器電路。總體而言，可選的I/O資源的特性包括：IO標準的選擇、輸出驅動能力的編程控制、擺率選擇、輸入延遲和維持時間控制等。 本文是關于FPGA中多標準兼容可編程輸入輸出電路(Input/Output Block)的設計和實現，該課題是成都華微電子系統有限公司FPGA大項目中的一子項，目的為在更新的工藝水平上設計出能夠兼容單端標準的I/O電路模塊；同時針對以前設計的I/O模塊不支持雙端標準的缺點，要求新的電路模塊中擴展出雙端標準的部分。文中以低壓雙端差分標準(LVDS)為代表構建雙端標準收發轉換電路，與單端標準比較，LVDS具有很多優點： (1)LVDS傳輸的信號擺幅小，從而功耗低，一般差分線上電流不超過4mA，負載阻抗為100Ω。這一特征使它適合做并行數據傳輸。 (2)LVDS信號擺幅小，從而使得該結構可以在2.5V的低電壓下工作。 (3)LVDS輸入單端信號電壓可以從0V到2.4V變化，單端信號擺幅為400mV，這樣允許輸入共模電壓從0.2V到2.2V范圍內變化，也就是說LVDS允許收發兩端地電勢有±1V的落差。 本文采用0.18μm1.8V/3.3V混合工藝，輔助Xilinx公司FPGA開發軟件ISE，設計完成了可以用于Virtex系列各低端型號FPGA的IOB結構，它有靈活的可配置性和出色的適應能力，能支持大量的I/O標準，其中包括單端標準，也包括雙端標準如LVDS等。它具有適應性的優點、可選的特性和考慮到被文件描述的硬件結構特征，這些特點可以改進和簡化系統級的設計，為最終的產品設計和生產打下基礎。設計中對包括20種IO標準在內的各電器參數按照用戶手冊描述進行仿真驗證，性能參數已達到預期標準。
上傳時間： 2013-05-15
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焊有元件的印制電路板在線測試是印制電路板生產過程中的一個重要環節，關系著整個電子產品的質量。本文在深入研究國內外印制電路板自動測試技術的基礎上，結合當前先進的電子技術，設計出一套高性能，低價位，小體積，便于攜帶和操作的印制電路板在線測試儀。 本文設計的在線測試儀系統包括控制器電路、信號發生電路、信號采集電路、元件測試電路、USB通信電路和開關矩陣電路等，其中控制器電路是以FPGA可編程控制芯片為核心，負責控制下位機其它所有電路的正常工作，并實現與上位機間的通信。 針對模擬元件的測試，本文首先探討了對印制電路板上模擬元件測試時的隔離原理，繼而詳細闡述了電阻、電容（電感）、二極管、三極管、運算放大器等的測試方法，并分別設計了硬件測試電路。因為測試時需向被測元件施加測試激勵信號，本文設計并完成了一信號發生電路，可輸出幅值可調的直流恒壓源信號和直流恒流源信號、幅值和頻率都可調的交流信號。 針對數字器件的測試，本文將數字器件分為兩種，一種為具有邊界掃描功能單元的器件，另一類為非邊界掃描器件，并分別對兩種類型的數字器件的測試原理和方法進行了詳細的描述，在文中給出了相關的硬件測試電路圖。 本設計中，所有測試激勵信號經測試電路后輸出的測試結果都是直流電壓信號，所以本文設計了一通用信號采集電路來完成對測試結果的取樣。本文還設計了開關矩陣電路，用于將被測印制電路板上的元件接入到測試電路中。對通信電路的設計，本文采用USB通信方式與上位機進行有效的數據交換，并通過USB接口芯片完成了硬件電路的設計。 在軟件方面，本文采用NiosⅡ C語言完成所有軟件設計，以協助硬件部分來完成對印制電路板的測試工作。 本文已完成各部分電路試驗及系統聯調，試驗證明設計達到了項目預定要求。
上傳時間： 2013-08-02
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FPGA作為新一代集成電路的出現，引起了數字電路設計的巨大變革。隨著FPGA工藝的不斷更新與改善，越來越多的用戶與設計公司開始使用FPGA進行系統開發，因此，PFAG的市場需求也越來越高，從而使得FPGA的集成電路板的工藝發展也越來越先進，在如此良性循環下，不久的將來，FPGA可以主領集成電路設計領域。正是由于FPGA有著如此巨大的發展前景與市場吸引力，因此，本文采用FPGA作為電路設計的首選。 @@ 隨著FPGA的開發技術日趨簡單化、軟件化，從面向硬件語言的VHDL、VerilogHDL設計語言，到現在面向對象的System Verilog、SystemC設計語言，硬件設計語言開始向高級語言發展。作為一個軟件設計人員，會很容易接受面向對象的語言。現在軟件的設計中，算法處理的瓶頸就是速度的問題，如果采用專用的硬件電路，可以解決這個問題，本文在第一章第二節詳細介紹了軟硬結合的開發優勢。另外，在第一章中還介紹了知識產權核心（IP Core）的發展與前景，特別是IP Core中軟核的設計與開發，許多FGPA的開發公司開始爭奪軟核的開發市場。 @@ 數字電路設計中最長遇到的就是通信的問題，而每一種通信方式都有自己的協議規范。在CPU的設計中，由于需要高速的處理速度，因此其內部都是用并行總線進行通信，但是由于集成電路資源的問題，不可能所有的外部設備都要用并行總線進行通信，因此其外部通信就需要進行串行傳輸。又因為需要連接的外部設備的不同，因此就需要使用不同的串行通信接口。本文主要介紹了小型CPU中常用的三種通信協議，那就是SPI、I2C、UART。除了分別論述了各自的通信原理外，本文還特別介紹了一個小型CPU的內部構造，以及這三個通信協議在CPU中所處的位置。 @@ 在硬件的設計開發中，由于集成電路本身的特殊性，其開發流程也相對的復雜。本文由于篇幅的問題，只對總的開發流程作了簡要的介紹，并且將其中最復雜但是又很重要的靜態時序分析進行了詳細的論述。在通信協議的開發中，需要注意接口的設計、時序的分析、驗證環境的搭建等，因此，本文以SPI數據通信協議的設計作為一個開發范例，從協議功能的研究到最后的驗證測試，將FPGA 的開發流程與關鍵技術等以實例的方式進行了詳細的論述。在SPI通信協議的開發中，不僅對協議進行了詳細的功能分析，而且對架構中的每個模塊的設計都進行了詳細的論述。@@關鍵詞：FPGA；SPI；I2C；UART；靜態時序分析；驗證環境
上傳時間： 2013-04-24
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本文提出了一種基于FPGA的硬件防火墻的實現方案，采用了FPGA來實現千兆線速的防火墻。傳統的基于X86等通用CPU的防火墻無法支撐快速增長的網絡速度，無法實現線速過濾和轉發。本文在采用FPGA可編程器件+通用CPU模式下，快速處理網絡數據。網絡數據在建立連接跟蹤后，直接由FPGA實現的快速處理板直接轉發，實現了網絡數據的線速處理，通用CPU在操作系統支持下，完成網絡數據的連接跟蹤的創建、維護，對網絡規則表的維護等工作。FPGA硬件板和CPU各司所長，實現快速轉發的目的。 本文設計了基于FPGA的硬件板的硬件規格，提出了硬件連接跟蹤表的存儲模式，以及規則表的存儲模式和定義等； 防火墻系統軟件采用NetBSD操作系統，完成了硬件板的NetBSD的驅動；在軟件系統完成了新建連接的建立、下發、老化等工作；在連接跟蹤上完成了規則的建立、刪除、修改等工作。 本文完成了防火墻的實現。實現了基于連接跟蹤的包過濾、地址轉換（NAT），設計了連接跟蹤的關鍵數據結構，包過濾的關鍵數據結構等，重用了NetBSD操作系統的路由。本文針對地址轉換應用程序的穿透問題，新增了部分實現。 在DoS攻擊是一種比較常見的攻擊網絡手段，本文采用了軟硬件結合的方法，不僅在軟件部分做了完善，也在硬件部分采取了相應的措施，測試數據表明，對常見的Syn洪水攻擊效果明顯。 在實踐過程中，我們發現了NetBSD操作系統內核的軟件缺陷，做了修正，使之更完善。 經過測試分析，本方案不僅明顯的優于X86方案，和基于NP方案、基于ASIC方案比較，具有靈活、可配置、易升級的優點。
上傳時間： 2013-06-21
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為適應組合導航計算機系統的微型化、高性能度的要求，拓寬導航計算機的應用領域，本文設計出一種基于浮點型DSP(TMS320C6713)和可編程邏輯陣列器件(FPGA： EP1C12N240C8)協同合作的導航計算機系統。 論文在闡述了組合導航計算機的特點和應用要求后，提出基于DSP和FPGA的組合導航計算機系統方案。該方案以DSP為導航解算處理器，由FPGA完成IMU信號的采集和緩存以及系統控制信號的整合；DSP通過EMIF接口實現和FPGA通信。在此基礎上研究了各擴展通信接口、系統硬件原理圖和PCB的開發，且在FPGA中使用調用IP核來實現FIR低通濾波數據處理機抖激光陀螺的機抖振動的影響。其次，詳細闡述了利用TI公司的DSP集成開發環境和DSP/BIOS準實時操作系統開發多任務系統軟件的具體方案。本文引入DSP/BIOS實時操作系統提供的多任務機制，將采集處理按照功能劃分四個相對獨立的任務，這些任務在DSP/BIOS的調度下，按照用戶指定的優先級運行，大大提高系統的工作效率。最后給了DSP芯片Bootloader的制作方法。 導航計算機系統研制開發是軟、硬件研究緊密結合的過程。在微型導航計算機系統方案建立的基礎上，本文首先討論了系統硬件整體設計和軟件開發流程；其次針對導航計算機系統各個功能模塊以及多項關鍵技術進行了設計與開發工作，涉及系統數據通信模塊、模擬信號采集模塊和數據存儲模塊；最后，對導航計算機系統進行了聯合調試工作，并對各個模塊進行了詳細的功能測試與驗證，完成了微型導航計算機系統的制作。 以DSP/FPGA作為導航計算機硬件平臺的捷聯式慣性導航實時數據系統能夠滿足系統所要求的高精度、實時性、穩定性要求，適應了其高性能、低成本、低功耗的發展方向。
上傳時間： 2013-04-24
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