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硬件解碼器

  • 上海手游公司開發RPG大作-破虜傳完整代碼,註解與資源包和地圖編輯器,經JBX編譯成功

    上海手游公司開發RPG大作-破虜傳完整代碼,註解與資源包和地圖編輯器,經JBX編譯成功

    標簽: RPG JBX

    上傳時間: 2016-06-17

    上傳用戶:lixinxiang

  • 嵌入式硬件系統設計與開發實例詳解

    嵌入式硬件系統設計與開發實例詳解

    標簽: 嵌入式 硬件 開發實例 系統設計

    上傳時間: 2013-08-02

    上傳用戶:eeworm

  • 嵌入式硬件系統設計與開發實例詳解-319頁-10.5M.rar

    專輯類----單片機專輯 嵌入式硬件系統設計與開發實例詳解-319頁-10.5M.rar

    標簽: 10.5 319 嵌入式

    上傳時間: 2013-04-24

    上傳用戶:小宇NVO

  • 嵌入式硬件系統設計與開發實例詳解-319頁-10.5M.pdf

    專輯類-單片機專輯-258冊-4.20G 嵌入式硬件系統設計與開發實例詳解-319頁-10.5M.pdf

    標簽: 10.5 319 嵌入式

    上傳時間: 2013-04-24

    上傳用戶:ABCD_ABCD

  • 基于FPGA的直擴調制解調器的設計與實現.rar

    擴頻通信系統與常規的通信系統相比,具有很強的抗窄帶干擾,抗多徑干擾,抗人為干擾的能力,并具有信息隱蔽、多址保密通信等優點。在近年來得到了迅速的發展。本論文主要討論和實現了基于FPGA的直接序列擴頻信號的解擴解調處理。論文對該直擴通信系統和FPGA設計方法進行了相關研究,最后用Altera公司的最新的FPGA開發平臺Quarus Ⅱ5.0實現了相關設計。 整個系統分為兩個部分,發送部分和接收部分。發送部分主要有串并轉換、差分卷積編碼、PN碼擴頻、QPSK調制、成型濾波等模塊。接收部分主要有前端抗干擾、數字下變頻、解擴解調等模塊。 論文首先介紹了擴頻通信系統的特點以及相關技術的國內外發展現狀,并介紹了本論文的研究思路和內容。 然后,論文分析了幾種常用的窄帶干擾抑制、載波同步及PN碼同步算法,結合實際需要,設計了一種零中頻DSSS解調解擴方案。給出了抗窄帶干擾、PN碼捕獲及跟蹤以及載波同步的算法分析,采用了基于數字外差調制的自適應陷波器來進行前端窄帶干擾抑制處理,用基于自適應門限技術的滑動相關捕獲和分時復用單相關器跟蹤來改善PN碼同步的性能,用基于硬判決的COSTAS(科斯塔斯)環來減少載波提取的算法復雜度,用改進型CORDIC算法實現NCO來方便的進行擴展。 接著,論文給出了系統總體設計和發送及接受子系統的各個功能模塊的實現分析以及在Quartus Ⅱ5.0上的實現細節,給出了仿真結果。 然后論文介紹了整個系統的硬件電路設計和它在真實系統中連機調試所得到的測試結果,結果表明該系統具有性能穩定,靈活性好,生產調試容易,體積小,便于升級等特點并且達到課題各項指標的要求。 最后是對論文工作的一些總結和對今后工作的展望。

    標簽: FPGA 調制解調器

    上傳時間: 2013-05-23

    上傳用戶:磊子226

  • 適用于H.264視頻解碼器的VLD設計

    設計了一種適合于H.264 的變字長解碼器根據碼流特點進行模塊劃分減少硬件開銷采用并行結構解NAL 包解碼效率高采用了桶形移位器進行并行解碼每個時鐘解一個碼字采用Verilog 語言進行設計仿真并通過

    標簽: 264 VLD 視頻解碼器

    上傳時間: 2013-07-15

    上傳用戶:shen007yue

  • 基于FPGA的直擴調制解調器

    擴頻通信系統與常規的通信系統相比,具有很強的抗窄帶干擾,抗多徑干擾,抗人為干擾的能力,并具有信息隱蔽、多址保密通信等優點。在近年來得到了迅速的發展。本論文主要討論和實現了基于FPGA的直接序列擴頻信號的解擴解調處理。論文對該直擴通信系統和FPGA設計方法進行了相關研究,最后用Altera公司的最新的FPGA開發平臺Quarus Ⅱ5.0實現了相關設計。 整個系統分為兩個部分,發送部分和接收部分。發送部分主要有串并轉換、差分卷積編碼、PN碼擴頻、QPSK調制、成型濾波等模塊。接收部分主要有前端抗干擾、數字下變頻、解擴解調等模塊。 論文首先介紹了擴頻通信系統的特點以及相關技術的國內外發展現狀,并介紹了本論文的研究思路和內容。 然后,論文分析了幾種常用的窄帶干擾抑制、載波同步及PN碼同步算法,結合實際需要,設計了一種零中頻DSSS解調解擴方案。給出了抗窄帶干擾、PN碼捕獲及跟蹤以及載波同步的算法分析,采用了基于數字外差調制的自適應陷波器來進行前端窄帶干擾抑制處理,用基于自適應門限技術的滑動相關捕獲和分時復用單相關器跟蹤來改善PN碼同步的性能,用基于硬判決的COSTAS(科斯塔斯)環來減少載波提取的算法復雜度,用改進型CORDIC算法實現NCO來方便的進行擴展。 接著,論文給出了系統總體設計和發送及接受子系統的各個功能模塊的實現分析以及在Quartus Ⅱ5.0上的實現細節,給出了仿真結果。 然后論文介紹了整個系統的硬件電路設計和它在真實系統中連機調試所得到的測試結果,結果表明該系統具有性能穩定,靈活性好,生產調試容易,體積小,便于升級等特點并且達到課題各項指標的要求。 最后是對論文工作的一些總結和對今后工作的展望。

    標簽: FPGA 調制解調器

    上傳時間: 2013-07-04

    上傳用戶:yd19890720

  • 51寄存器詳解

    51寄存器的所有寄存器名稱,(包括寄存器每一位的作用及用法)資源詳解!

    標簽: 51寄存器

    上傳時間: 2013-05-22

    上傳用戶:ABCD_ABCD

  • 一個用cpld實現的數控系統硬件直線插補器的簡單方案

    一個用cpld實現的數控系統硬件直線插補器的簡單方案

    標簽: cpld 數控系統 硬件 直線

    上傳時間: 2013-08-07

    上傳用戶:klin3139

  • 用FPGA可編程器件和VHDL硬件描述語言來實現Flash編程器

    用 FPGA 可編程器件和 VHDL 硬件描述語言來實現 Flash 編程器

    標簽: Flash FPGA VHDL 可編程器件

    上傳時間: 2013-08-10

    上傳用戶:450976175

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