1-1前言一般人所能夠感受到聲音的頻率約介於5H2-20KHz，超音波（Ultrasonic wave）即爲(wèi)頻率超過20KHz以上的音波或機(jī)械振動(dòng)，因此超音波馬達(dá)就是利用超音波的彈性振動(dòng)頻率所構(gòu)成的制動(dòng)力。超音波馬達(dá)的內(nèi)部主要是以壓電陶瓷材料作爲(wèi)激發(fā)源，其成份是由鉛（Pb）、結(jié)（Zr）及鈦（Ti）的氧化物皓鈦酸鉛（Lead zirconate titanate，PZT）製成的。將歷電材料上下方各黏接彈性體，如銅或不銹鋼，並施以交流電壓於壓電陶瓷材料作爲(wèi)驅(qū)動(dòng)源，以激振彈性體，稱此結(jié)構(gòu)爲(wèi)定子（Stator），將其用彈簧與轉(zhuǎn)子Rotor）接觸，將所産生摩擦力來(lái)驅(qū)使轉(zhuǎn)子轉(zhuǎn)動(dòng)，由於壓電材料的驅(qū)動(dòng)能量很大，並足以抗衡轉(zhuǎn)子與定子間的正向力，雖然伸縮振幅大小僅有數(shù)徵米（um）的程度，但因每秒之伸縮達(dá)數(shù)十萬(wàn)次，所以相較於同型的電磁式馬達(dá)的驅(qū)動(dòng)能量要大的許多。超音波馬達(dá)的優(yōu)點(diǎn)爲(wèi)：1，轉(zhuǎn)子慣性小、響應(yīng)時(shí)間短、速度範(fàn)圍大。2，低轉(zhuǎn)速可產(chǎn)生高轉(zhuǎn)矩及高轉(zhuǎn)換效率。3，不受磁場(chǎng)作用的影響。4，構(gòu)造簡(jiǎn)單，體積大小可控制。5，不須經(jīng)過齒輸作減速機(jī)構(gòu)，故較爲(wèi)安靜。實(shí)際應(yīng)用上，超音波馬達(dá)具有不同於傳統(tǒng)電磁式馬達(dá)的特性，因此在不適合應(yīng)用傳統(tǒng)馬達(dá)的場(chǎng)合，例如：間歇性運(yùn)動(dòng)的裝置、空間或形狀受到限制的場(chǎng)所；另外包括一些高磁場(chǎng)的場(chǎng)合，如核磁共振裝置、斷層掃描儀器等。所以未來(lái)在自動(dòng)化設(shè)備、視聽音響、照相機(jī)及光學(xué)儀器等皆可應(yīng)用超音波馬達(dá)來(lái)取代。
標(biāo)簽： 超聲波電機(jī)
上傳時(shí)間： 2022-06-17
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用于FPGA的N+0.5分頻代碼，可以用來(lái)進(jìn)行非整數(shù)分頻！
上傳時(shí)間： 2013-08-06
上傳用戶：weixiao99
針對(duì)高速數(shù)字信號(hào)處理的要求,提出用FPGA 實(shí)現(xiàn)基- 4FFT 算法,并對(duì)其整體結(jié)構(gòu)、蝶形單\\\\\\\\r\\\\\\\\n元進(jìn)行了分析. 采用蝶算單元輸入并行結(jié)構(gòu)和同址運(yùn)算,能同時(shí)提供蝶形運(yùn)算所需的4 個(gè)操作\\\\\\\\r\\\\\\\\n數(shù),具有最大的數(shù)據(jù)并行性,能提高處理速度 按照旋轉(zhuǎn)因子存放規(guī)則,蝶形運(yùn)算所需的3 個(gè)旋轉(zhuǎn)\\\\\\\\r\\\\\\\\n因子地址相同,且尋址方式簡(jiǎn)單 輸出采取與輸入相似的存儲(chǔ)器 運(yùn)算單元同時(shí)采用3 個(gè)乘法的\\\\\\\\r\\\\\\\\n復(fù)數(shù)運(yùn)算算法來(lái)
上傳時(shí)間： 2013-08-08
上傳用戶：gxrui1991
:文章針對(duì)目前數(shù)字信號(hào)處理中大量采用的快速傅立葉變換[FFT] 算法采用軟件編程來(lái)處理的應(yīng)用現(xiàn)狀,在對(duì)FFT 算法進(jìn)行\(zhòng)\\\\\\\r\\\\\\\\n分析的基礎(chǔ)上,給出了用FPGA[Field Programmable Gate Array] 實(shí)現(xiàn)的8 點(diǎn)32 位FFT 處理器方案,并得到了系統(tǒng)的仿真結(jié)果。\\\\\\\\r\\\\\\\\n最后在Altera 公司FLEX10K系列FPGA 芯片上成功地實(shí)現(xiàn)了綜合。
上傳時(shí)間： 2013-08-09
上傳用戶：yangzhiwei
用fpga高效率的設(shè)計(jì)FIR濾波器\r\n里面有原理介紹，具體如何實(shí)施設(shè)計(jì)
上傳時(shí)間： 2013-08-13
上傳用戶：asdfasdfd
BulkIn是FPGA向CY7C68013發(fā)送數(shù)據(jù)\r\nBulkOut是FPGA從CY7C68013接收數(shù)據(jù),可以用LED顯示\r\n
標(biāo)簽： C68013 68013 FPGA CY7
上傳時(shí)間： 2013-08-30
上傳用戶：anng
數(shù)控振蕩器的頻率控制字寄存器、相位控制字寄存器、累加器和加法器可以用VHDL語(yǔ)言描述，集成在一個(gè)模塊中，提供VHDL源程序供大家學(xué)習(xí)和討論。\r\n
標(biāo)簽： VHDL 寄存器 數(shù)控振蕩器 加法器
上傳時(shí)間： 2013-09-04
上傳用戶：a471778
工作原理：\r\n 脈沖輸入，記錄30個(gè)脈沖的間隔時(shí)間（總時(shí)間），LED顯示出來(lái)，牽涉到數(shù)碼管的輪流點(diǎn)亮，以及LED的碼。輸入端口一定要用個(gè)\r\n74LS14整一下，圖上沒有。數(shù)碼管使用共陰數(shù)碼管。MAXPLUS編譯。\r\n測(cè)試時(shí)將光電門的信號(hào)端一塊連接到J2口的第三管腳，同時(shí)第一管腳為地，應(yīng)該與光電門的地連接（共地）。\r\n開始測(cè)試：\r\n 按下按鍵，應(yīng)該可以見到LED被點(diǎn)亮，指示可以開始轉(zhuǎn)動(dòng)轉(zhuǎn)動(dòng)慣量盤，等遮光片遮擋30次光電門后，\r\n LED熄滅，數(shù)碼管有數(shù)字顯示，此為時(shí)間值，單位為秒，與
標(biāo)簽： CPLD LED 控制 數(shù)碼管
上傳時(shí)間： 2013-09-05
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用cpld實(shí)現(xiàn)曼徹斯特編碼\r\n用verilog HDL進(jìn)行曼徹斯特編碼，用于通信中
上傳時(shí)間： 2013-09-07
上傳用戶：786334970
新手指導(dǎo)\r\n--用PROTEL DXP電路板設(shè)計(jì)的一般原則\r\n電路板設(shè)計(jì)的一般原則包括：電路板的選用、電路板尺寸、元件布局、布線、焊盤、填充、跨接線等。\r\n
標(biāo)簽： PROTEL DXP 電路板設(shè)計(jì)
上傳時(shí)間： 2013-09-11
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