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自動(dòng)組卷系統(tǒng)(tǒng)

  • 開關(guān)磁阻電機(jī)的新型齒極結(jié)構(gòu)及自組織模糊控制

    開關(guān)磁阻電機(jī)驅(qū)動(dòng)系統(tǒng)(SRD)是一種新型交流驅(qū)動(dòng)系統(tǒng),以結(jié)構(gòu)簡(jiǎn)單、堅(jiān)固耐用、成本低廉、控制參數(shù)多、控制方法靈活、可得到各種所需的機(jī)械特性,而備受矚目,應(yīng)用日益廣泛.并且SRD在寬廣的調(diào)速范圍內(nèi)均具有較高的效率,這一點(diǎn)是其它調(diào)速系統(tǒng)所不可比擬的.但開關(guān)磁阻電機(jī)(SRM)的振動(dòng)與噪聲比較大,這影響了SRD在許多領(lǐng)域的應(yīng)用.本文針對(duì)上述問題進(jìn)行了研究,提出了一種新型齒極結(jié)構(gòu),可有效降低開關(guān)磁阻電機(jī)的振動(dòng)與噪聲.通過電磁場(chǎng)有限元計(jì)算可看出,在新型齒極結(jié)構(gòu)下,導(dǎo)致開關(guān)磁阻電機(jī)振動(dòng)與噪聲的徑向力大為減小,尤其是當(dāng)轉(zhuǎn)子極相對(duì)定子極位于關(guān)斷位置時(shí),徑向力大幅度地減小,并改善了徑向力沿定子圓周的分布,使其波動(dòng)減小,從而減小了定子鐵心的變形與振動(dòng),進(jìn)而降低了開關(guān)磁阻電機(jī)的噪聲.靜態(tài)轉(zhuǎn)矩因轉(zhuǎn)子極開槽也略微減小,但對(duì)電機(jī)的效率影響不大.開關(guān)磁阻電機(jī)因磁路的飽和導(dǎo)致參數(shù)的非線性,又因在不同控制方式下是變結(jié)構(gòu)的.這使得開關(guān)磁阻電機(jī)的控制非常困難.經(jīng)典的線性控制方法如PI、PID等方法用于開關(guān)磁阻電機(jī)的控制,效果不好.其它的控制方法如滑模變結(jié)構(gòu)控制、狀態(tài)空間控制方法等可取得較好的控制效果但大都比較復(fù)雜,實(shí)現(xiàn)起來比較困難.而智能控制方法如模糊控制本身為一種非線性控制方法,對(duì)于非線性、變結(jié)構(gòu)、時(shí)變的被控對(duì)象均可取得較好的控制效果且不需知道被控對(duì)象的數(shù)學(xué)模型,這對(duì)于很難精確建模的開關(guān)磁阻電機(jī)來說尤其適用.同時(shí),模糊控制實(shí)現(xiàn)比較容易.但對(duì)于變參數(shù)、變結(jié)構(gòu)的開關(guān)磁阻電機(jī)來說固定參數(shù)的模糊控制在不同條件下其控制效果難以達(dá)到最優(yōu).為取得最優(yōu)的控制效果,該文采用帶修正因子的自組織模糊控制器,采用單純形加速優(yōu)化算法通過在線調(diào)整參數(shù),達(dá)到了較好的控制效果.仿真結(jié)果證明了這一點(diǎn).

    標(biāo)簽: 開關(guān)磁阻電機(jī) 自組織 模糊控制

    上傳時(shí)間: 2013-05-16

    上傳用戶:大三三

  • 自定制Nios處理器的FFT算法指令

    本文深入研究了Nios 自定制指令的軟硬件接口,基于Altera 的IP 核FFT V2.2.0實(shí)現(xiàn)了變換長(zhǎng)度為1024 點(diǎn)的高速復(fù)數(shù)FFT 算法,提出了一種在Nios 嵌入式系統(tǒng)中定制用戶FFT 算

    標(biāo)簽: Nios FFT 定制 處理器

    上傳時(shí)間: 2013-04-24

    上傳用戶:hfmm633

  • 基于LMS自適應(yīng)濾波器信息采集系統(tǒng)設(shè)計(jì)

    設(shè)計(jì)并實(shí)現(xiàn)具有硬件濾波空氣清新器的信息采集系統(tǒng),根據(jù)空氣的復(fù)雜性以及隨機(jī)性,結(jié)合自適應(yīng)濾波器的原理,提出一種新的空氣信息采集系統(tǒng)設(shè)計(jì)方法。該方法利用最小均方(LMS)自適應(yīng)濾波器進(jìn)行軟件濾波,針對(duì)空氣

    標(biāo)簽: LMS 自適應(yīng)濾波器 信息采集 系統(tǒng)設(shè)計(jì)

    上傳時(shí)間: 2013-06-14

    上傳用戶:sjb555

  • 電能計(jì)量裝置安裝接線規(guī)則 DL/T 825-2002

    電能計(jì)量裝置安裝接線規(guī)則 DL/T 825-2002:本標(biāo)準(zhǔn)規(guī)定了電力系統(tǒng)中計(jì)費(fèi)用和非計(jì)費(fèi)用交流電能計(jì)量裝置的接線方式及安裝規(guī)定。

    標(biāo)簽: 2002 825 DL 電能計(jì)量

    上傳時(shí)間: 2013-06-30

    上傳用戶:yuanhong95

  • 基于ARM的織機(jī)送經(jīng)和卷取控制系統(tǒng)的設(shè)計(jì)

    目前,織機(jī)向著高速化、智能化方向發(fā)展,無梭織機(jī)也越來越占主導(dǎo)地位,開發(fā)中高檔織機(jī)控制系統(tǒng)是當(dāng)前紡織機(jī)械領(lǐng)域的重要課題。織機(jī)的電子送經(jīng)和卷取控制系統(tǒng)是中高檔織機(jī)控制的關(guān)鍵技術(shù)之一,同時(shí)它也是無梭織機(jī)優(yōu)越于有梭織機(jī)的重要特征之一,因此研究送經(jīng)和卷取控制系統(tǒng)具有重要意義。 本文研究的內(nèi)容是織機(jī)的送經(jīng)和卷取控制系統(tǒng),主要目的是保證織機(jī)在織造過程中紗線張力的動(dòng)態(tài)穩(wěn)定。主要工作如下: (1)在分析送經(jīng)卷取系統(tǒng)原理和功能的基礎(chǔ)上,提出了一種用較低成本完成所需控制功能的解決方案——以ARM嵌入式處理器S3C44B0為中心構(gòu)建硬件平臺(tái),以嵌入式操作系統(tǒng)uClinux為基礎(chǔ)構(gòu)建軟件平臺(tái)。 (2)利用嵌入式處理器S3C44B0豐富的硬件資源,對(duì)電子送經(jīng)卷取控制系統(tǒng)進(jìn)行硬件設(shè)計(jì):包括以S3C44B0為核心的最小系統(tǒng)電路的設(shè)計(jì)、與上位機(jī)通訊接口電路的設(shè)計(jì)、經(jīng)紗張力檢測(cè)與采樣電路的設(shè)計(jì)、伺服電機(jī)驅(qū)動(dòng)接口電路的設(shè)計(jì)和編碼器接口電路的設(shè)計(jì)等. (3)利用嵌入式操作系統(tǒng)uClinux高實(shí)時(shí)、多任務(wù)等優(yōu)點(diǎn),對(duì)電子送經(jīng)卷取控制系統(tǒng)進(jìn)行軟件設(shè)計(jì): ●在分析uClinux系統(tǒng)的特點(diǎn)和功能的基礎(chǔ)上,完成了在硬件電路板上的移植; ●在分析系統(tǒng)引導(dǎo)程序功能的基礎(chǔ)上,完成了Boot Loader的設(shè)計(jì); ●完成了系統(tǒng)設(shè)備驅(qū)動(dòng)程序的設(shè)計(jì):包括串口驅(qū)動(dòng)程序設(shè)計(jì)、A/D驅(qū)動(dòng)程序的設(shè)計(jì)和IIC驅(qū)動(dòng)程序的設(shè)計(jì)等; ●在對(duì)織機(jī)工藝了解的基礎(chǔ)上,以模塊化的思想完成了系統(tǒng)應(yīng)用程序的設(shè)計(jì):包括張力傳感器數(shù)據(jù)采集模塊、控制算法模塊和通訊模塊等; (4)詳細(xì)介紹了整個(gè)控制系統(tǒng)的調(diào)試過程。 本文設(shè)計(jì)的系統(tǒng)能使控制的經(jīng)紗張力恒定,反應(yīng)快速,控制精度高,很好地解決了開車痕等問題,能滿足中高檔織機(jī)的要求,具有實(shí)際應(yīng)用價(jià)值。

    標(biāo)簽: ARM 控制系統(tǒng)

    上傳時(shí)間: 2013-04-24

    上傳用戶:athjac

  • 39839電感量計(jì)算小巧實(shí)用的綠色軟件,根據(jù)輸入的線圈長(zhǎng)度、線圈直徑、導(dǎo)線直徑、線圈匝數(shù)及工作頻率快速計(jì)算出電感量、自分布電容、空載Q值、自諧振頻率

    39839電感量計(jì)算小巧實(shí)用的綠色軟件,根據(jù)輸入的線圈長(zhǎng)度、線圈直徑、導(dǎo)線直徑、線圈匝數(shù)及工作頻率快速計(jì)算出電感量、自分布電容、空載Q值、自諧振頻率

    標(biāo)簽: 39839 電感量 計(jì)算 線圈

    上傳時(shí)間: 2013-06-03

    上傳用戶:夜月十二橋

  • DVBH發(fā)射端信道內(nèi)碼和調(diào)制部分的FPGA設(shè)計(jì)和實(shí)現(xiàn)

    數(shù)字電視技術(shù)和超大規(guī)模深亞微米的系統(tǒng)級(jí)芯片設(shè)計(jì)技術(shù)是當(dāng)前信息產(chǎn)業(yè)中最受關(guān)注的兩個(gè)方向。它們的交叉就是數(shù)字電視應(yīng)用中的一系列系統(tǒng)級(jí)芯片和超深亞微米專用集成電路。其中信道處理系統(tǒng)及其相關(guān)芯片更是集中了數(shù)字信號(hào)處理前向糾錯(cuò)編解碼等數(shù)字電視傳輸?shù)暮诵募夹g(shù),成為設(shè)計(jì)和開發(fā)整個(gè)數(shù)字電視系統(tǒng)的關(guān)鍵之一。數(shù)字高清晰度電視(Digital HDTV)做為第三代電視標(biāo)準(zhǔn),已成為當(dāng)今世界高技術(shù)競(jìng)爭(zhēng)的焦點(diǎn),本文正是從這個(gè)交叉點(diǎn)上出發(fā)對(duì)DVB-H(Digital Video Broadcasting-Handheld)標(biāo)準(zhǔn)中所涉及的信道編碼和調(diào)制部分進(jìn)行了研究,重點(diǎn)分析了信道內(nèi)編碼部分的硬件優(yōu)化實(shí)現(xiàn)。本項(xiàng)目完成了DVB-H傳輸系統(tǒng)信道編碼的FPGA硬件設(shè)計(jì)和實(shí)現(xiàn),系統(tǒng)所有FPGA硬件電路設(shè)計(jì)采用了Veillog HDL語言編寫。同時(shí)對(duì)清華大學(xué)數(shù)字電視地面?zhèn)鬏敇?biāo)準(zhǔn)DMB-T(Terrestrial Digital Multimedia/TV Broadcasting)中的關(guān)鍵技術(shù)做了研究,與DVB標(biāo)準(zhǔn)中的相關(guān)技術(shù)做了對(duì)比。 本文首先對(duì)DVB.H以及COFDM的相關(guān)理論進(jìn)行介紹和研究。然后針對(duì)DVB-H信道編碼調(diào)制器中的部分核心算法的FPGA設(shè)計(jì)和實(shí)現(xiàn)進(jìn)行了詳細(xì)的研究工作,包括外編碼、內(nèi)編碼(卷積刪余)、內(nèi)交織(包括比特交織和符號(hào)交織)、星座映射、幀形成、OFDM調(diào)制的部分設(shè)計(jì)等。相應(yīng)地對(duì)DVB-H信道解碼解調(diào)器中的部分算法的FPGA設(shè)計(jì)的研究工作做了描述,包括符號(hào)解交織和比特解交織。同時(shí)對(duì)清華大學(xué)數(shù)字電視地面?zhèn)鬏敇?biāo)準(zhǔn)DMB-T外接收機(jī)中頻域和時(shí)域解交織模塊的FPGA設(shè)計(jì)實(shí)現(xiàn)做了描述。 筆者在項(xiàng)目中完成的主要工作有: (1)與項(xiàng)目組成員合作制定系統(tǒng)框架,劃分模塊。 (2)對(duì)所負(fù)責(zé)的模塊,包括外編碼、內(nèi)編碼(卷積刪余)、內(nèi)交織(包括比特交織和符號(hào)交織)、星座映射、幀形成、OFDM調(diào)制的算法進(jìn)行研究并加以優(yōu)化,建立軟件仿真模型,進(jìn)行FPGA設(shè)計(jì),仿真和實(shí)現(xiàn)。

    標(biāo)簽: DVBH FPGA 發(fā)射端 信道

    上傳時(shí)間: 2013-06-10

    上傳用戶:rockjablew

  • DVBT發(fā)射機(jī)系統(tǒng)中的OFDM調(diào)制FPGA實(shí)現(xiàn)

    該項(xiàng)目完成的是DVB-T發(fā)射機(jī)系統(tǒng)中OFDM調(diào)制部分的FPGA設(shè)計(jì).DVB-T是ETSI(歐洲電信標(biāo)準(zhǔn)委員會(huì))提出的數(shù)字地面電視廣播系統(tǒng)標(biāo)準(zhǔn),在業(yè)界影響很廣.整個(gè)DVB-T發(fā)射機(jī)系統(tǒng)包括RS編碼,內(nèi)交織,卷積編碼,外交織,星座映射,IFFT變換等主要部分.該項(xiàng)目組負(fù)責(zé)以FPGA為主體的硬件平臺(tái)的搭建及編碼,調(diào)制部分的FPGA軟件設(shè)計(jì),作者完成了2k模式下IFFT變換的軟件設(shè)計(jì).該文首先介紹了OFDM及DVB-T相關(guān)原理,然后比較分析了各種FFT算法及實(shí)現(xiàn)結(jié)構(gòu)的復(fù)雜度,最后采取了一種Radix2

    標(biāo)簽: DVBT OFDM FPGA 發(fā)射機(jī)

    上傳時(shí)間: 2013-05-17

    上傳用戶:gundamwzc

  • DVBT信道編解碼算法研究及FPGA實(shí)現(xiàn)

    數(shù)字通信系統(tǒng)中,在實(shí)際信道上傳輸數(shù)字信號(hào)時(shí),由于信道傳輸特性不理想及噪聲的影響,接收端所收到的數(shù)字信號(hào)不可避免地會(huì)發(fā)生錯(cuò)誤。為了減小誤碼率,提高接收質(zhì)量,必須采用差錯(cuò)控制編碼。對(duì)于數(shù)字視頻通信系統(tǒng)這類高碼率,高要求的系統(tǒng),為了提供優(yōu)良的圖象質(zhì)量,采用差錯(cuò)控制編碼尤為重要。 本文采用的DVB-T系統(tǒng)差錯(cuò)控制技術(shù)是針對(duì)于數(shù)字視頻通信而設(shè)計(jì)的,提出了糾錯(cuò)編碼結(jié)合交織技術(shù)的實(shí)現(xiàn)方案,即RS(204,188,8)截短碼、卷積交織、卷積碼三種技術(shù)的級(jí)聯(lián)。各技術(shù)中的參數(shù)設(shè)計(jì)為輸入的MPEG-2傳輸流(TS流)提供了便利,在編碼后可以保持傳輸流的幀結(jié)構(gòu)和同步字節(jié)不改變,使接收端的同步捕獲和同步跟蹤成為可能。 本文首先簡(jiǎn)要介紹了差錯(cuò)控制技術(shù),DVB-T系統(tǒng),以及硬件實(shí)現(xiàn)所用到的FPGA實(shí)現(xiàn)方法。然后分別研究RS碼、卷積交織、卷積碼的編解碼原理,并提出了三類技術(shù)的硬件實(shí)現(xiàn)方案。其中,重點(diǎn)論述了RS碼解碼的硬件實(shí)現(xiàn)。將RS碼解碼分為四個(gè)模塊:伴隨式計(jì)算,BM迭代,錢搜索和錯(cuò)誤值計(jì)算,分別講述每個(gè)模塊的電路設(shè)計(jì)方案并給出仿真結(jié)果。最后,將該差錯(cuò)控制系統(tǒng)應(yīng)用于一個(gè)輸出速率恒定的實(shí)際數(shù)字視頻通信系統(tǒng)中,按系統(tǒng)需要,加入了接口電路和速率控制的設(shè)計(jì)。

    標(biāo)簽: DVBT FPGA 信道 編解碼

    上傳時(shí)間: 2013-04-24

    上傳用戶:gcs333

  • DVB信道編解碼算法研究與FPGA實(shí)現(xiàn)

    隨著人們對(duì)于數(shù)字視頻和數(shù)字圖像的需求越來越大,數(shù)字電視廣播和手機(jī)電視迅速發(fā)展起來,但是人們對(duì)于數(shù)字圖像質(zhì)量的要求也越來越高。對(duì)于觀眾來講,畫面的質(zhì)量幾乎是最為重要的,然而由于信道傳輸特性不理想和加性噪聲的影響,不可避免地會(huì)產(chǎn)生誤碼,導(dǎo)致圖像質(zhì)量的下降,甚至無法正常收看。因此,為了保障圖像質(zhì)量就需要采用糾錯(cuò)編碼(又稱信道編碼)的方式來實(shí)現(xiàn)通信。在數(shù)字視頻廣播系統(tǒng)(DVB)中,無論是衛(wèi)星傳輸,電纜傳輸還是地面?zhèn)鬏敹疾捎昧诵诺谰幋a。 本文首先深入研究DVB標(biāo)準(zhǔn)中的信道編碼部分的關(guān)鍵技術(shù);然后依照DVB-T標(biāo)準(zhǔn)技術(shù)要求,設(shè)計(jì)并硬件實(shí)現(xiàn)了數(shù)字視頻傳輸?shù)男诺谰幗獯a系統(tǒng)。在該系統(tǒng)中,編解碼器與信源端的接口利用了MPEG-2的視頻傳輸接口同步并行接口(SPI),這種接口的應(yīng)用讓系統(tǒng)具有很強(qiáng)的通用性;與信道端接口采用了G.703接口,具有G.703接口功能和特性的數(shù)據(jù)通信設(shè)備可以直接與數(shù)字通信設(shè)備連接,這使得應(yīng)用時(shí)對(duì)于信道的選擇具有較大的靈活性。 在深入理解RS編解碼算法,卷積交織/解交織原理,卷積編碼/VITERBI譯碼算法原理的基礎(chǔ)上,本文給出了解碼部分的設(shè)計(jì)方案,并利用Xilinx公司的SpartanⅢ系列XC3S2000芯片完成方案的硬件實(shí)現(xiàn)。在RS解碼過程中引入了流水線機(jī)制,從而很大程度上提高了解碼效率。解交織器部分采用了RAM分區(qū)循環(huán)法,利用對(duì)RAM讀寫地址的控制實(shí)現(xiàn)解卷積交織,這種方法控制電路簡(jiǎn)單,實(shí)現(xiàn)速度比較快,代價(jià)小。VITERBI譯碼器采用截尾譯碼,在幾乎不影響譯碼準(zhǔn)確度的基礎(chǔ)上大大提高了解碼效率。

    標(biāo)簽: FPGA DVB 信道 編解碼

    上傳時(shí)間: 2013-07-16

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