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計(jì)步器電路

  • 用MCP定時器控制步進電機

    用MCP定時器控制步進電機:步進電機簡介1.1.1 步進電機步進電機和普通電動機不同之處是步進電機接受脈沖信號的控制。步進電機靠一種叫環形分配器的電子開關器件，通過功率放大器使勵磁繞組按照順序輪流接通直流電源。由于勵磁繞組在空間中按一定的規律排列，輪流和直流電源接通后，就會在空間形成一種階躍變化的旋轉磁場，使轉子步進式的轉動，隨著脈沖頻率的增高，轉速就會增大。步進電機的旋轉同時與相數、分配數、轉子齒輪數有關。現在比較常用的步進電機包括反應式步進電機（VR）、永磁式步進電機（PM）、混合式步進電機（HB）和單相式步進電機等。其中反應式步進電機的轉子磁路由軟磁材料制成，定子上有多相勵磁繞組，利用磁導的變化產生轉矩。現階段，反應式步進電機獲得最多的應用。步進電機和普通電機的區別主要就在于其脈沖驅動的形式，正是這個特點，步進電機可以和現代的數字控制技術相結合。不過步進電機在控制的精度、速度變化范圍、低速性能方面都不如傳統的閉環控制的直流伺服電動機。在精度不是需要特別高的場合就可以使用步進電機，步進電機可以發揮其結構簡單、可靠性高和成本低的特點。使用恰當的時候，甚至可以和直流伺服電動機性能相媲美。

    標簽： MCP 定時器 控制 步進電機

    上傳時間： 2014-04-28

    上傳用戶：joheace

  • FPGA與ARM EPI通信，控制16路步進電機和12路DC馬達 VHDL編寫的

    FPGA與ARM EPI通信，控制16路步進電機和12路DC馬達 VHDL編寫的，，，，，

    標簽： FPGA VHDL ARM EPI

    上傳時間： 2013-10-21

    上傳用戶：zhyfjj

  • 基于FPGA的多路高速串并轉換器設計

    高速串并轉換器的設計是FPGA 設計的一個重要方面,傳統設計方法由于采用FPGA 的內部邏輯資源來實現,從而限制了串并轉換的速度。該研究以網絡交換調度系統的FGPA 驗證平臺中多路高速串并轉換器的設計為例,詳細闡述了1 :8DDR 模式下高速串并轉換器的設計方法和16 路1 :8 串并轉換器的實現。結果表明,采用Xilinx Virtex24 的ISERDES 設計的多路串并轉換器可以實現800 Mbit/ s 輸入信號的串并轉換,并且減少了設計復雜度,縮短了開發周期,能滿足設計要求。關鍵詞:串并轉換;現場可編程邏輯陣列;Xilinx ; ISERDES

    標簽： FPGA 多路 串并轉換

    上傳時間： 2013-11-03

    上傳用戶：王小奇

  • J-Link v8仿真器全制作DIY

    教你如何制作一個J-Link V8仿真器！ 已經成功！

    標簽： J-Link DIY 仿真器

    上傳時間： 2013-10-15

    上傳用戶：truth12

  • 克服能量采集無線感測器設計挑戰

    無線感測器已變得越來越普及，短期內其開發和部署數量將急遽增加。而無線通訊技術的突飛猛進，也使得智慧型網路中的無線感測器能夠緊密互連。此外，系統單晶片(SoC)的密度不斷提高，讓各式各樣的多功能、小尺寸無線感測器系統相繼問市。儘管如此，工程師仍面臨一個重大的挑戰：即電源消耗。

    標簽： 能量采集 無線感測器

    上傳時間： 2013-10-30

    上傳用戶：wojiaohs

  • 基于18B20的雙路溫度采集器設計

    基于18B20的雙路溫度采集器設計

    標簽： 18B20 溫度 集器設計

    上傳時間： 2013-11-19

    上傳用戶：zhichenglu

  • 多路多節功分器的設計與傳輸線問題的研究

    文章的設計是采用內部互聯一分二功分器的方法來實現多路功分器, 因為實際制作中很難將一分二功分器直接相連, 所以在一分二功分器之間需要采用傳輸線進行連接, 本文主要研究了內部互聯多路多節功分器的性能以及傳輸線對內部互聯多路多節功分器的影響。

    標簽： 多路 功分器 傳輸線

    上傳時間： 2013-10-26

    上傳用戶：15501536189

  • FPGA與ARM EPI通信，控制16路步進電機和12路DC馬達 VHDL編寫的

    FPGA與ARM EPI通信，控制16路步進電機和12路DC馬達 VHDL編寫的，，，，，

    標簽： FPGA VHDL ARM EPI

    上傳時間： 2013-10-31

    上傳用戶：chaisz

  • 基于FPGA的多路高速串并轉換器設計

    高速串并轉換器的設計是FPGA 設計的一個重要方面,傳統設計方法由于采用FPGA 的內部邏輯資源來實現,從而限制了串并轉換的速度。該研究以網絡交換調度系統的FGPA 驗證平臺中多路高速串并轉換器的設計為例,詳細闡述了1 :8DDR 模式下高速串并轉換器的設計方法和16 路1 :8 串并轉換器的實現。結果表明,采用Xilinx Virtex24 的ISERDES 設計的多路串并轉換器可以實現800 Mbit/ s 輸入信號的串并轉換,并且減少了設計復雜度,縮短了開發周期,能滿足設計要求。關鍵詞:串并轉換;現場可編程邏輯陣列;Xilinx ; ISERDES

    標簽： FPGA 多路 串并轉換

    上傳時間： 2013-11-17

    上傳用戶：hxy200501

  • J-LIN仿真器操作步驟

    J-LIN仿真器操作步驟，J-LIN仿真器操作步驟。

    標簽： J-LIN 仿真器 操作

    上傳時間： 2013-10-31

    上傳用戶：1966640071

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