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自己課程設(shè)計(jì)寫的程序，用FPGA控制ADC0809的轉(zhuǎn)換時(shí)序來完成模/數(shù)轉(zhuǎn)換，然后將轉(zhuǎn)換完的數(shù)字信號(hào)傳遞給0832
標(biāo)簽： FPGA 0809 ADC 轉(zhuǎn)換
上傳時(shí)間： 2013-08-30
上傳用戶：小寶愛考拉
BulkIn是FPGA向CY7C68013發(fā)送數(shù)據(jù)\r\nBulkOut是FPGA從CY7C68013接收數(shù)據(jù),可以用LED顯示\r\n
標(biāo)簽： C68013 68013 FPGA CY7
上傳用戶：anng
介紹用FPGA設(shè)計(jì)實(shí)現(xiàn)MIL-STD1553B部接口中的曼徹斯特碼編解碼器
標(biāo)簽： MIL-STD FPGA 1553 設(shè)計(jì)實(shí)現(xiàn)
上傳用戶：Amygdala
用Verilog實(shí)現(xiàn)基于FPGA的通用分頻器
標(biāo)簽： Verilog FPGA 分頻器
上傳用戶：xingyuewubian
此程序用通過PFGA用VHDL語言實(shí)現(xiàn)了傅立葉變換，希望對(duì)大家有用
標(biāo)簽： PFGA VHDL 程序 傅立葉變換
上傳用戶：tonyshao
用CPLD驅(qū)動(dòng)SJA1000 CAN控制器
標(biāo)簽： CPLD 1000 CAN SJA
上傳時(shí)間： 2013-08-31
上傳用戶：壞壞的華仔
用CPLD做了個(gè)FPGA的FPP下載時(shí)序，驗(yàn)證過。
標(biāo)簽： CPLD FPGA FPP
上傳用戶：xy@1314
自己現(xiàn)在用的CPLD下載線，用74HC244芯片\r\n要注意設(shè)置下載模式
標(biāo)簽： CPLD 244 74 HC
上傳用戶：dancnc
用CPLD控制曼徹斯特編解碼器，很詳細(xì)的文字說明。
標(biāo)簽： CPLD 控制 曼徹斯特 編解碼器
上傳時(shí)間： 2013-09-01
上傳用戶：xiaodu1124
用單片機(jī)AT89s52和epm7128設(shè)計(jì)的頻率計(jì)
標(biāo)簽： 7128 89s s52 epm
上傳用戶：671145514
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