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連續的

  • 算法FPGA實現的直接數字頻率合成器

    高精度的信號源是各種測試和實驗過程中不可缺少的工具,在通信、雷達、測量、控制、教學等領域應用十分廣泛。傳統的頻率合成方法設計的信號源在功能、精度、成本等方面均存在缺陷和不足,不能滿足電子技術的發展要求,直接數字合成(Direct Digital Synthesis)DDS技術可以提供高性能、高頻高精度的信號源,方便地獲得分辨率高且相位連續的信號,基于FPGA的DDS技術提供了升級方便并且成本低廉的解決方案。    本文對DDS的基本原理和輸出頻譜特性進行理論分析,總結出雜散分布規律。同時以DDS的頻譜分析為基礎,給出了幾種改善雜散的方法。本文結合相關文獻資料采用傅立葉變換的方法對相位截斷時DDS雜散信號的頻譜特性進行了研究,得到了雜散分布的規律性結論,并應用在程序設計程中;DDS技術的實現依賴于高速、高性能的數字器件,本文將FPGA器件和DDS技術相結合,確定了FPGA器件的整體設計方案,詳細說明了各個模塊的功能和設計方法,并對其關鍵部分進行了優化設計,從而實現了波形發生器數字電路部分的功能。軟件部分采用模塊設計方法,十分方便調試。為了得到滿足設計要求的模擬波形,本文還設計了幅度調節、D/A轉換和低通濾波等外圍硬件電路。    實驗結果表明,本文設計的基于DDS技術的多波形信號源基本能夠滿足普通學生實驗室的要求。

    標簽: FPGA 算法 數字頻率合成器

    上傳時間: 2013-06-11

    上傳用戶:woshiayin

  • 基于PCI9054的數據轉換模塊設計

    為了實現把軟件仿真的數據通過PCI總線DMA傳輸、處理后轉換成高速視頻串行數據流(LVDS數據流),設計出了基于PCI9054的數據轉換模塊。通過介紹PCI總線接口協議芯片PCI9054的性能、特點,分析了windows的WDM驅動程序的特點,在軟硬件設計中采用把數據緩存器設置為兩組SRAM的結構,兩組SRAM交替進行數據存取的方式,有效克服了數據流不連續的現象,解決了形成不間斷數據流和兩次DMA傳輸之間的數據間斷問題。應用結果表明,該設計可滿足數字視頻帶寬20 MHz以內的LVDS數據流的轉換與傳輸。    

    標簽: 9054 PCI 數據轉換 模塊設計

    上傳時間: 2014-12-26

    上傳用戶:jisujeke

  • 基于CH365的PCI總線運動控制卡的設計

    為實現基于PCI總線的運動控制,設計了一款以國產芯片CH365為核心的運動控制卡,給出設計原理圖,開發基于DOS的開源驅動函數庫和基于Windows的驅動程序及動態鏈接庫,并對運動控制卡驅動程序的編寫做了詳細的介紹,對中斷服務程序的工作流程也做了完整的說明,通過這些函數庫及驅動程序,可方便地對伺服電機進行步進式及脈沖式控制,實現各種方向連續的曲線加工和速度控制。經測試,設計的運動控制卡在實時性、可靠性、插補速度和加工精度方面都有較大的優勢,具有較好的應用前景。

    標簽: 365 PCI CH 總線

    上傳時間: 2013-11-09

    上傳用戶:yeling1919

  • 基于仿生原理的架空輸電線路巡線機器人越障模型

    針對目前架空輸電線路巡線機器人連續巡線能力低、對大型障礙物越障適應能力弱的問題,提出基于仿生學原理的巡線機器人越障模型。設計兩吊臂式巡線機器人,建立機器人的動力學模型,通過調整機器人兩個手臂的相對角度和輪爪與障礙物的相對位置,求解模型的周期跨越動作,通過連續的兩次擺動,完成了巡線機器人在輸電線路上的越障過程。結果表明,當θ1為2.41(rad)時,巡線機器人以靜止狀態開始擺動,完成了周期的越障的運動過程。文中為巡線機器人的越障問題提供了新的思路和設計方法。

    標簽: 仿生 架空輸電 巡線機器人 線路

    上傳時間: 2013-10-11

    上傳用戶:zhuyibin

  • 開關磁阻電機調速系統的主要研究 “開關磁阻電機(Switched reluctance motor簡稱SR電動機)”一詞源見于美國學者S.A.Nasar1969年所撰論文

    開關磁阻電機調速系統的主要研究 “開關磁阻電機(Switched reluctance motor簡稱SR電動機)”一詞源見于美國學者S.A.Nasar1969年所撰論文,它描述了這種電機的兩個基本特征:1開關性——電機必須工作在一種連續的開關模式,這是為什么在各種新型半導體器件獲得后才得以發展得主要原因;2磁阻性——它是真正的磁阻電機,定、轉子具有可變磁阻回路。

    標簽: reluctance Switched Nasar motor

    上傳時間: 2013-12-17

    上傳用戶:ynsnjs

  • 本程序模擬100塊球場的資源分配

    本程序模擬100塊球場的資源分配,足球場代號0~99,可以申請和釋放足球場的場地,,申請和釋放必須是連續的場地,申請過的人或者公司以名字為標記,可以隨時查看場地的占用情況(程序有顯示)。

    標簽: 100 程序 模擬 資源分配

    上傳時間: 2014-12-01

    上傳用戶:cx111111

  • 如果您用的是51等慢速的單片機可能沒什么事情

    如果您用的是51等慢速的單片機可能沒什么事情,當用ARM等快速的處理器作大量數據傳輸時可能會出現丟包的現象。在MCU連續的給主機發包的過程中,主機還沒有將上一個包的數據從D12讀走(就是D12的緩沖區處于滿的情況),MCU又將另一個包寫進去時會覆蓋掉以前的。因此在每寫入一個包時必須先判斷D12有沒有空的緩沖區,

    標簽: 單片機

    上傳時間: 2015-08-30

    上傳用戶:xzt

  • 用verilog設計密勒解碼器 一、題目: 設計一個密勒解碼器電路 二、輸入信號: 1. DIN:輸入數據 2. CLK:頻率為2MHz的方波

    用verilog設計密勒解碼器 一、題目: 設計一個密勒解碼器電路 二、輸入信號: 1. DIN:輸入數據 2. CLK:頻率為2MHz的方波,占空比為50% 3. RESET:復位信號,低有效 三、輸入信號說明: 輸入數據為串行改進密勒碼,每個碼元持續時間為8μs,即16個CLK時鐘;數據流是由A、B、C三種信號組成; A:前8個時鐘保持“1”,接著5個時鐘變為“0”,最后3個時鐘為“1”。 B:在整個碼元持續時間內都沒有出現“0”,即連續16個時鐘保持“1”。 C:前5個時鐘保持“0”,后面11個時鐘保持“1”。 改進密勒碼編碼規則如下: 如果碼元為邏輯“1”,用A信號表示。 如果碼元為邏輯“0”,用B信號表示,但以下兩種特例除外:如果出現兩個以上連“0”,則從第二個“0”起用C信號表示;如果在“通信起始位”之后第一位就是“0”,則用C信號表示,以下類推; “通信起始位”,用C信號表示; “通信結束位”,用“0”及緊隨其后的B信號表示。 “無數據”,用連續的B信號表示。

    標簽: verilog 2MHz DIN CLK

    上傳時間: 2013-12-02

    上傳用戶:wang0123456789

  • 將運算的結果(浮點數)存入eeprom中。我們知道

    將運算的結果(浮點數)存入eeprom中。我們知道,浮點數在c語言中是以ieee格式存儲 的,一個浮點數占用四個字節,例如浮點數34.526存為(160,26,10,66)這四個數。要 將一個浮點數存入eeprom,實際上就是要存這四個數。那么如何在程序中得到一個浮點數的 組成數呢? 浮點數在存儲時,是存儲連續的字節中的,只要設法找到存儲位置,就可以得到這些數了。 可以定義一個void的指針,將此指針指向需要存儲的浮點數,然后將此指針強制轉化為char型,這樣,利用指針就可以得到組成該浮點數的各個字節的值了!

    標簽: eeprom 運算 浮點數

    上傳時間: 2014-01-21

    上傳用戶:a673761058

  • 計算機對數據的處理都是以二進制數的形式來完成的

    計算機對數據的處理都是以二進制數的形式來完成的,因此計算機處理的信號數值上和時間上都不是連續的,而是離散的

    標簽: 計算機 對數 二進制數

    上傳時間: 2014-01-24

    上傳用戶:zhangyigenius

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