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通信天線

  • FPGA與ARM EPI通信,控制16路步進(jìn)電機(jī)和12路DC馬達(dá) VHDL編寫的

    FPGA與ARM EPI通信,控制16路步進(jìn)電機(jī)和12路DC馬達(dá) VHDL編寫的,,,,,

    標(biāo)簽: FPGA VHDL ARM EPI

    上傳時(shí)間: 2013-10-21

    上傳用戶:zhyfjj

  • 初學(xué)ModelSimSE時(shí)被迷糊了幾天的若干概念[1].unlocked

    初學(xué)ModelSimSE時(shí)被迷糊了幾天的若干概念[1].unlocked

    標(biāo)簽: ModelSimSE unlocked

    上傳時(shí)間: 2013-11-09

    上傳用戶:neu_liyan

  • 七天玩轉(zhuǎn)Altera:學(xué)習(xí)FPGA必經(jīng)之路

             七天玩轉(zhuǎn)Altera:學(xué)習(xí)FPGA必經(jīng)之路包括基礎(chǔ)篇、時(shí)序篇和驗(yàn)證篇三個(gè)部分。

    標(biāo)簽: Altera FPGA

    上傳時(shí)間: 2013-10-11

    上傳用戶:woshinimiaoye

  • 基于Xilinx+FPGA的OFDM通信系統(tǒng)基帶設(shè)計(jì)-程序

    《基于Xilinx FPGA的OFDM通信系統(tǒng)基帶設(shè)計(jì)》附帶的代碼

    標(biāo)簽: Xilinx FPGA OFDM 通信系統(tǒng)

    上傳時(shí)間: 2014-01-10

    上傳用戶:15501536189

  • 用FPGA實(shí)現(xiàn)RS485通信接口芯片

    在點(diǎn)對(duì)多點(diǎn)主從通信系統(tǒng)中,需要合適的接口形式和通信協(xié)議實(shí)現(xiàn)主站與各從站的信息交換。RS -485 接口是適合這種需求的一種標(biāo)準(zhǔn)接口形式。當(dāng)選擇主從多點(diǎn)同步通信方式時(shí),工作過(guò)程與幀格式符合HDLC/SDLC協(xié)議。介紹了采用VHDL 語(yǔ)言在FPGA 上實(shí)現(xiàn)的以HDLC/ SDLC 協(xié)議控制為基礎(chǔ)的RS - 485 通信接口芯片。實(shí)驗(yàn)表明,這種接口芯片操作簡(jiǎn)單、體積小、功耗低、可靠性高,極具實(shí)用價(jià)值。

    標(biāo)簽: FPGA 485 RS 通信接口

    上傳時(shí)間: 2013-11-02

    上傳用戶:zhf01y

  • 擴(kuò)頻通信芯片STEL-2000A的FPGA實(shí)現(xiàn)

    針對(duì)傳統(tǒng)集成電路(ASIC)功能固定、升級(jí)困難等缺點(diǎn),利用FPGA實(shí)現(xiàn)了擴(kuò)頻通信芯片STEL-2000A的核心功能。使用ISE提供的DDS IP核實(shí)現(xiàn)NCO模塊,在下變頻模塊調(diào)用了硬核乘法器并引入CIC濾波器進(jìn)行低通濾波,給出了DQPSK解調(diào)的原理和實(shí)現(xiàn)方法,推導(dǎo)出一種簡(jiǎn)便的引入?仔/4固定相移的實(shí)現(xiàn)方法。采用模塊化的設(shè)計(jì)方法使用VHDL語(yǔ)言編寫出源程序,在Virtex-II Pro 開發(fā)板上成功實(shí)現(xiàn)了整個(gè)系統(tǒng)。測(cè)試結(jié)果表明該系統(tǒng)正確實(shí)現(xiàn)了STEL-2000A的核心功能。 Abstract:  To overcome drawbacks of ASIC such as fixed functionality and upgrade difficulty, FPGA was used to realize the core functions of STEL-2000A. This paper used the DDS IP core provided by ISE to realize the NCO module, called hard core multiplier and implemented CIC filter in the down converter, described the principle and implementation detail of the demodulation of DQPSK, and derived a simple method to introduce a fixed phase shift of ?仔/4. The VHDL source code was designed by modularity method , and the complete system was successfully implemented on Virtex-II Pro development board. Test results indicate that this system successfully realize the core function of the STEL-2000A.

    標(biāo)簽: STEL 2000 FPGA 擴(kuò)頻通信

    上傳時(shí)間: 2013-11-06

    上傳用戶:liu123

  • 基于FPGA的多通道HDLC通信系統(tǒng)設(shè)計(jì)與實(shí)現(xiàn)

    為了滿足某測(cè)控平臺(tái)的設(shè)計(jì)要求,設(shè)計(jì)并實(shí)現(xiàn)了基于FPGA的六通道HDLC并行通信系統(tǒng)。該系統(tǒng)以FPGA為核心,包括FPGA、DSP、485轉(zhuǎn)換接口等部分。給出了系統(tǒng)的電路設(shè)計(jì)、關(guān)鍵模塊及軟件流程圖。測(cè)試結(jié)果表明,系統(tǒng)通訊速度為1 Mb/s,并且工作穩(wěn)定,目前該設(shè)計(jì)已經(jīng)成功應(yīng)用于某樣機(jī)中。

    標(biāo)簽: FPGA HDLC 多通道 通信

    上傳時(shí)間: 2013-11-25

    上傳用戶:王成林。

  • 基于PWM技術(shù)的紅外語(yǔ)音通信系統(tǒng)設(shè)計(jì)

    制作紅外通信

    標(biāo)簽: PWM 紅外 系統(tǒng)設(shè)計(jì) 語(yǔ)音通信

    上傳時(shí)間: 2014-01-03

    上傳用戶:manlian

  • 一種用排隊(duì)論指導(dǎo)的CAN總線語(yǔ)音通信系統(tǒng)設(shè)計(jì)

    針對(duì)傳統(tǒng)語(yǔ)音通信系統(tǒng)存在的地址編碼繁雜、通信模式單一、難于維護(hù)的缺陷,設(shè)計(jì)了一款適用于工業(yè)現(xiàn)場(chǎng)的多功能語(yǔ)音通信系統(tǒng)。在排隊(duì)論的基礎(chǔ)上,對(duì)CAN總線語(yǔ)音通信系統(tǒng)進(jìn)行了理論分析,重點(diǎn)介紹了CAN總線的軟硬件設(shè)計(jì)。對(duì)系統(tǒng)的性能測(cè)試結(jié)果表明,系統(tǒng)的CAN幀丟失率<0.5‰,語(yǔ)音質(zhì)量能通過(guò)主觀試聽和客觀測(cè)試,整體系統(tǒng)工作良好。

    標(biāo)簽: CAN 總線 語(yǔ)音通信 系統(tǒng)設(shè)計(jì)

    上傳時(shí)間: 2014-12-28

    上傳用戶:aa54

  • 基于MELP的水下實(shí)時(shí)語(yǔ)音通信機(jī)的研究與實(shí)現(xiàn)

    基于MELP的水下實(shí)時(shí)語(yǔ)音通信機(jī)的研究與實(shí)現(xiàn)

    標(biāo)簽: MELP 語(yǔ)音 通信機(jī)

    上傳時(shí)間: 2013-11-08

    上傳用戶:1966649934

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