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邏輯分析儀

邏輯分析儀是分析數字系統邏輯關系的儀器。邏輯分析儀是屬于數據域測試儀器中的一種總線分析儀,即以總線(多線)概念為基礎,同時對多條數據線上的數據流進行觀察和測試的儀器,這種儀器對復雜的數字系統的測試和分析十分有效。邏輯分析儀是利用時鐘從測試設備上采集和顯示數字信號的儀器,最主要作用在于時序判定。由于邏輯分析儀不像示波器那樣有許多電壓等級,通常只顯示兩個電壓(邏輯1和0),因此設定了參考電壓后,邏輯分析儀將被測信號通過比較器進行判定,高于參考電壓者為High,低于參考電壓者為Low,在High與Low之間形成數字波形。[1]
  • 全數字OQPSK解調算法的研究及FPGA實現

    隨著各種通信系統數量的日益增多,為了充分地利用有限的頻譜資源,高頻譜利用率的調制技術不斷被應用。偏移正交相移鍵控(OQPSK: Offset QuadraturePhase Shift Keying)是一種恒包絡調制技術,具有較高的頻譜利用率和功率利用率,廣泛應用于衛星通信系統和地面移動通信系統。因此,對于OQPSK全數字解調技術的研究具有一定的理論價值。 本文以軟件無線電和全數字解調的相關理論為指導,成功設計并實現了基于FPGA的OQPSK全數字解調。論文介紹了OQPSK全數字接收解調原理和基于軟件無線電設計思想的全數字接收機的基本結構,詳細闡述了當今OQPSK數字解調中載波頻率同步、載波相位同步、時鐘同步和數據幀同步的一些常用算法,并選擇了相應算法構建了三種系統級的實現方案。通過MATLAB對解調方案的仿真和性能分析,確定了FPGA中的系統實現方案。在此基礎上,本文采用VerilogHDL硬件描述語言在Altera公司的Quartus II開發平臺上設計了同步解調系統中的各個模塊,還對各模塊和整個系統在ModelSim中進行了時序仿真驗證,并對設計中出現的問題進行了修正。最后,經過FPGA調試工具嵌入式邏輯分析儀SignalTapⅡ的硬件實際測試,本文對系統方案進行了最終的改進與調整。 實際測試結果表明,本文的設計最終能夠達到了預期的指標和要求。本課題設計經過時序和資源優化后還可以向ASIC和系統級SOC轉化,以進一步縮小系統體積、降低成本和提高電路的可靠性,因此具有良好的實際應用價值。

    標簽: OQPSK FPGA 全數字 解調

    上傳時間: 2013-07-14

    上傳用戶:aappkkee

  • 《電子系統設計與實踐》設計實例

    西安交通大學電氣工程學院編寫的《電子系統設計與實踐》中的第7章節--電子系統設計設計實例,既有理論分析又有具體方案介紹,內容有:簡易數字頻率計、數字式工頻有效值多用表、存貯式數字式示波器、簡易邏輯分析儀、低頻數字式相位測試儀、液體點滴速度監控裝置。值得參考。

    標簽: 電子系統設計 實踐 設計實例

    上傳時間: 2013-06-23

    上傳用戶:kristycreasy

  • 三態門總線傳輸電路的Multisim仿真方案

    基于探索仿真三態門總線傳輸電路的目的,采用Multisim10仿真軟件對總線連接的三態門分時輪流工作時的波形進行了仿真實驗測試,給出了仿真實驗方案,即用Multisim仿真軟件構成環形計數器產生各個三態門的控制信號、用脈沖信號源產生各個三態門不同輸入數據信號,用Multisim仿真軟件中的邏輯分析儀多蹤同步顯示各個三態門的控制信號、數據輸入信號及總線輸出信號波形,結論是仿真實驗可直觀形象地描述三態門總線傳輸電路的工作特性,所述方法的創新點是解決了三態門的工作波形無法用電子實驗儀器進行分析驗證的問題。

    標簽: Multisim 三態門 總線傳輸 仿真

    上傳時間: 2013-12-14

    上傳用戶:jackandlee

  • 5 Gsps高速數據采集系統的設計與實現

    以某高速實時頻譜儀為應用背景,論述了5 Gsps采樣率的高速數據采集系統的構成和設計要點,著重分析了采集系統的關鍵部分高速ADC(analog to digital,模數轉換器)的設計、系統采樣時鐘設計、模數混合信號完整性設計、電磁兼容性設計和基于總線和接口標準(PCI Express)的數據傳輸和處理軟件設計。在實現了系統硬件的基礎上,采用Xilinx公司ISE軟件的在線邏輯分析儀(ChipScope Pro)測試了ADC和采樣時鐘的性能,實測表明整體指標達到設計要求。給出上位機對采集數據進行處理的結果,表明系統實現了數據的實時采集存儲功能。

    標簽: Gsps 高速數據 采集系統

    上傳時間: 2014-11-26

    上傳用戶:黃蛋的蛋黃

  • 單片機仿真軟件proteus V7.5 SP3中文版下載_單片機模擬仿真軟件

    單片機仿真軟件Proteus是英國Labcenter electronics公司出版的EDA工具軟件,下面不僅介紹了它的使用方法和Proteus 特色功能,以下還有Proteus的安裝方法。Proteus它不僅具有其它EDA工具軟件的仿真功能,還能仿真單片機及外圍器件。它是目前最好的仿真單片機及外圍器件的工具。雖然目前國內推廣剛起步,但已受到單片機愛好者、從事單片機教學的教師、致力于單片機開發應用的科技工作者的青睞。Proteus是世界上著名的EDA工具(仿真軟件),從原理圖布圖、代碼調試到單片機與外圍電路協同仿真,一鍵切換到PCB設計,真正實現了從概念到產品的完整設計。是目前世界上唯一將電路仿真軟件、PCB設計軟件和虛擬模型仿真軟件三合一的設計平臺,其處理器模型支持8051、HC11、PIC10/12/16/18/24/30/DsPIC33、AVR、ARM、8086和MSP430等,2010年即將增加Cortex和DSP系列處理器,并持續增加其他系列處理器模型。在編譯方面,它也支持IAR、Keil和MPLAB等多種編譯器。 proteusV7.5 SP3中文版安裝方法 1.執行setup75 Sp3.exe安裝proteus 7.5 Sp3; 2.添加licence時指定到Grassington North Yorkshire.lxk; 3.安裝完成后執行LXK Proteus 7.5 SP3 v2.1.,將目錄指定到X:\Program Files\Labcenter Electronics\Proteus 7 Professional (X是你安裝的盤符), 然后執行update; 漢化方法 將漢化文件解壓覆蓋到X:\Program Files\Labcenter Electronics\Proteus 7 Professional \BIN 單片機仿真軟件Proteus 使用方法 Proteus軟件破解版是根據官方放出的Demo版制作而成,其中有很多器件由于沒有仿真模型而無法使用,該軟件最大的優點在于能夠對常用微控制器進行仿真,適合于剛剛接觸單片機以及進行數模電綜合仿真的用戶使用,但是由于仿真精度等等原因,仿真結果不夠精細,甚至可能有錯誤,不要盲目信任仿真結果。 Proteus(海神)的ISIS是一款Labcenter出品的電路分析實物仿真系統,可仿真各種電路和IC,并支持單片機,元件庫齊全,使用方便,是不可多得的專業的單片機軟件仿真系統。 單片機仿真軟件Proteus 特色功能 ① 全部滿足我們提出的單片機軟件仿真系統的標準,并在同類產品中具有明顯的優勢。   ②具有模擬電路仿真、數字電路仿真、單片機及其外圍電路組成的系統的仿真、RS-232動態仿真、C調試器、SPI調試器、鍵盤和LCD系統仿真的功能;有各種虛擬儀器,如示波器、邏輯分析儀、信號發生器等。   ③ 目前支持的單片機類型有:68000系列、8051系列、AVR系列、PIC12系列、PIC16系列、PIC18系列、Z80系列、HC11系列以及各種外圍芯片。   ④ 支持大量的存儲器和外圍芯片。總之該軟件是一款集單片機和SPICE分析于一身的仿真軟件,功能極其強大 ,可仿真51、AVR、PIC。

    標簽: proteus 7.5 SP3 單片機仿真軟件

    上傳時間: 2013-11-08

    上傳用戶:kernaling

  • proteus7.8破解版(附帶Proteus中文入門教程)

    附件下載proteus7.8破解版包含了Proteus中文入門教程在內 Proteus Pro 7.8 sp2 漢化破解版,該Proteus 漢化破解版解決了7.2版本運行10分鐘就自動關閉的問題,是目前最Protus中最高的版本。Proteus 不僅具有其它EDA工具軟件的仿真功能,還能仿真單片機及外圍器件,它是目前最好的仿真單片機及外圍器件的工具。從原理圖布圖、代碼調試到單片機與外圍電路協同仿真,一鍵切換到PCB設計,真正實現了從概念到產品的完整設計。 Proteus 是目前世界上唯一將電路仿真軟件、PCB設計軟件和虛擬模型仿真軟件三合一的設計平臺,其處理器模型支持8051、HC11、PIC10/12/16/18/24/30/DsPIC33、AVR、ARM、8086和MSP430等,Proteus為您建立完整的電子設計開發環境。中文系統可用,不需修改 “非unicode程序的語言”設置,不用改區域語言設置,也不要安裝其他破解。 proteus7.8破解版安裝步驟: 先安裝P7.8sp2.exe,再運行"Proteus Pro 7.8 SP2破解1.0.exe"破解,再漢化。這個漢化補丁用7.5的漢化修改而來,覆蓋前注意備份原文件,如果漢化報錯,就將“漢化報錯.exe” 復制到安裝文件夾再運行。 Proteus 不僅具有其它EDA工具軟件的仿真功能,還能仿真單片機及外圍器件,它是目前最好的仿真單片機及外圍器件的工具。從原理圖布圖、代碼調試到單片機與外圍電路協同仿真,一鍵切換到PCB設計,真正實現了從概念到產品的完整設計。 Proteus中文入門教程 Proteus ISIS是英國Labcenter公司開發的電路分析與實物仿真軟件。它運行于Windows操作系統上,可以仿真、分析(SPICE)各種模擬器件和集成電路,該軟件的特點是:①實現了單片機仿真和SPICE電路仿真相結合。具有模擬電路仿真、數字電路仿真、單片機及其外圍電路組成的系統的仿真、RS232動態仿真、I2C調試器、SPI調試器、鍵盤和LCD系統仿真的功能;有各種虛擬儀器,如示波器、邏輯分析儀、信號發生器等。②支持主流單片機系統的仿真。目前支持的單片機類型有:68000系列、8051系列、AVR系列、PIC12系列、PIC16系列、PIC18系列、Z80系列、HC11系列以及各種外圍芯片。③提供軟件調試功能。在硬件仿真系統中具有全速、單步、設置斷點等調試功能,同時可以觀察各個變量、寄存器等的當前狀態,因此在該軟件仿真系統中,也必須具有這些功能;同時支持第三方的軟件編譯和調試環境,如Keil C51 uVision2等軟件。④具有強大的原理圖繪制功能。總之,該軟件是一款集單片機和SPICE分析于一身的仿真軟件,功能極其強大。本章介紹Proteus ISIS軟件的工作環境和一些基本操作。 Proteus中文入門教程目  錄 第一章  概述 2 一、進入Proteus ISIS 2 二、工作界面 3 三、基本操作 3 圖形編輯窗口 3 預覽窗口(The Overview Window) 4 對象選擇器窗口 5 圖形編輯的基本操作 5 參考1 10 參考2作原理圖仿真調試 12 四、實例一 16 電路圖的繪制 17 KeilC與Proteus連接調試 26 五、實例二 30 使用元件工具箱 30 使用狀態信息條 30 使用對話框 30 使用仿真信息窗口 30 關閉Proteus ISIS 30 四、菜單命令簡述 31 主窗口菜單 31 表格輸出窗口(Table)菜單 33 方格輸出窗口(Grid)菜單 33 Smith圓圖輸出窗口(Smith)菜單 33 直方圖輸出窗口(Histogram)菜單 33 第二章 基于51的PID爐溫度調節器的硬件設計及仿真 34

    標簽: proteus Proteus 7.8 破解版

    上傳時間: 2013-11-20

    上傳用戶:tangsiyun

  • LAB6000U(USB接口)單片機/微控制器仿真實驗系統

    偉福LAB6000U系列仿真實驗系統性能特點:USB通信接口+串行通信接口含偉福先進的E6000仿真功能,硬件斷點、不占用用戶資源含32路、16K深度、10M的邏輯分析儀,32K深度跟蹤器,8路、20M波形發生器含靜態硬件測試儀(windows版本)含保護電路,仿真器部分與用戶電路部分采用隔離技術,使用更加安全可靠一機多用,配置51/96/8088仿真板可以仿真MCS51/MCS96/8086具有擴展功能,在板DIP擴展座和EPLD擴展座給實驗的擴展提供空間軟件平臺使用最新偉福E6000仿真器軟件,運行于WIN9x/WINME/WINNT

    標簽: 6000U 6000 LAB USB

    上傳時間: 2013-10-23

    上傳用戶:chfanjiang

  • 單片機原理與接口技術實驗指導書

    偉福仿真器系統概述 本仿真器系統由仿真主機+仿真頭、MULT1A用戶板、實驗板、開關電源等組成。本系統的特點是: 1.主機+仿真頭的組合,通過更換不同型號的仿真頭即可對各種不同類型的單片機進行仿真,是一種靈活的多CPU仿真系統。采用主機+POD組合的方式,更換POD,可以對各種CPU進行仿真。本仿真器主機型號為E2000/S,仿真頭型號為POD8X5X(可仿真51系列8X5X單片機)。 2.雙平臺,具有DOS版本和WINDOWS版本,后者功能強大,中/英文界面任選,用戶源程序的大小不再有任何限制,支持ASM,c,PLM語言混合編程,具有項目管理功能,為用戶的資源共享、課題重組提供強有力的手段。支持點屏顯示,用鼠標左鍵點一下源程序中的某一變量,即可顯示該變量的數值。有豐富的窗口顯示方式,多方位,動態地顯示仿真的各種過程,使用極為便利。本操作系統一經推出,立即被廣大用戶所喜愛。 3.雙工作模式①.軟件模擬仿真(不要仿真器也能模擬仿真)。②硬件仿真。 4.雙CPU結構,100%不占用戶資源。全空間硬件斷點,不受任何條件限制,支持地址、數據、外部信號、事件斷點、支持實時斷點計數、軟件運行時間統計。 5.雙集成環境編輯、編譯、下載、調試全部集中在一個環境下。多種仿真器,多類CPU仿真全部集成在一個環境下。可仿真51系列,196系列,PIC系列,飛利蒲公司的552、LPC764、DALLAS320,華邦438等51增強型CPU。為了跟上形勢,現在很多工程師需要面對和掌握不同的項目管理器、編輯器、編譯器。他們由不同的廠家開發,相互不兼容,使用不同的界面,學習使用都很吃力。偉福WINDOWS調試軟件為您提供了一個全集成環境,統一的界面,包含一個項目管理器,一個功能強大的編輯器,匯編Make、Build和調試工具并提供千個與第三方編譯器的接口。由于風格統一,大大節省了您的精力和時間。 6.強大的邏輯分析儀綜合調試功能。邏輯分析儀由交互式軟件菜單窗口對系統硬件的邏輯或時序進行同步實時采樣,并實時在線調試分析,采集深度32K(E2000/L),最高時基采樣頻率達20MHz,40路波形,可精確實時反映用戶程序運行時的歷史時間。系統在使用邏輯分析儀時,除普通的單步運行、鍵盤斷點運行、全速硬件斷點運行外,還可實現各種條件組合斷點如:數據、地址、外部控制信號、CPU內部控制信號、程序區間斷點等。由于邏輯儀可以直接對程序的執行結果進行分析,因此極大地便利于程序的調試。隨著科學技術的發展,單片機通訊方面的運用越來越多。在通訊功能的調試時,如果通訊不正常,查找原因是非常耗時和低效的,您很難搞清楚問題到底在什么地方,是波特率不對,是硬件信道有問題,是通訊協儀有問題,是發方出錯還是收方出錯。有了邏輯儀,情況則完全不一樣,用它可以分別或者同時對發送方、接收方的輸入或者輸出波形進行記錄、存儲、對比、測量等各種直觀的分析,可以將實際輸出通訊報文的波形與源程序相比較,可立即發現問題所在,從而極大地方便了調試。 7.強大的追蹤器功能追蹤功能以總線周期為單位,實時記錄仿真過程中CPU發生的總線事件,其觸發條件方式同邏輯分析儀。追蹤窗口在仿真停止時可收集顯示追蹤的CPU指令記憶信息,可以以總線反匯編碼模式、源程序模式對應顯示追蹤結果。屏幕窗口顯示波形圖最多追蹤記憶指令32K并通過仿真器的斷點、單步、全速運行或各種條件組合斷點來完成追蹤功能。總線跟蹤可以跟蹤程序的運行軌跡。可以統計軟件運行時間。

    標簽: 單片機原理 接口技術 實驗指導書

    上傳時間: 2013-11-01

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  • 如何使用高級觸發測量程序跑飛

    如何使用高級觸發測量程序跑飛:LA系列邏輯分析儀內部集成了32位的定時器、32位的計數器和高速比較模塊,高效的使用以上模塊資源可以使您的測量事半功倍。邏輯分析儀在實際應用中主要作用有:1.觀察波形,看看測量波形中是否存在毛刺、干擾、頻率是否正確等;2.時序測量,對被測信號進行時序校對,看看操作時序是否符合要求。3.輔助分析,利用邏輯分析儀完善的協議分析功能來進行輔助分析;4.查錯功能,利用邏輯分析儀強大的觸發功能來進行錯誤捕獲。當單片機的PC值(程序計數器)對沒有程序的地方進行取指時,稱為程序跑飛。程序跑飛的原因有多種,主要有以下原因:1) 客觀原因:單片機受到外界強干擾造成PC值寄存器改變;2)程序Bug:用戶程序調用函數指針,對非程序空間進行對用。以80C51單片機為例子,當程序跑到非用戶程序區時,單片機使用PSEN對外部程序進行取指,使用邏輯分析儀可以設置觸發條件,當使用PSEN對外部程序進行取指時進行記錄,把出錯情況前后的狀態記錄下來進行分析,查找出錯原因。如80C51的取指范圍正確為0x0000~0x3fff,則當對0x3fff以上地址進行取指時為程序跑飛。分析80C51對外部程序取指的時序,如圖1所示。

    標簽: 如何使用 觸發 測量程序

    上傳時間: 2013-10-11

    上傳用戶:panpanpan

  • 基于DSP Builder數字信號處理器的FPGA設計

    針對使用硬件描述語言進行設計存在的問題,提出一種基于FPGA并采用DSP Builder作為設計工具的數字信號處理器設計方法。并按照Matlab/Simulink/DSP Builder/QuartusⅡ設計流程,設計了一個12階FIR 低通數字濾波器,通過Quartus 時序仿真及嵌入式邏輯分析儀SignalTapⅡ硬件測試對設計進行了驗證。結果表明,所設計的FIR 濾波器功能正確,性能良好。 Abstract:  Aiming at the problems in designing DSP using HDL,a method of designing DSP based on FPGA which using DSP Builder as designed tool is pointed out.A 12-order low-pass FIR digital filter was designed according to the process of Matlab/Simulink/DSP Builder/QuartusⅡ, and the design was verified by the timing simulation based on QuartusⅡand practical test based on SignalTapⅡ. The result shows the designed filter is correct in function and good in performance.

    標簽: Builder FPGA DSP 數字信號處理器

    上傳時間: 2013-11-17

    上傳用戶:lo25643

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