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邱關(guān)(guān)源

  • 計(jì)算二階有源濾波、一階有源濾波、阻容充放電

    計(jì)算二階有源濾波、一階有源濾波、阻容充放電。

    標(biāo)簽: 有源濾波 計(jì)算 二階 充放電

    上傳時(shí)間: 2013-11-17

    上傳用戶:hgmmyl

  • 3GHz射頻信號(hào)源模塊GR6710

    產(chǎn)品概要: 3GHz射頻信號(hào)源模塊GR6710是軟件程控的虛擬儀器模塊,可以通過(guò)測(cè)控軟件產(chǎn)生9kHz到3GHz的射頻信號(hào)源和AM/FM/CW調(diào)制輸出,具有CPCI、PXI、SPI、RS232、RS485和自定義IO接口。 產(chǎn)品描述: 3GHz射頻信號(hào)源模塊GR6710是軟件程控的虛擬儀器模塊,可以通過(guò)測(cè)控軟件產(chǎn)生9kHz到3GHz的射頻信號(hào)源和AM/FM/CW調(diào)制輸出,還可以通過(guò)IQ選件實(shí)現(xiàn)其它任意調(diào)制輸出。GR6710既可程控發(fā)生點(diǎn)頻信號(hào)和掃頻信號(hào),也支持內(nèi)部調(diào)制和外部調(diào)制。GR6710可安裝于3U/6U背板上工作,也可以獨(dú)立供電工作,使用靈活。該模塊可用于通信測(cè)試、校準(zhǔn)信號(hào)源。 技術(shù)指標(biāo) 頻率特性 頻率范圍:9kHz~3GHz,500KHz以下指標(biāo)不保證 頻率分辨率:3Hz,1Hz(載頻<10MHz時(shí)) 頻率穩(wěn)定度:晶振保證 電平特性 電平范圍:-110dBm~+10dBm 電平分辨率:0.5dB 電平準(zhǔn)確度:≤±2.5dB@POWER<-90dBm,≤±1.5dB@POWER>-90dBm 輸出關(guān)斷功能 頻譜純度 諧波:9KHz~200MHz≥20dBc,200MHz~3GHz≥30dBc 非諧波:≤80dBc典型值(偏移10kHz,載頻<1GHz),≥68dBc(偏移10kHz,其它載頻), 鎖相環(huán)小數(shù)分頻雜散≥64dBc(偏移10kHz) SSB相噪: ≤-98dBc/Hz 偏移20kHz(500MHz) ≤-102dBc/Hz 偏移20kHz(1GHz) ≤-90dBc/Hz 偏移20kHz(>1GHz) 調(diào)制輸出:調(diào)幅AM、調(diào)頻FM、脈沖CW,其它調(diào)制輸出可以通過(guò)IQ選件實(shí)現(xiàn) 調(diào)制源:內(nèi)、外 參考時(shí)鐘輸入和輸出:10MHz,14dBm 控制接口:CPCI、PXI、SPI、RS232、RS485、自定義GPIO 射頻和時(shí)鐘連接器:SMA-K 電源接口:背板供電、獨(dú)立供電 可選 電源及其功耗:+5V DC、±12V DC(紋波≤2%輸出電壓),≤38W 結(jié)構(gòu)尺寸:3U高度4槽寬度(100mm×160mm×82mm,不含連接器部分) 工作環(huán)境:商業(yè)級(jí)溫度和工業(yè)級(jí)溫度 可選,振動(dòng)、沖擊、可靠性、MTBF 測(cè)控軟件功能:射頻信號(hào)發(fā)生、調(diào)制信號(hào)輸出、跳頻/掃頻信號(hào)發(fā)生、支持WindowsXP系統(tǒng) 成功案例: 通信綜測(cè)儀器內(nèi)部的信號(hào)源模塊 無(wú)線電監(jiān)測(cè)設(shè)備內(nèi)部的信號(hào)校準(zhǔn)模塊 無(wú)線電通信測(cè)試儀器的調(diào)制信號(hào)發(fā)生

    標(biāo)簽: 3GHz 6710 GR 射頻信號(hào)源

    上傳時(shí)間: 2013-11-13

    上傳用戶:s363994250

  • X波段低相噪跳頻源的設(shè)計(jì)

    結(jié)合直接數(shù)字頻率合成(DDS)和鎖相環(huán)(PLL)技術(shù)完成了X波段低相噪本振跳頻源的設(shè)計(jì)。文章通過(guò)軟件仿真重點(diǎn)分析了本振跳頻源的低相噪設(shè)計(jì)方法,同時(shí)給出了主要的硬件選擇和詳細(xì)電路設(shè)計(jì)過(guò)程。最后對(duì)樣機(jī)的測(cè)試結(jié)果表明,本方案具有相位噪聲低、頻率控制靈活等優(yōu)點(diǎn),滿足了實(shí)際工程應(yīng)用。

    標(biāo)簽: X波段 跳頻源

    上傳時(shí)間: 2013-11-12

    上傳用戶:jiwy

  • 采用歸零法的N進(jìn)制計(jì)數(shù)器原理

    計(jì)數(shù)器是一種重要的時(shí)序邏輯電路,廣泛應(yīng)用于各類數(shù)字系統(tǒng)中。介紹以集成計(jì)數(shù)器74LS161和74LS160為基礎(chǔ),用歸零法設(shè)計(jì)N進(jìn)制計(jì)數(shù)器的原理與步驟。用此方法設(shè)計(jì)了3種36進(jìn)制計(jì)數(shù)器,并用Multisim10軟件進(jìn)行仿真。計(jì)算機(jī)仿真結(jié)果表明設(shè)計(jì)的計(jì)數(shù)器實(shí)現(xiàn)了36進(jìn)制計(jì)數(shù)的功能。基于集成計(jì)數(shù)器的N進(jìn)制計(jì)數(shù)器設(shè)計(jì)方法簡(jiǎn)單、可行,運(yùn)用Multisim 10進(jìn)行電子電路設(shè)計(jì)和仿真具有省時(shí)、低成本、高效率的優(yōu)越性。

    標(biāo)簽: 歸零法 N進(jìn)制計(jì)數(shù)器原

    上傳時(shí)間: 2013-10-11

    上傳用戶:gtzj

  • p-n結(jié)的隧道擊穿模型研究

    在理論模型的基礎(chǔ)上探討了電子勢(shì)壘的形狀以及勢(shì)壘形狀隨外加電壓的變化, 并進(jìn)行定量計(jì)算, 得出隧穿電壓隨雜質(zhì)摻雜濃度的變化規(guī)律。所得結(jié)論與硅、鍺p-n 結(jié)實(shí)驗(yàn)數(shù)據(jù)相吻合, 證明了所建立的理論模型在定量 研究p-n 結(jié)的隧道擊穿中的合理性與實(shí)用性。該理論模型對(duì)研究一般材料或器件的隧道擊穿具有重要的借鑒意義。

    標(biāo)簽: p-n 隧道 擊穿 模型研究

    上傳時(shí)間: 2013-10-31

    上傳用戶:summery

  • 共源共柵兩級(jí)運(yùn)放中兩種補(bǔ)償方法的比較

    給出了兩種應(yīng)用于兩級(jí)CMOS 運(yùn)算放大器的密勒補(bǔ)償技術(shù)的比較,用共源共柵密勒補(bǔ)償技術(shù)設(shè)計(jì)出的CMOS 運(yùn)放與直接密勒補(bǔ)償相比,具有更大的單位增益帶寬、更大的擺率和更小的信號(hào)建立時(shí)間等優(yōu)點(diǎn),還可以在達(dá)到相同補(bǔ)償效果的情況下極大地減小版圖尺寸. 通過(guò)電路級(jí)小信號(hào)等效電路的分析和仿真,對(duì)兩種補(bǔ)償技術(shù)進(jìn)行比較,結(jié)果驗(yàn)證了共源共柵密勒補(bǔ)償技術(shù)相對(duì)于直接密勒補(bǔ)償技術(shù)的優(yōu)越性.

    標(biāo)簽: 共源共柵 運(yùn)放 補(bǔ)償 比較

    上傳時(shí)間: 2013-10-14

    上傳用戶:gengxiaochao

  • CMOS工藝下高擺幅共源共柵偏置電路

    共源共柵級(jí)放大器可提供較高的輸出阻抗和減少米勒效應(yīng),在放大器領(lǐng)域有很多的應(yīng)用。本文提出一種COMS工藝下簡(jiǎn)單的高擺幅共源共柵偏置電路,且能應(yīng)用于任意電流密度。根據(jù)飽和電壓和共源共柵級(jí)電流密度的定義,本文提出器件寬長(zhǎng)比與輸出電壓擺幅的關(guān)系,并設(shè)計(jì)一種高擺幅的共源共柵級(jí)偏置電路。

    標(biāo)簽: CMOS 工藝 共源共柵 偏置電路

    上傳時(shí)間: 2013-10-08

    上傳用戶:debuchangshi

  • 二階有源低通濾波電路分析

    設(shè)計(jì)一種壓控電壓源型二階有源低通濾波電路,并利用Multisim10仿真軟件對(duì)電路的頻率特性、特征參量等進(jìn)行了仿真分析,仿真結(jié)果與理論設(shè)計(jì)一致,為有源濾波器的電路設(shè)計(jì)提供了EDA手段和依據(jù)。

    標(biāo)簽: 二階 有源低通濾波 電路分析

    上傳時(shí)間: 2013-11-12

    上傳用戶:名爵少年

  • 使用時(shí)鐘PLL的源同步系統(tǒng)時(shí)序分析

    使用時(shí)鐘PLL的源同步系統(tǒng)時(shí)序分析一)回顧源同步時(shí)序計(jì)算Setup Margin = Min Clock Etch Delay – Max Data Etch Delay – Max Delay Skew – Setup TimeHold Margin = Min Data Etch Delay – Max Clock Etch Delay + Min Delay Skew + Data Rate – Hold Time下面解釋以上公式中各參數(shù)的意義:Etch Delay:與常說(shuō)的飛行時(shí)間(Flight Time)意義相同,其值并不是從仿真直接得到,而是通過(guò)仿真結(jié)果的后處理得來(lái)。請(qǐng)看下面圖示:圖一為實(shí)際電路,激勵(lì)源從輸出端,經(jīng)過(guò)互連到達(dá)接收端,傳輸延時(shí)如圖示Rmin,Rmax,F(xiàn)min,F(xiàn)max。圖二為對(duì)應(yīng)輸出端的測(cè)試負(fù)載電路,測(cè)試負(fù)載延時(shí)如圖示Rising,F(xiàn)alling。通過(guò)這兩組值就可以計(jì)算得到Etch Delay 的最大和最小值。

    標(biāo)簽: PLL 時(shí)鐘 同步系統(tǒng) 時(shí)序分析

    上傳時(shí)間: 2013-11-05

    上傳用戶:VRMMO

  • 電流源和電壓源的區(qū)別

    電壓源電流源名字上僅差一個(gè)字…HE HE.有一些朋友對(duì)此不太明白.所以特此說(shuō)明下…并以軟件仿真…詳細(xì)介紹工作原理…以及注意事項(xiàng)….下面就是電壓源和電流的符號(hào)…左邊是電流源,右邊是電壓源. 電壓源…電壓源其實(shí)就是我們普通經(jīng)常用的一種電源.比如說(shuō)電池呀電瓶或自己做的穩(wěn)壓電路.一般屬于電壓源… 電壓源的特性是: 輸出端,可以開(kāi)路,但不能短路…總而言之電壓源的輸出電壓是恒定的…比如5V 電壓源輸出的電壓就是5V.隨不同的負(fù)載會(huì)改變電流…比如在5V 的電壓源上加一個(gè)1 歐的負(fù)載… 流過(guò)的電流就是5/1=5A 電流… 如果接的電阻為2 歐.流過(guò)電流就等于5/2=2.5A….這個(gè)簡(jiǎn)單的計(jì)算相信誰(shuí)都會(huì)…電流源電流源和電壓源區(qū)別比較大…電流源輸出端不能開(kāi)路,但可以短路…為什么不能開(kāi)路呢…HE HE…是因?yàn)殚_(kāi)路了…電流源輸出的電壓就為無(wú)限高了…(實(shí)際上電壓也是有一定值的)總而言之電流源的輸出電流是恒定的.不管你負(fù)載的大小…就是你短路了.他的電流還是保持不變.改變的是電壓…比如一個(gè)1A的恒流源…你接上一個(gè)1歐的負(fù)載…他輸出的電壓是.1x1=1V 電壓…當(dāng)你接上一個(gè)10 歐電阻的時(shí)候…他就是1x10=10V電壓輸出…

    標(biāo)簽: 電流源 電壓源

    上傳時(shí)間: 2013-10-08

    上傳用戶:kaixinxin196

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