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量子行為

  • look1為電子看板的第二個芯片

    look1為電子看板的第二個芯片,使用自制的握手信號與look通訊,可以進行數據傳送,以及控制16個數碼管顯示,此案例已成功用於生產現志,所用的元件很少,功能較大呢

    標簽: look1 芯片

    上傳時間: 2017-01-02

    上傳用戶:han_zh

  • QL-2006燒錄軟體-中文版, 為燒寫器軟件的安裝文件

    QL-2006燒錄軟體-中文版, 為燒寫器軟件的安裝文件,直接雙擊執(zhí)行安裝

    標簽: 2006 QL

    上傳時間: 2017-07-26

    上傳用戶:www240697738

  • PIC單片機的C編譯器介紹, 為燒寫器軟件的安裝文件

    PIC單片機的C編譯器介紹, 為燒寫器軟件的安裝文件,直接雙擊執(zhí)行安裝

    標簽: PIC C編譯器 單片機

    上傳時間: 2013-12-25

    上傳用戶:sssl

  • 基于USB的串行通信軟硬件設計

    基于USB的串行通信軟硬件設計

    標簽: USB 串行通信 軟硬件設計

    上傳時間: 2013-08-04

    上傳用戶:eeworm

  • 《三百六十行大觀》(名家繪圖本·中國傳統(tǒng)行業(yè)圖集)[沈寂主編][上海畫報版.1997][PDF]

    《三百六十行大觀》(名家繪圖本·中國傳統(tǒng)行業(yè)圖集)[沈寂主編][上海畫報版.1997][PDF]

    標簽: 1997 圖集

    上傳時間: 2013-08-04

    上傳用戶:eeworm

  • 基于USB的串行通信軟硬件設計-41頁-0.8M.pdf

    專輯類-數字處理及顯示技術專輯-106冊-9138M 基于USB的串行通信軟硬件設計-41頁-0.8M.pdf

    標簽: USB 0.8 41

    上傳時間: 2013-07-19

    上傳用戶:yatouzi118

  • 行波超聲波電機伺服控制特性理論與實踐研究.rar

    超聲波電機(Ultrasonic Motor簡稱USM)是八十年代發(fā)展起來的新型微電機。本文針對超聲波電機及其控制技術的研究現狀和發(fā)展趨勢,以我國研究技術相對比較成熟并有產業(yè)化前景的行波超聲波電機(Traveling-wave Ultrasonic Motor簡稱TUSM)的伺服控制技術為研究對象,以直徑60mm的行波超聲波電機TUSM60為研究實例,在特性測試、動穩(wěn)態(tài)性能分析,辨識模型建立、控制策略與控制算法的選擇與實現等方面展開研究。本論具體的研究內容為: 在分析超聲波電機研究歷史和現狀的基礎上,結合國內外超聲波電機特別是行波超聲波電機控制技術的發(fā)展趨勢,重點論述了行波超聲波電機及其驅動控制技術的研究進展。 介紹行波超聲波電機的基本結構,并從該電機的主要理論基礎--壓電原理、行波合成、接觸模型出發(fā),分析了行波超聲波電機定子質點的運動方程.并結合定轉子摩擦接觸特點,分析了行波超聲波電機的運行機理。 根據對行波超聲波電機測試和高精度控制的要求,研制出基于雙DSP和FPGA的超聲波電機高性能測試控制平臺。其中控制核心采用了雙DSP結構,可以在對行波超聲波電機進行控制的同時,將必要的參數讀取出來進行分析和研究。為行波超聲波電機瞬態(tài)特性分析以及控制策略、控制算法的深入研究打下了基礎。 對電機的瞬態(tài)、穩(wěn)態(tài)特性進行的測試,可以分析驅動頻率、電壓以及相位差等調節(jié)量對電機輸出的影響。在此基礎上進一步對行波超聲波電機的調節(jié)方式、控制算法選擇方面進行分析,并得到相應結論。 通過對實驗數據的總結和歸納,利用系統(tǒng)辨識中的非參數方法,建立在特定頻率條件下的近似線性模型。在行波超聲波電機工作范圍內,辨識若干組不同頻率條件下的近似線性模型,將這些模型的參數進行二維或三維擬合,可以得到一個關于行波超聲波電機傳遞函數的模型。辨識模型的建立為合理的選擇和優(yōu)化控制參數,控制效果的驗證等提供了行之有效的手段。 在對行波超聲波電機的速度控制、位置控制展開的研究中.首先利用遺傳算法對常規(guī)PI恒轉速控制的控制參數整定及修正方法進行了研究;利用神經元的在線自學習能力,研究和設計單神經元PID-PI轉速控制器,提高控制系統(tǒng)對電機非線性和時變性的適應能力;為了消除在伺服控制中,單一調節(jié)量(驅動頻率)情況下,低轉速的跳躍問題,研究和討論了多調節(jié)量分段控制方法,并利用模糊控制對控制方法的有效性進行了驗證;在位置控制中,利用轉速控制研究的結果,研究和設計了位置--速度雙環(huán)(串級)控制器,實現了電機高精度位置伺服控制。 通過對已有控制系統(tǒng)的改進和簡化,設計和研制了具有實用化價值行波超聲波電機控制器:并將研究成果應用于針對核磁成像設備而設計的行波超聲波電機隨動控制系統(tǒng)中,同時嘗試了將該控制器用于高精度X-Y兩維定位平臺。

    標簽: 行波 電機伺服 控制

    上傳時間: 2013-07-13

    上傳用戶:mpquest

  • 基于FPGA的高速串行接口模塊仿真設計.rar

    現代社會信息量爆炸式增長,由于網絡、多媒體等新技術的發(fā)展,用戶對帶寬和速度的需求快速增加。并行傳輸技術由于時鐘抖動和偏移,以及PCB布線的困難,使得傳輸速率的進一步提升面臨設計的極限;而高速串行通信技術憑借其帶寬大、抗干擾性強和接口簡單等優(yōu)勢,正迅速取代傳統(tǒng)的并行技術,成為業(yè)界的主流。 本論文針對目前比較流行并且有很大發(fā)展?jié)摿Φ膬煞N高速串行接口電路——高速鏈路口和Rocket I/O進行研究,并以Xilinx公司最新款的Virtex-5 FPGA為研究平臺進行仿真設計。本論文的主要工作是以某低成本相控陣雷達信號處理機為設計平臺,在其中的一塊信號處理板上,進行了基于LVDS(Low VoltageDifferential Signal)技術的高速LinkPort(鏈路口)設計和基于CML(Current ModeLogic)技術的Rocket I/O高速串行接口設計。首先在FPGA的軟件中進行程序設計和功能、時序的仿真,當仿真驗證通過之后,重點是在硬件平臺上進行調試。硬件調試驗證的方法是將DSP TS201的鏈路口功能與在FPGA中的模擬高速鏈路口相連接,進行數據的互相傳送,接收和發(fā)送的數據相同,證明了高速鏈路口設計的正確性。并且在硬件調試時對Rocket IO GTP收發(fā)器進行回環(huán)設計,經過回環(huán)之后接收到的數據與發(fā)送的數據相同,證明了Rocket I/O高速串行接口設計的正確性。

    標簽: FPGA 高速串行 接口模塊

    上傳時間: 2013-04-24

    上傳用戶:戀天使569

  • 基于FPGA的SCI串行通信接口的研究與實現.rar

    國家863項目“飛行控制計算機系統(tǒng)FC通信卡研制”的任務是研究設計符合CPCI總線標準的FC通信卡。本課題是這個項目的進一步引伸,用于設計SCI串行通信接口,以實現環(huán)上多計算機系統(tǒng)間的高速串行通信。 本文以此項目為背景,對基于FPGA的SCI串行通信接口進行研究與實現。論文先概述SCI協(xié)議,接著對SCI串行通信接口的兩個模塊:SCI節(jié)點模型模塊和CPCI總線接口模塊的功能和實現進行了詳細的論述。 SCI節(jié)模型包含Aurora收發(fā)模塊、中斷進程、旁路FIFO、接受和發(fā)送存儲器、地址解碼、MUX。在SCI節(jié)點模型的實現上,利用FPGA內嵌的RocketIO高速串行收發(fā)器實現主機之間的高速串行通信,并利用Aurora IP核實現了Aurora鏈路層協(xié)議;設計一個同步FIFO實現旁路FIFO;利用FPGA上的塊RAM實現發(fā)送和接收存儲器;中斷進程、地址解碼和多路復合分別在控制邏輯中實現。 CPCI總線接口包括PCI核、PCI核的配置模塊以及用戶邏輯三個部分。本課題中,采用FPGA+PCI軟核的方法來實現CPCI總線接口。PCI核作為PCI總線與用戶邏輯之間的橋梁:PCI核的配置模塊負責對PCI核進行配置,得到用戶需要的PCI核;用戶邏輯模塊負責實現整個通信接口具體的內部邏輯功能;并引入中斷機制來提高SCI通信接口與主機之間數據交換的速率。 設計選用硬件描述語言VerilogHDL和VHDL,在開發(fā)工具Xilinx ISE7.1中完成整個系統(tǒng)的設計、綜合、布局布線,利用Modelsim進行功能及時序仿真,使用DriverWorks為SCI串行通信接口編寫WinXP下的驅動程序,用VC++6.0編寫相應的測試應用程序。最后,將FPGA設計下載到FC通信卡中運行,并利用ISE內嵌的ChipScope Pro虛擬邏輯分析儀對設計進行驗證,運行結果正常。 文章最后分析傳輸性能上的原因,指出工作中的不足之處和需要進一步完善的地方。

    標簽: FPGA SCI 串行通信接口

    上傳時間: 2013-04-24

    上傳用戶:竺羽翎2222

  • 基于FPGAHDL的隨機讀寫I2C串行總線接口電路設計.rar

    I2C(Inter Integrated Circuits)是Philips公司開發(fā)的用于芯片之間連接的串行總線,以其嚴格的規(guī)范、卓越的性能、簡便的操作和眾多帶I2C接口的外圍器件而得到廣泛的應用并受到普遍的歡迎。 現場可編程門陣列(FPGA)設計靈活、速度快,在數字專用集成電路的設計中得到了廣泛的應用。本論文主要討論了如何利用Verilog/FPGA來實現一個隨機讀/寫的I2C接口電路,實現與外圍I2C接口器件E2PROM進行數據通信,實現讀、寫等功能,傳輸速率實現為100KBps。在Modelsim6.0仿真軟件環(huán)境中進行仿真,在Xilinx公司的ISE9.li開發(fā)平臺上進行了下載,搭建外圍電路,用Agilem邏輯分析儀進行數據采集,分析測試結果。 首先,介紹了微電子設計的發(fā)展概況以及設計流程,重點介紹了HDL/FPGA的設計流程。其次,對I2C串行總線進行了介紹,重點說明了總線上的數據傳輸格式并對所使用的AT24C02 E2PROM存儲器的讀/寫時序作了介紹。第三,基于Verilog _HDL設計了隨機讀/寫的I2C接口電路、測試模塊和顯示電路;接口電路由同步有限狀態(tài)機(FSM)來實現;測試模塊首先將數據寫入到AT24C02的指定地址,接著將寫入的數據讀出,并將兩個數據顯示在外圍LED數碼管和發(fā)光二極管上,從而直觀地比較寫入和輸出的數據的正確性。FPGA下載芯片為Xilinx SPARTAN Ⅲ XC3S200。第四,用Agilent邏輯分析儀進行傳輸數據的采集,分析數據傳輸的時序,從而驗證電路設計的正確性。最后,論文對所取得的研究成果進行了總結,并展望了下一步的工作。

    標簽: FPGAHDL I2C 隨機

    上傳時間: 2013-06-27

    上傳用戶:liuchee

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