變電站是電力系統的一個重要環節，它的運行情況直接影響到電力系統的可靠、經濟運行。一個變電站運行情況的優劣，在很大程度上取決于其二次設備的工作性能。現在的變電站有三種運行模式：一種是常規變電站，一種是部分實現微機管理、具有一定自動化水平的變電站，再有一種是實現無人值班、全面微機化的綜合自動化變電站。在常規變電站中，其繼電保護、中央信號系統、變送器、遠動及故障錄波裝置等所有二次設備都是采用傳統的分立式設備，而且站內配備大量控制、保護、記錄用屏盤。使裝備設置復雜，占地面積大，日常維護管理工作繁重。這種常規變電站的一個致命弱點是不具備自診斷能力，對二次系統本身的故障無法監測。因此，這種常規變電站已逐漸被淘汰。 要提高變電站運行的可靠性及經濟性，一個最有效的方法就是提高變電站運行管理的自動化水平，實現變電站的綜合自動化，以微機化的新型二次設備取代傳統使用的分立式設備。開發集保護、控制、監測及遠動等功能為一體的新型設備，并實現設備共享、信息資源共享，使變電站設計簡捷、布局緊湊，運行更加可靠安全。 隨著微型計算機技術、集成電路技術的迅速發展，原來越多的新技術和新產品應用到變電站的二次設備中去，使變電站的二次設備得到不斷的更新換代。該項研究把一種新型的低壓電能量測量芯片與高性能的數字信號處理器(DSP)結合起來，利用DSP體積小、功能強、功耗低、速度快、性價比高等優點，設計出新型的變電站線路測控單元，實現對高壓線路的測量、監視和控制，這種新型的二次設備比傳統的二次設備具有更高的精度和更快的相應速度。 與此同時，網絡理論和技術的發展，也使變電站監控系統的結構發生了很大的變化，由原來的集中控制型逐步過渡到功能分散、模塊化的分散網絡型，通過現場總線，使主控室和現場之間的聯系變成了串行通信聯系，從而提高的系統的可靠性和可維護性。CAN總線應用于變電站的監控系統中，組成變電站的數據通信網絡，可以提高系統的抗干擾能力和容錯能力。 該文就以上的兩個方面進行研究和設計，主要內容包括：一是在簡單介紹新型電能測量芯片和DSP的基本知識的基礎上，提出了一個變電站測控單元的設計方案，并從從硬件和軟件兩個方面進行了詳細的介紹，主要部分是對測量模塊的設計；二是系統的通信接口模塊設計，從硬件和軟件方面詳細的介紹了通信模塊的三種不同的通信接口的設計，分別是RS-232串行通信、RS-485總線通信、CAN總線通信；三是在分析現代測控系統發展歷史，指出了現場總線測控系統的優越性；四是設計出的測控系統單元的基礎上，利用CAN現場總線構建變電站的綜合監控系統。 該文提出的方案、技術以及結論對于變電站監控系統和自綜合動化系統的研究開發、工程設計都具有實際的參考意義。
標簽： CAN 總線 變電站
上傳時間： 2013-04-24
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永磁無刷直流電動機具有慣量小、控制簡單、動態性能好等優良特性，因此在航天、機器人、數控機床等許多領域得到了廣泛應用。無刷直流電機在國外已經成功應用于對系統要求較高的場合，近年來在國內也引起了廣泛的興趣。本課題針對輪式機器人，設計了無刷直流電動機并設計相應控制系統。 首先，本課題分析了機器人用無刷直流電動機的組成結構、繞組連接，并對三相無刷直流電動機星角接工作方式進行比較，按照無刷直流電動機兩種模式運行、多極分數槽等特點進行局部設計。最終以爬坡時狀態為參考，經過多次計算得到無刷直流電動機的初始設計方案。 其次，為了提高設計的可靠性及設計成本，本課題用MaxwellRMxprt和Maxwell 2D有限元分析軟件來對所設計的電磁設計方案進行驗證。應用Maxwell 2D軟件進一步對設計方案進行分析和校驗，以校核仿真結果參數能否與設計方案相吻合。 最后設計了無刷直流電動機的PIC單片機控制系統并對無刷直流電動機進行系統仿真。控制系統CPU采用PIC16F877單片機，它能夠提供最佳的性能價格比。系統采用IGBT 專用柵極驅動集成電路IR2130，來控制系統主電路。系統仿真采用MATLAB/SIMULINK軟件，檢驗所設計電機在系統中的性能。 結論，本課題主要包括五部分：無刷直流電動機繞組連接分析，初始數據方案設計，Maxwell對電磁設計方案進行驗證，設計PIC單片機控制系統，應用MATLAB對電機控制系統進行仿真。通過這五部，本文完成了輪式機器人用無刷直流電動機進行設計及相應控制系統的設計。
標簽： 輪式機器人 無刷直流電動機
上傳時間： 2013-07-28
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模擬ic設計經典的入門教程，分析很透徹，適合初學者進行系統的認識模擬電路的設計方法，對于有經驗的工作者，也可當作設計參考
標簽： 模擬集成電路 分
上傳時間： 2013-05-24
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在傳統的直線驅動場合，都是由旋轉電機提供原動力，再由絲杠、絲桿、齒條等中間機構轉換為直線運動。這樣的設置，不僅在中間傳動過程中消耗了大量的能量，而且摩擦產生的噪聲也非常明顯，同時也給系統的維護工作帶來了麻煩。 直線電機的出現可以使上述問題得到解決，由于具備直接將電能轉化為直線運動的能力，直線電機已經在機床驅動、集成電路組裝等場合逐漸取代了傳統的旋轉電機的位置。 自19世紀中期直線電機的概念被首次提出以來，經過孕育、實驗、開發和實用這四個階段的發展，并借助于電力電子技術，以及日漸成熟的直線電機控制技術，直線電機已經廣泛應用到了制造業、交通運輸業等各個方面。 與旋轉電機類似，按工作原理的不同，直線電機也有著各種類型，應用較多的是直線步進電機、直線同步電機和直線感應電機。其中直線步進電機更多的是應用在需要精確定位的場合，比如半導體工業；后兩者則被應用在需要連續和大推力的場合，比如機床。而直線同步電機，尤其是永磁直線同步電機，憑借更大的單位面積推力、更高的效率等優點受到了更多的青睞，與此同時，由于沒有了勵磁繞組，電機的整個結構也得以簡化。另一方面，我國豐富的稀土資源也為這種電機的發展提供了廣泛空間。 作為一種較為新穎的電機，目前國內仍缺乏系統化的永磁直線同步電機設計方案，尤其是電樞繞組部分。常用的方法仍是基于傳統的旋轉電機，例如使用雙層疊繞組方案。通過對實際電機的軟件模擬，我們發現這樣的設計思路的表現并不能令人滿意，比如造成了動子線圈槽滿率過大，電機設計難以形成系列化等缺點，而電機本身輸出推力的波動也較大。 針對傳統方案的一系列缺點，本文提出了一種新的永磁直線同步電機設計方案。該方案基于“單元電機”的概念，使用單層同心式線圈。當目標推力要求變化時，只需改變“單元電機”的數目和排列組合的方式，就可以達到改變的目的。而每個單元中的繞組連接方式則不需要改變，由此避免了繁瑣而復雜的繞組設計，這就給電機的系列化設計帶來了便捷。同時，單層繞組的使用也更方便嵌線，也更有利于降低銅耗，提高效率。 在完成單元電機設計任務的基礎上，本文利用加拿大Infolytica公司出品的電磁場有限元分析軟件MagNet對電機的運行進行了模擬，并得到了電機的額定輸出推力曲線和反電動勢曲線，輸出推力曲線較之傳統方案也更平穩。體現了該設計方案的優越性。
標簽： 直線 同步電機
上傳時間： 2013-06-29
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隨著當今科學技術的迅猛發展，數字圖像處理技術正在各個行業得到廣泛的應用，而FPGA技術的不斷成熟改變了通常采用并行計算機或數字信號處理器(DSP)、專用集成電路(ASIC)等作為嵌入式處理器的慣例。可編程邏輯器件(FPGA)憑借其較低的開發成本、較高的并行處理速度、較大的靈活性及其較短的開發周期等特點，在圖像處理系統中有獨特的優勢。 本文提出了一種基于FPGA的圖像采集處理系統解決方案，并選用低成本高性能的Altera公司的CycloneIII系列FPGA EP3C40F324為核心，設計開發了圖像采集處理的軟硬件綜合系統。文章闡述了如何在FPGA中嵌入NiosII軟核處理器并完成圖像采集處理系統功能的設計方案。硬件電路上，系統設計了三塊電路板：FPGA核心處理板、圖像采集卡、圖像顯示卡，其中通過I2C總線對采集卡的工作模式進行配置，在采集模塊控制下，將采集到的圖像數據存儲到SDRAM；根據VGA顯示原理及其時序關系，設計了VGA顯示輸出控制模塊，合成了VGA工作的控制信號，又根據VGA顯示器的工業標準，合成VGA接口的水平和幀同步信號。邏輯硬件上，應用SOPCBuilder工具生成了FPGA內部的邏輯硬件功能模塊，定制了NiosII IP core、CMOS圖像采集模塊、VGA Controller及其I2C總線接口，系統各模塊間通過Avalon總線連接起來。軟件部分，在NiosII內核處理器上實現了彩色圖像顏色空間轉換、二值化、形態學腐蝕處理及其目標定位等算法。實驗結果證明了本文提出的方案及算法的正確性，可行性。
標簽： FPGA 圖像采集 處理系統
上傳時間： 2013-08-05
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近年來，隨著大規模集成電路的飛速發展，微控制器和數字信號處理器的性價比不斷提高，數字控制技術已逐步應用于大中功率高頻開關電源。相對于傳統模擬控制方式，數字控制方式具有電源設計靈活、外圍控制電路少、可采用較先進的控制算法、具有較高可靠性等優點。 高頻開關電源具有體積小、重量輕、效率高、輸出紋波小等特點，現已逐步成為現代通訊設備的新型基礎電源系統。針對傳統開關電源中損耗較大、超調量較大、動態性能較差等問題，本文采用基于DSP的全橋軟開關拓撲結構。全橋軟開關移相控制技術由智能DSP系統完成，采樣信號采用差分傳輸，控制算法采用模糊自適應PID算法，產生數字PWM波配合驅動電路控制全橋開關的通斷。在輸入端應用平均電流控制法的有源功率因數校正，使輸入電流跟隨輸入電壓的波形，從而使功率因數接近1。最后通過Matlab仿真結果表明模糊自適應PID控制算法比傳統PID控制算法在超調量，調節時間，動態特性等性能上具有優越性。 論文以高頻開關電源的設計為主線，在詳細分析各部分電路原理的基礎上，進行系統的主電路設計、輔助電路設計、控制電路設計、仿真研究、軟件實現。重點介紹了高頻變壓器的設計及模糊自適應PID控制器的實現。并將輔助電源及控制電路制成電路板，以及在此電路板基礎上進行各波形分析并進行相關實驗。
標簽： DSP 高頻 通訊
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近年來，以電池作為電源的微電子產品得到廣泛使用，因而迫切要求采用低電源電壓的模擬電路來降低功耗。目前低電壓、低功耗的模擬電路設計技術正成為微電子行業研究的熱點之一。 在模擬集成電路中，運算放大器是最基本的電路，所以設計低電壓、低功耗的運算放大器非常必要。在實現低電壓、低功耗設計的過程中，必須考慮電路的主要性能指標。由于電源電壓的降低會影響電路的性能，所以只實現低壓、低功耗的目標而不實現優良的性能(如高速)是不大妥當的。 論文對國內外的低電壓、低功耗模擬電路的設計方法做了廣泛的調查研究，分析了這些方法的工作原理和各自的優缺點，在吸收這些成果的基礎上設計了一個3.3 V低功耗、高速、軌對軌的CMOS/BiCMOS運算放大器。在設計輸入級時，選擇了兩級直接共源一共柵輸入級結構；為穩定運放輸出共模電壓，設計了共模負反饋電路，并進行了共模回路補償；在偏置電路設計中，電流鏡負載并不采用傳統的標準共源-共柵結構，而是采用適合在低壓工況下的低壓、寬擺幅共源-共柵結構；為了提高效率，在設計時采用了推挽共源極放大器作為輸出級，輸出電壓擺幅基本上達到了軌對軌；并采用帶有調零電阻的密勒補償技術對運放進行頻率補償。 采用標準的上華科技CSMC 0.6μpm CMOS工藝參數，對整個運放電路進行了設計，并通過了HSPICE軟件進行了仿真。結果表明，當接有5 pF負載電容和20 kΩ負載電阻時，所設計的CMOS運放的靜態功耗只有9.6 mW，時延為16.8ns，開環增益、單位增益帶寬和相位裕度分別達到82.78 dB，52.8 MHz和76°，而所設計的BiCMOS運放的靜態功耗達到10.2 mW，時延為12.7 ns，開環增益、單位增益帶寬和相位裕度分別為83.3 dB、75 MHz以及63°，各項技術指標都達到了設計要求。
標簽： CMOSBiCMOS 低壓 低功耗
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軟件無線電（Software Defined Radio）是無線通信系統收發信機的發展方向，它使得通信系統的設計者可以將主要精力集中到收發機的數字處理上，而不必過多關注電路實現。在進行數字處理時，常用的方案包括現場可編程門陣列（FPGA）、數字信號處理器（DSP）和專用集成電路（ASIC）。FPGA以其相對較低的功耗和相對較低廉的成本，成為許多通信系統的首先方案。正是在這樣的前提下，本課題結合軟件無線電技術，研究并實現基于FPGA的數字收發信機。 @@ 本論文主要研究了發射機和接收機的結構和相關的硬件實現問題。首先，從理論上對發射機和接收機結構進行研究，找到收發信機設計中關鍵問題。其次，在理論上有深刻認識的基礎上，以FPGA為手段，將反饋控制算法、反饋補償算法和前饋補償算法落實到硬件電路上。同步一直是數字通信系統中的關鍵問題，它也是本文的研究重點。本文在研究了已有各種同步方法的基礎上，設計了一種新的同步方法和相應的接收機結構，并以硬件電路將其實現。最后，針對所設計的硬件系統，本文還進行了充分的硬件系統測試。硬件測試的各項數據結果表明系統設計方案是可行的，基本實現了數字中頻收發機系統的設計要求。 @@ 本文中發射機系統是以Altera公司EP2C70F672C6為硬件平臺，接收機系統以Altera公司EP2S180F1020C3為硬件平臺。收發系統均是在Ouartus Ⅱ 8．0環境下，通過編寫Verilog HDL代碼和調用Altera IP core加以實現。在將設計方案落實到硬件電路實現之前，各種算法均使用MATLAB進行原理仿真，并在MATLAB仿真得到正確結果的基礎上，使用Quartus Ⅱ 8．0中的功能仿真工具和時序仿真工具進行了前仿真和后仿真。所有仿真結果無誤后，可下載至硬件平臺進行調試，通過Quartus Ⅱ 8．0中集成的SignalTap邏輯分析儀，可以實時觀察電路中各點信號的變化情況，并結合示波器和頻譜儀，得到硬件測試結果。 @@關鍵詞：SDR；數字收發機；FPGA；載波同步；符號同步
標簽： FPGA 數字中頻 收發信機
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現場可編程門陣列(FPGA，Field Programmable Gate Array)是可編程邏輯器件的一種，它的出現是隨著微電子技術的發展，設計與制造集成電路的任務已不完全由半導體廠商來獨立承擔。系統設計師們更愿意自己設計專用集成電路(ASIC，Application Specific Integrated Circuit)．芯片，而且希望ASIC的設計周期盡可能短，最好是在實驗室里就能設計出合適的ASIC芯片，并且立即投入實際應用之中。現在，FPGA已廣泛地運用于通信領域、消費類電子和車用電子。 本文中涉及的I/O端口模塊是FPGA中最主要的幾個大模塊之一，它的主要作用是提供封裝引腳到CLB之間的接口，將外部信號引入FPGA內部進行邏輯功能的實現并把結果輸出給外部電路，并且根據需要可以進行配置來支持多種不同的接口標準。FPGA允許使用者通過不同編程來配置實現各種邏輯功能，在IO端口中它可以通過選擇配置方式來兼容不同信號標準的I/O緩沖器電路。總體而言，可選的I/O資源的特性包括：IO標準的選擇、輸出驅動能力的編程控制、擺率選擇、輸入延遲和維持時間控制等。 本文是關于FPGA中多標準兼容可編程輸入輸出電路(Input/Output Block)的設計和實現，該課題是成都華微電子系統有限公司FPGA大項目中的一子項，目的為在更新的工藝水平上設計出能夠兼容單端標準的I/O電路模塊；同時針對以前設計的I/O模塊不支持雙端標準的缺點，要求新的電路模塊中擴展出雙端標準的部分。文中以低壓雙端差分標準(LVDS)為代表構建雙端標準收發轉換電路，與單端標準比較，LVDS具有很多優點： (1)LVDS傳輸的信號擺幅小，從而功耗低，一般差分線上電流不超過4mA，負載阻抗為100Ω。這一特征使它適合做并行數據傳輸。 (2)LVDS信號擺幅小，從而使得該結構可以在2.5V的低電壓下工作。 (3)LVDS輸入單端信號電壓可以從0V到2.4V變化，單端信號擺幅為400mV，這樣允許輸入共模電壓從0.2V到2.2V范圍內變化，也就是說LVDS允許收發兩端地電勢有±1V的落差。 本文采用0.18μm1.8V/3.3V混合工藝，輔助Xilinx公司FPGA開發軟件ISE，設計完成了可以用于Virtex系列各低端型號FPGA的IOB結構，它有靈活的可配置性和出色的適應能力，能支持大量的I/O標準，其中包括單端標準，也包括雙端標準如LVDS等。它具有適應性的優點、可選的特性和考慮到被文件描述的硬件結構特征，這些特點可以改進和簡化系統級的設計，為最終的產品設計和生產打下基礎。設計中對包括20種IO標準在內的各電器參數按照用戶手冊描述進行仿真驗證，性能參數已達到預期標準。
標簽： FPGA 標準 可編程
上傳時間： 2013-05-15
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近年來，語音識別研究大部分集中在算法設計和改進等方面，而隨著半導體技術的高速發展，集成電路規模的不斷增大與各種研發技術水平的不斷提高，新的硬件平臺的推出，語音識別實現平臺有了更多的選擇。語音識別技術在與DSP、FPGA、ASIC等器件為平臺的嵌入式系統結合后，逐漸向實用化、小型化方向發展。 本課題通過對現有各種語音特征參數與孤立詞語音識別模型進行研究的基礎上，重點探索基于動態時間規整算法的DTW模型在孤立詞語音識別領域的應用，并結合基于FPGA的SOPC系統，在嵌入式平臺上實現具有較好精度與速度的孤立詞語音識別系統。 本系統整體設計基于DE2開發平臺,采用基于Nios II的SOPC技術。采用這種解決方案的優點是實現了片上系統，減少了系統的物理體積和總體功耗；同時系統控制核心都在FPGA內部實現，可以極為方便地更新和升級系統，大大地提高了系統的通用性和可維護性。 此外，由于本系統需要大量的高速數據運算，在設計中作者充分利用了Cyclone II芯片的豐富的硬件乘法器，實現了語音信號的端點檢測模塊，FFT快速傅立葉變換模塊，DCT離散余弦變換模塊等硬件設計模塊。為了提高系統的整體性能，作者充分利用了FPGA的高速并行的優勢，以及配套開發環境中的Avalon總線自定義硬件外設，使系統處理數字信號的能力大大提高，其性能優于傳統的微控制器和普通DSP芯片。 本論文主要包含了以下幾個方面： （1）結合ALTERA CYCLONE II芯片的特點，確定了基于FPGA語音識別系統的總體設計，在此基礎上進行了系統的軟硬件的選擇和設計。 （2）自主設計了純硬件描述語言的驅動電路設計，完成了高速語音采集的工作，并且對存儲數據芯片SRAM中的原始語音數據進行提取導入MATLAB平臺測試數據的正確性。整個程序測試的方式對系統的模塊測試起到重要的作用。 （3）完成高速定點256點的FFT模塊的設計，此模塊是系統成敗的關鍵，實現高速實時的運算。 （4）結合SOPC的特性，設計了人機友好接口，如LCD顯示屏的提示反饋信息等等，以及利用ALTERA提供的一些驅動接口設計完成用戶定制的系統。 （5）進行了整體系統測試，系統可以較穩定地實現實時處理的目的，具有一定的市場潛在價值。
標簽： FPGA 語音識別 系統設計
上傳時間： 2013-05-23
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