<bdo id="guyw8"></bdo> <strike id="guyw8"></strike> 直接數據頻率合成器(DDS)因能產生頻率捷變且殘留相位噪聲性能卓越而著稱。另外，多數用戶都很清楚DDS輸出頻譜中存在的雜散噪聲，比如相位截斷雜散以及與相位-幅度轉換過程相關的雜散等。此類雜散是實際DDS設計中的有限相位和幅度分辨率造成的結果。
標簽： 雜散噪聲
上傳時間： 2013-11-18
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PCB LAYOUT 術語解釋(TERMS)1. COMPONENT SIDE(零件面、正面)︰大多數零件放置之面。2. SOLDER SIDE(焊錫面、反面)。3. SOLDER MASK(止焊膜面)︰通常指Solder Mask Open 之意。4. TOP PAD︰在零件面上所設計之零件腳PAD，不管是否鑽孔、電鍍。5. BOTTOM PAD：在銲錫面上所設計之零件腳PAD，不管是否鑽孔、電鍍。6. POSITIVE LAYER：單、雙層板之各層線路；多層板之上、下兩層線路及內層走線皆屬之。7. NEGATIVE LAYER：通常指多層板之電源層。8. INNER PAD：多層板之POSITIVE LAYER 內層PAD。9. ANTI-PAD：多層板之NEGATIVE LAYER 上所使用之絕緣範圍，不與零件腳相接。10. THERMAL PAD：多層板內NEGATIVE LAYER 上必須零件腳時所使用之PAD，一般稱為散熱孔或導通孔。11. PAD (銲墊)：除了SMD PAD 外，其他PAD 之TOP PAD、BOTTOM PAD 及INNER PAD 之形狀大小皆應相同。12. Moat : 不同信號的 Power& GND plane 之間的分隔線13. Grid : 佈線時的走線格點2. Test Point : ATE 測試點供工廠ICT 測試治具使用ICT 測試點 LAYOUT 注意事項:PCB 的每條TRACE 都要有一個作為測試用之TEST PAD(測試點)，其原則如下：1. 一般測試點大小均為30-35mil，元件分布較密時，測試點最小可至30mil.測試點與元件PAD 的距離最小為40mil。2. 測試點與測試點間的間距最小為50-75mil，一般使用75mil。密度高時可使用50mil,3. 測試點必須均勻分佈於PCB 上，避免測試時造成板面受力不均。4. 多層板必須透過貫穿孔(VIA)將測試點留於錫爐著錫面上(Solder Side)。5. 測試點必需放至於Bottom Layer6. 輸出test point report(.asc 檔案powerpcb v3.5)供廠商分析可測率7. 測試點設置處:Setuppadsstacks
上傳時間： 2013-10-22
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電容器的寄生作用與雜散電容.pdf
上傳時間： 2014-04-18
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重郵盛群實驗課講義
上傳時間： 2013-11-11
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盛群單片機使用書
上傳時間： 2013-10-14
上傳用戶：redherr
摘要：研制了一種基于Winbond公司W77E58單片機的光伏并網電站智能群控器，該群控器由顯示模塊、通訊模塊、時鐘模塊、報警模塊以及大容量數據存儲模塊等構成。在現場可取代PC機，對多達60臺的并網逆變器無人值守監控，具有成本低、安裝靈活方便等優點；在大型分布多支路光伏并網電站中，多個智能群控器與PC機可組建多級分布式通訊網絡，對整個光伏并網電站進行實時監控和管理。關鍵詞：單片機；光伏；并網；群控器；監控
上傳時間： 2013-11-04
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首先介紹了采用直接數字頻率合成（DDS）技術的正弦信號發生器的基本原理和采用FPGA實現DDS信號發生器的基本方法，然后結合DDS的原理分析了采用DDS方法實現的正弦信號發生器的優缺點，其中重點分析了幅度量化雜散產生的誤差及其原因，最后針對DDS原理上存在的幅度量化雜散，利用FPGA時鐘頻率可調的特點，重點提出了基于FPGA實現的DDS正弦信號發生器的兩種改進方法，經過MATLAB仿真驗證，改進方法較好的抑制了幅度量化雜散，減小了誤差。
上傳時間： 2013-10-09
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介紹了一種基于3G無線傳感的橋梁集群健康實時監測系統。系統將3G無線模塊與ZIGBEE無線傳感網絡模塊統一于AT91SAM9G20 ARM微處理器芯片，嵌入LINUX操作系統，設計了橋梁健康監測系統下位機系統。采用VC6.0軟件，設計了橋梁健康監測中心上位機系統。在橋梁集群上80個采集點實際應用表明，該系統運行穩定，數據存儲和無線傳輸穩定可靠，可滿足橋梁集群無線健康監測的需求。
上傳時間： 2013-11-07
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傳統的PID控制對于控制模型不確定并具有非線性特性的對象時，存在參數難以整定、控制效果不好的缺點，文中提出了一種基于蟻群算法的PID調節算法，即利用蟻群算法動態調節PID的參數，實現對配料系統的控制，通過實驗仿真的方式證明了該方法具有良好的控制效果及適應性。
上傳時間： 2013-10-09
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首先介紹了采用直接數字頻率合成（DDS）技術的正弦信號發生器的基本原理和采用FPGA實現DDS信號發生器的基本方法，然后結合DDS的原理分析了采用DDS方法實現的正弦信號發生器的優缺點，其中重點分析了幅度量化雜散產生的誤差及其原因，最后針對DDS原理上存在的幅度量化雜散，利用FPGA時鐘頻率可調的特點，重點提出了基于FPGA實現的DDS正弦信號發生器的兩種改進方法，經過MATLAB仿真驗證，改進方法較好的抑制了幅度量化雜散，減小了誤差。
上傳時間： 2013-11-21
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