首先介紹了采用直接數(shù)字頻率合成（DDS）技術(shù)的正弦信號(hào)發(fā)生器的基本原理和采用FPGA實(shí)現(xiàn)DDS信號(hào)發(fā)生器的基本方法，然后結(jié)合DDS的原理分析了采用DDS方法實(shí)現(xiàn)的正弦信號(hào)發(fā)生器的優(yōu)缺點(diǎn)，其中重點(diǎn)分析了幅度量化雜散產(chǎn)生的誤差及其原因，最后針對(duì)DDS原理上存在的幅度量化雜散，利用FPGA時(shí)鐘頻率可調(diào)的特點(diǎn)，重點(diǎn)提出了基于FPGA實(shí)現(xiàn)的DDS正弦信號(hào)發(fā)生器的兩種改進(jìn)方法，經(jīng)過MATLAB仿真驗(yàn)證，改進(jìn)方法較好的抑制了幅度量化雜散，減小了誤差。
資源簡(jiǎn)介：首先介紹了采用直接數(shù)字頻率合成（DDS）技術(shù)的正弦信號(hào)發(fā)生器的基本原理和采用FPGA實(shí)現(xiàn)DDS信號(hào)發(fā)生器的基本方法，然后結(jié)合DDS的原理分析了采用DDS方法實(shí)現(xiàn)的正弦信號(hào)發(fā)生器的優(yōu)缺點(diǎn)，其中重點(diǎn)分析了幅度量化雜散產(chǎn)生的誤差及其原因，最后針對(duì)DDS原理上存在的...
上傳時(shí)間： 2013-10-09
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資源簡(jiǎn)介：首先介紹了采用直接數(shù)字頻率合成（DDS）技術(shù)的正弦信號(hào)發(fā)生器的基本原理和采用FPGA實(shí)現(xiàn)DDS信號(hào)發(fā)生器的基本方法，然后結(jié)合DDS的原理分析了采用DDS方法實(shí)現(xiàn)的正弦信號(hào)發(fā)生器的優(yōu)缺點(diǎn)，其中重點(diǎn)分析了幅度量化雜散產(chǎn)生的誤差及其原因，最后針對(duì)DDS原理上存在的...
上傳時(shí)間： 2013-11-21
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資源簡(jiǎn)介：基于FPGA的DDS信號(hào)發(fā)生器的簡(jiǎn)單實(shí)現(xiàn)。這種方法簡(jiǎn)單可靠、控制方便，且具有很高的頻率分辨率和轉(zhuǎn)換速度，非常適合快速跳頻通信的要求。 DDS（直接數(shù)字合成）是近年來迅速發(fā)展起來的一種新的頻率合成方法。
上傳時(shí)間： 2013-08-13
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資源簡(jiǎn)介：verilog編寫基于FPGA的DDS實(shí)現(xiàn)
上傳時(shí)間： 2013-08-19
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資源簡(jiǎn)介：基于FPGA的DDS和周期合成技術(shù)在EIS中的應(yīng)用,caj格式
上傳時(shí)間： 2013-08-26
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資源簡(jiǎn)介：在無線傳送領(lǐng)域,基于FPGA 的DDS 實(shí)現(xiàn)的幾種方式
上傳時(shí)間： 2013-09-01
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資源簡(jiǎn)介：以Altera公司的Quartus Ⅱ 7.2作為開發(fā)工具，研究了基于FPGA的DDS IP核設(shè)計(jì)，并給出基于Signal Tap II嵌入式邏輯分析儀的仿真測(cè)試結(jié)果。將設(shè)計(jì)的DDS IP核封裝成為SOPC Builder自定義的組件，結(jié)合32位嵌入式CPU軟核Nios II，構(gòu)成可編程片上系統(tǒng)（SOPC），利用...
上傳時(shí)間： 2013-11-06
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資源簡(jiǎn)介：以Altera公司的Quartus Ⅱ 7.2作為開發(fā)工具，研究了基于FPGA的DDS IP核設(shè)計(jì)，并給出基于Signal Tap II嵌入式邏輯分析儀的仿真測(cè)試結(jié)果。將設(shè)計(jì)的DDS IP核封裝成為SOPC Builder自定義的組件，結(jié)合32位嵌入式CPU軟核Nios II，構(gòu)成可編程片上系統(tǒng)（SOPC），利用...
上傳時(shí)間： 2013-12-22
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資源簡(jiǎn)介：在無線傳送領(lǐng)域,基于FPGA 的DDS 實(shí)現(xiàn)的幾種方式
上傳時(shí)間： 2015-11-05
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資源簡(jiǎn)介：基于FPGA的DDS和周期合成技術(shù)在EIS中的應(yīng)用,caj格式
上傳時(shí)間： 2013-12-18
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資源簡(jiǎn)介：verilog編寫基于FPGA的DDS實(shí)現(xiàn)
上傳時(shí)間： 2013-12-20
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資源簡(jiǎn)介：基于FPGA的DDS信號(hào)發(fā)生器的簡(jiǎn)單實(shí)現(xiàn)。DDS（直接數(shù)字合成）是近年來迅速發(fā)展起來的一種新的頻率合成方法。這種方法簡(jiǎn)單可靠、控制方便，且具有很高的頻率分辨率和轉(zhuǎn)換速度，非常適合快速跳頻通信的要求。
上傳時(shí)間： 2017-02-06
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資源簡(jiǎn)介：基于FPGA的DDS正弦信號(hào)發(fā)生器,信號(hào)失真小，頻率穩(wěn)定，可調(diào)
上傳時(shí)間： 2013-12-22
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資源簡(jiǎn)介：基于FPGA的DDS算法的實(shí)現(xiàn)，已經(jīng)通過FPGA的后端仿真實(shí)現(xiàn)
上傳時(shí)間： 2017-06-26
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資源簡(jiǎn)介：基于MATLAB的GPS選星分析及實(shí)驗(yàn)研究
上傳時(shí)間： 2017-08-04
上傳用戶：hfmm633
資源簡(jiǎn)介：該文檔為基于FPGA的FLASH控制器系統(tǒng)設(shè)計(jì)及實(shí)現(xiàn)簡(jiǎn)介文檔，是一份很不錯(cuò)的參考資料，具有較高參考價(jià)值，感興趣的可以下載看看………………
上傳時(shí)間： 2021-11-23
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資源簡(jiǎn)介：該文檔為基于FPGA的雙口RAM實(shí)現(xiàn)及應(yīng)用簡(jiǎn)介文檔，是一份很不錯(cuò)的參考資料，具有較高參考價(jià)值，感興趣的可以下載看看………………
上傳時(shí)間： 2021-11-29
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資源簡(jiǎn)介：該文檔為基于FPGA的雙口RAM實(shí)現(xiàn)及應(yīng)用的講解文檔，是一份很不錯(cuò)的參考資料，具有較高參考價(jià)值，感興趣的可以下載看看………………
上傳時(shí)間： 2021-12-09
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上傳時(shí)間： 2022-01-24
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資源簡(jiǎn)介：基于FPGA的數(shù)字中頻接收機(jī)設(shè)計(jì)及算法仿真 ? ? ? ? ?
上傳時(shí)間： 2022-03-19
上傳用戶：jiabin
資源簡(jiǎn)介：實(shí)現(xiàn)了基于FPGA的DDS信號(hào)源設(shè)計(jì)，能同時(shí)兩路輸出，輸出波形包括正弦波、三角波、方波和鋸齒波，且其頻率和相位均可調(diào)，還能計(jì)算兩路輸出信號(hào)的相位差。
上傳時(shí)間： 2022-04-21
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資源簡(jiǎn)介：Verilog編寫基于FPGA的DDS實(shí)現(xiàn)。適合感興趣的學(xué)習(xí)者學(xué)習(xí)，可以提高自己的能力，大家可以多交流哈
上傳時(shí)間： 2022-05-18
上傳用戶：zhaiyawei
資源簡(jiǎn)介：基于FPGA的VGA時(shí)序彩條信號(hào)實(shí)現(xiàn)方法及其應(yīng)用
上傳時(shí)間： 2013-12-05
上傳用戶：semi1981
資源簡(jiǎn)介：隨著圖像分辨率的越來越高，軟件實(shí)現(xiàn)的圖像處理無法滿足實(shí)時(shí)性的需求；同時(shí)FPGA等可編程器件的快速發(fā)展使得硬件實(shí)現(xiàn)圖像處理變得可行。如今基于FPGA的圖像處理研究成為了國(guó)內(nèi)外的一個(gè)熱門領(lǐng)域。 本文在FPGA平臺(tái)上，用Verilog HDL實(shí)現(xiàn)了一個(gè)研究圖像處理算法的...
上傳時(shí)間： 2013-07-29
上傳用戶：愛順不順
資源簡(jiǎn)介：頻率合成技術(shù)廣泛應(yīng)用于通信、航空航天、儀器儀表等領(lǐng)域，目前，常用的頻率合成技術(shù)有直接頻率合成、鎖相頻率合成和直接數(shù)字頻率合成(DDS)等。其中DDS是一種新的頻率合成方法，是頻率合成的一次革命。全數(shù)字化的DDS技術(shù)由于具有頻率分辨率高、頻率切換速度快...
上傳時(shí)間： 2013-07-05
上傳用戶：suxuan110425
資源簡(jiǎn)介：頻率合成技術(shù)廣泛應(yīng)用于通信、航空航天、儀器儀表等領(lǐng)域，目前，常用的頻率合成技術(shù)有直接頻率合成、鎖相頻率合成和直接數(shù)字頻率合成(DDS)等。其中DDS是一種新的頻率合成方法，是頻率合成的一次革命。全數(shù)字化的DDS技術(shù)由于具有頻率分辨率高、頻率切換速度快...
上傳時(shí)間： 2013-04-24
上傳用戶：yx007699
資源簡(jiǎn)介：本文結(jié)合目前國(guó)內(nèi)外航電數(shù)據(jù)處理系統(tǒng)的發(fā)展概況，設(shè)計(jì)了一款集數(shù)據(jù)采集、處理、控制及傳輸于一體的航電處理系統(tǒng)。文章首先深入研究了自適應(yīng)濾波器原理，分析了LMS算法性能，著重從影響算法性能的因素入手，通過分析仿真，改進(jìn)算法，提升了算法性能，給出仿真...
上傳時(shí)間： 2013-07-01
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資源簡(jiǎn)介：基于FPGA的芯片，有關(guān)DDS合成原理實(shí)現(xiàn)正交信號(hào)源的設(shè)計(jì)。
上傳時(shí)間： 2015-04-27
上傳用戶：1589633708
資源簡(jiǎn)介：隨著紅外焦平面陣列的不斷發(fā)展，紅外技術(shù)的應(yīng)用范圍將越來越廣泛。焦平面面陣探測(cè)器的一個(gè)最大的缺點(diǎn)是固有的非均勻性。本文首先介紹了紅外熱成像技術(shù)的發(fā)展，討論了紅外焦平面陣列的基本原理和工作方式，分析了紅外非均勻性產(chǎn)生的原因。其次研究了幾種主要的...
上傳時(shí)間： 2013-08-03
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資源簡(jiǎn)介：基于FPGA的信號(hào)采集及頻譜分析，用VHDL編寫，壓縮包里是Quartus下的工程。AD采樣用狀態(tài)機(jī)實(shí)現(xiàn)，并存入LPM_RAM。設(shè)計(jì)了一個(gè)UART模塊（也是狀態(tài)機(jī)實(shí)現(xiàn)的），可將數(shù)據(jù)發(fā)到ＰＣ機(jī)上。
上傳時(shí)間： 2017-09-26
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