專輯類-實(shí)用電子技術(shù)專輯-385冊(cè)-3.609G 電子連接器設(shè)計(jì)基礎(chǔ)-35頁(yè)-1.3M.ppt
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專輯類-實(shí)用電子技術(shù)專輯-385冊(cè)-3.609G 無線供電、充電模塊.pdf
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專輯類-實(shí)用電子技術(shù)專輯-385冊(cè)-3.609G LCD-電子密碼鎖-4頁(yè)-2.2M.pdf
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專輯類-實(shí)用電子技術(shù)專輯-385冊(cè)-3.609G 第三章-GE-FANUC-PLC-指令集-一-繼電器指令.pdf
標(biāo)簽： GE-FANUC-PLC 指令集 指令
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New-尚未歸類-412冊(cè)-8.64G LED產(chǎn)業(yè)長(zhǎng)期發(fā)展仍看好.pdf
標(biāo)簽： LED
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New-尚未歸類-412冊(cè)-8.64G 信電路業(yè)余制作150例-281頁(yè)-6.6M.pdf
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專輯類-數(shù)字處理及顯示技術(shù)專輯-106冊(cè)-9138M 基于USB的串行通信軟硬件設(shè)計(jì)-41頁(yè)-0.8M.pdf
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超聲波電機(jī)(Ultrasonic Motor簡(jiǎn)稱USM)是八十年代發(fā)展起來的新型微電機(jī)。本文針對(duì)超聲波電機(jī)及其控制技術(shù)的研究現(xiàn)狀和發(fā)展趨勢(shì),以我國(guó)研究技術(shù)相對(duì)比較成熟并有產(chǎn)業(yè)化前景的行波超聲波電機(jī)(Traveling-wave Ultrasonic Motor簡(jiǎn)稱TUSM)的伺服控制技術(shù)為研究對(duì)象,以直徑60mm的行波超聲波電機(jī)TUSM60為研究實(shí)例,在特性測(cè)試、動(dòng)穩(wěn)態(tài)性能分析,辨識(shí)模型建立、控制策略與控制算法的選擇與實(shí)現(xiàn)等方面展開研究。本論具體的研究?jī)?nèi)容為： 在分析超聲波電機(jī)研究歷史和現(xiàn)狀的基礎(chǔ)上,結(jié)合國(guó)內(nèi)外超聲波電機(jī)特別是行波超聲波電機(jī)控制技術(shù)的發(fā)展趨勢(shì),重點(diǎn)論述了行波超聲波電機(jī)及其驅(qū)動(dòng)控制技術(shù)的研究進(jìn)展。 介紹行波超聲波電機(jī)的基本結(jié)構(gòu),并從該電機(jī)的主要理論基礎(chǔ)--壓電原理、行波合成、接觸模型出發(fā),分析了行波超聲波電機(jī)定子質(zhì)點(diǎn)的運(yùn)動(dòng)方程.并結(jié)合定轉(zhuǎn)子摩擦接觸特點(diǎn),分析了行波超聲波電機(jī)的運(yùn)行機(jī)理。 根據(jù)對(duì)行波超聲波電機(jī)測(cè)試和高精度控制的要求,研制出基于雙DSP和FPGA的超聲波電機(jī)高性能測(cè)試控制平臺(tái)。其中控制核心采用了雙DSP結(jié)構(gòu),可以在對(duì)行波超聲波電機(jī)進(jìn)行控制的同時(shí),將必要的參數(shù)讀取出來進(jìn)行分析和研究。為行波超聲波電機(jī)瞬態(tài)特性分析以及控制策略、控制算法的深入研究打下了基礎(chǔ)。 對(duì)電機(jī)的瞬態(tài)、穩(wěn)態(tài)特性進(jìn)行的測(cè)試,可以分析驅(qū)動(dòng)頻率、電壓以及相位差等調(diào)節(jié)量對(duì)電機(jī)輸出的影響。在此基礎(chǔ)上進(jìn)一步對(duì)行波超聲波電機(jī)的調(diào)節(jié)方式、控制算法選擇方面進(jìn)行分析,并得到相應(yīng)結(jié)論。 通過對(duì)實(shí)驗(yàn)數(shù)據(jù)的總結(jié)和歸納,利用系統(tǒng)辨識(shí)中的非參數(shù)方法,建立在特定頻率條件下的近似線性模型。在行波超聲波電機(jī)工作范圍內(nèi),辨識(shí)若干組不同頻率條件下的近似線性模型,將這些模型的參數(shù)進(jìn)行二維或三維擬合,可以得到一個(gè)關(guān)于行波超聲波電機(jī)傳遞函數(shù)的模型。辨識(shí)模型的建立為合理的選擇和優(yōu)化控制參數(shù),控制效果的驗(yàn)證等提供了行之有效的手段。 在對(duì)行波超聲波電機(jī)的速度控制、位置控制展開的研究中.首先利用遺傳算法對(duì)常規(guī)PI恒轉(zhuǎn)速控制的控制參數(shù)整定及修正方法進(jìn)行了研究；利用神經(jīng)元的在線自學(xué)習(xí)能力,研究和設(shè)計(jì)單神經(jīng)元PID-PI轉(zhuǎn)速控制器,提高控制系統(tǒng)對(duì)電機(jī)非線性和時(shí)變性的適應(yīng)能力；為了消除在伺服控制中,單一調(diào)節(jié)量(驅(qū)動(dòng)頻率)情況下,低轉(zhuǎn)速的跳躍問題,研究和討論了多調(diào)節(jié)量分段控制方法,并利用模糊控制對(duì)控制方法的有效性進(jìn)行了驗(yàn)證；在位置控制中,利用轉(zhuǎn)速控制研究的結(jié)果,研究和設(shè)計(jì)了位置--速度雙環(huán)(串級(jí))控制器,實(shí)現(xiàn)了電機(jī)高精度位置伺服控制。 通過對(duì)已有控制系統(tǒng)的改進(jìn)和簡(jiǎn)化,設(shè)計(jì)和研制了具有實(shí)用化價(jià)值行波超聲波電機(jī)控制器：并將研究成果應(yīng)用于針對(duì)核磁成像設(shè)備而設(shè)計(jì)的行波超聲波電機(jī)隨動(dòng)控制系統(tǒng)中,同時(shí)嘗試了將該控制器用于高精度X-Y兩維定位平臺(tái)。
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高性能ADC產(chǎn)品的出現(xiàn)，給混合信號(hào)測(cè)試領(lǐng)域帶來前所未有的挑戰(zhàn)。并行ADC測(cè)試方案實(shí)現(xiàn)了多個(gè)ADC測(cè)試過程的并行化和實(shí)時(shí)化，減少了單個(gè)ADC的平均測(cè)試時(shí)間，從而降低ADC測(cè)試成本。 本文實(shí)現(xiàn)了基于FPGA的ADC并行測(cè)試方法。在閱讀相關(guān)文獻(xiàn)的基礎(chǔ)上，總結(jié)了常用ADC參數(shù)測(cè)試方法和測(cè)試流程。使用FPGA實(shí)現(xiàn)時(shí)域參數(shù)評(píng)估算法和頻域參數(shù)評(píng)估算法，并對(duì)2個(gè)ADC在不同樣本數(shù)條件下進(jìn)行并行測(cè)試。 通過在FPGA內(nèi)部實(shí)現(xiàn)ADC測(cè)試時(shí)域算法和頻域算法相結(jié)合的方法來搭建測(cè)試系統(tǒng)，完成音頻編解碼器WM8731L的控制模式接口、音頻數(shù)據(jù)接口、ADC測(cè)試時(shí)域算法和頻域算法的FPGA實(shí)現(xiàn)。整個(gè)測(cè)試系統(tǒng)使用Angilent 33220A任意信號(hào)發(fā)生器提供模擬激勵(lì)信號(hào)，共用一個(gè)FPGA內(nèi)部實(shí)現(xiàn)的采樣時(shí)鐘控制模塊。并行測(cè)試系統(tǒng)將WM8731.L片內(nèi)的兩個(gè)獨(dú)立ADC的串行輸出數(shù)據(jù)分流成左右兩通道，并對(duì)其進(jìn)行串并轉(zhuǎn)換。然后對(duì)左右兩個(gè)通道分別配置一個(gè)FFT算法模塊和時(shí)域算法模塊，并行地實(shí)現(xiàn)了ADC參數(shù)的評(píng)估算法。 在樣本數(shù)分別為128和4096的實(shí)驗(yàn)條件下，對(duì)WM8731L片內(nèi)2個(gè)被測(cè).ADC并行地進(jìn)行參數(shù)評(píng)估，被測(cè)參數(shù)包括增益GAIN、偏移量OFFSET、信噪比SNR、信號(hào)與噪聲諧波失真比SINAD、總諧波失真THD等5個(gè)常用參數(shù)。實(shí)驗(yàn)結(jié)果表明，通過在FPGA內(nèi)配置2個(gè)獨(dú)立的參數(shù)計(jì)算模塊，可并行地實(shí)現(xiàn)對(duì)2個(gè)相同ADC的參數(shù)評(píng)估，減小單個(gè)ADC的平均測(cè)試時(shí)間。 FPGA片內(nèi)實(shí)時(shí)評(píng)估算法的實(shí)現(xiàn)節(jié)省了測(cè)試樣本傳輸至自動(dòng)測(cè)試機(jī)PC端的時(shí)間。而且只需將HDL代碼多次復(fù)制，就可實(shí)現(xiàn)多個(gè)被測(cè)ADC在同一時(shí)刻并行地被評(píng)估，配置靈活。基于FPGA的ADC并行測(cè)試方法易于實(shí)現(xiàn)，具有可行性，但由于噪聲的影響，測(cè)試精度有待進(jìn)一步提高。該方法可用于自動(dòng)測(cè)試機(jī)的混合信號(hào)選項(xiàng)卡或測(cè)試子系統(tǒng)。 關(guān)鍵詞：ADC測(cè)試；并行；參數(shù)評(píng)估；FPGA；FFT
上傳時(shí)間： 2013-07-11
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現(xiàn)代社會(huì)信息量爆炸式增長(zhǎng)，由于網(wǎng)絡(luò)、多媒體等新技術(shù)的發(fā)展，用戶對(duì)帶寬和速度的需求快速增加。并行傳輸技術(shù)由于時(shí)鐘抖動(dòng)和偏移，以及PCB布線的困難，使得傳輸速率的進(jìn)一步提升面臨設(shè)計(jì)的極限；而高速串行通信技術(shù)憑借其帶寬大、抗干擾性強(qiáng)和接口簡(jiǎn)單等優(yōu)勢(shì)，正迅速取代傳統(tǒng)的并行技術(shù)，成為業(yè)界的主流。 本論文針對(duì)目前比較流行并且有很大發(fā)展?jié)摿Φ膬煞N高速串行接口電路——高速鏈路口和Rocket I/O進(jìn)行研究，并以Xilinx公司最新款的Virtex-5 FPGA為研究平臺(tái)進(jìn)行仿真設(shè)計(jì)。本論文的主要工作是以某低成本相控陣?yán)走_(dá)信號(hào)處理機(jī)為設(shè)計(jì)平臺(tái)，在其中的一塊信號(hào)處理板上，進(jìn)行了基于LVDS(Low VoltageDifferential Signal)技術(shù)的高速LinkPort(鏈路口)設(shè)計(jì)和基于CML(Current ModeLogic)技術(shù)的Rocket I/O高速串行接口設(shè)計(jì)。首先在FPGA的軟件中進(jìn)行程序設(shè)計(jì)和功能、時(shí)序的仿真，當(dāng)仿真驗(yàn)證通過之后，重點(diǎn)是在硬件平臺(tái)上進(jìn)行調(diào)試。硬件調(diào)試驗(yàn)證的方法是將DSP TS201的鏈路口功能與在FPGA中的模擬高速鏈路口相連接，進(jìn)行數(shù)據(jù)的互相傳送，接收和發(fā)送的數(shù)據(jù)相同，證明了高速鏈路口設(shè)計(jì)的正確性。并且在硬件調(diào)試時(shí)對(duì)Rocket IO GTP收發(fā)器進(jìn)行回環(huán)設(shè)計(jì)，經(jīng)過回環(huán)之后接收到的數(shù)據(jù)與發(fā)送的數(shù)據(jù)相同，證明了Rocket I/O高速串行接口設(shè)計(jì)的正確性。
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