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電氣控制與plc應用技術課后答案(全)

  • 三菱PLC伺服控制攻絲機電路圖

    三菱PLC伺服控制攻絲機電路圖,12頁電路圖,很詳細!

    標簽: PLC 三菱 伺服控制 機電路圖

    上傳時間: 2013-05-16

    上傳用戶:qazwsxedc

  • 基于PLC的混合型模糊PID在膠溫控制系統中的應用

    ·基于PLC的混合型模糊PID在膠溫控制系統中的應用

    標簽: PLC PID 混合型 模糊

    上傳時間: 2013-06-06

    上傳用戶:Breathe0125

  • 基于PLC驅動控制步進電機的設計與實現

    ·摘 要:在PLC步進電機控制中,輸入到其線圈組中的脈沖數或脈沖頻率可控制步進電機的角位移和速度。以三菱的FX2系列為例,討論了步進電機的PLC控制系統設計與實現。[著者文摘]

    標簽: PLC 驅動控制 步進電機

    上傳時間: 2013-08-05

    上傳用戶:tccc

  • 用FPGA cyclone控制AD9280

    用FPGA cyclone控制AD9280后,將結果用LED的明暗來表示,8位數據分兩次顯示。

    標簽: cyclone FPGA 9280 AD

    上傳時間: 2013-08-05

    上傳用戶:ajaxmoon

  • 用Verilog語言編寫的FPGA控制PWM的程序

    用Verilog語言編寫的FPGA控制PWM的程序.利用碼盤脈沖進行調速,進行過簡單試驗,可用.沒有經過長期驗證.做簡單修改即可應用!

    標簽: Verilog FPGA PWM 語言

    上傳時間: 2013-08-16

    上傳用戶:梧桐

  • 用FPGA控制ADC0809的轉換時序來完成模/數轉換

    自己課程設計寫的程序,用FPGA控制ADC0809的轉換時序來完成模/數轉換,然后將轉換完的數字信號傳遞給0832

    標簽: FPGA 0809 ADC 轉換

    上傳時間: 2013-08-30

    上傳用戶:小寶愛考拉

  • 用CPLD控制曼徹斯特編解碼器

    用CPLD控制曼徹斯特編解碼器,很詳細的文字說明。

    標簽: CPLD 控制 曼徹斯特 編解碼器

    上傳時間: 2013-09-01

    上傳用戶:xiaodu1124

  • 關于用CPLD和FPGA做插補算法的內容,對于想用FPGA做控制的朋友是個好的借鑒!

    關于用CPLD和FPGA做插補算法的內容,對于想用FPGA做控制的朋友是個好的借鑒!

    標簽: FPGA CPLD 插補算法 控制

    上傳時間: 2013-09-02

    上傳用戶:taox

  • 數控振蕩器的頻率控制字寄存器、相位控制字寄存器、累加器和加法器可以用VHDL語言描述

    數控振蕩器的頻率控制字寄存器、相位控制字寄存器、累加器和加法器可以用VHDL語言描述,集成在一個模塊中,提供VHDL源程序供大家學習和討論。\r\n

    標簽: VHDL 寄存器 數控振蕩器 加法器

    上傳時間: 2013-09-04

    上傳用戶:a471778

  • pcb layout design(臺灣硬件工程師15年經驗

    PCB LAYOUT 術語解釋(TERMS)1. COMPONENT SIDE(零件面、正面)︰大多數零件放置之面。2. SOLDER SIDE(焊錫面、反面)。3. SOLDER MASK(止焊膜面)︰通常指Solder Mask Open 之意。4. TOP PAD︰在零件面上所設計之零件腳PAD,不管是否鑽孔、電鍍。5. BOTTOM PAD:在銲錫面上所設計之零件腳PAD,不管是否鑽孔、電鍍。6. POSITIVE LAYER:單、雙層板之各層線路;多層板之上、下兩層線路及內層走線皆屬之。7. NEGATIVE LAYER:通常指多層板之電源層。8. INNER PAD:多層板之POSITIVE LAYER 內層PAD。9. ANTI-PAD:多層板之NEGATIVE LAYER 上所使用之絕緣範圍,不與零件腳相接。10. THERMAL PAD:多層板內NEGATIVE LAYER 上必須零件腳時所使用之PAD,一般稱為散熱孔或導通孔。11. PAD (銲墊):除了SMD PAD 外,其他PAD 之TOP PAD、BOTTOM PAD 及INNER PAD 之形狀大小皆應相同。12. Moat : 不同信號的 Power& GND plane 之間的分隔線13. Grid : 佈線時的走線格點2. Test Point : ATE 測試點供工廠ICT 測試治具使用ICT 測試點 LAYOUT 注意事項:PCB 的每條TRACE 都要有一個作為測試用之TEST PAD(測試點),其原則如下:1. 一般測試點大小均為30-35mil,元件分布較密時,測試點最小可至30mil.測試點與元件PAD 的距離最小為40mil。2. 測試點與測試點間的間距最小為50-75mil,一般使用75mil。密度高時可使用50mil,3. 測試點必須均勻分佈於PCB 上,避免測試時造成板面受力不均。4. 多層板必須透過貫穿孔(VIA)將測試點留於錫爐著錫面上(Solder Side)。5. 測試點必需放至於Bottom Layer6. 輸出test point report(.asc 檔案powerpcb v3.5)供廠商分析可測率7. 測試點設置處:Setup􀃆pads􀃆stacks

    標簽: layout design pcb 硬件工程師

    上傳時間: 2013-10-22

    上傳用戶:pei5

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