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高速信號

高速DSP與SDRAM之間信號傳輸延時的分析

　　當今電子技術的發展日新月異，尤其是深亞微米工藝在IC設計中的應用，使得芯片的集成規模愈來愈大，速度愈來愈高，從而使得如何處理高速信號問題成為設計的關鍵因素之一。隨著電子系統中邏輯和系統時鐘頻率的迅速提高和信號邊沿不斷變陡，印刷電路板(PCB)的線跡互連和板層特性對系統電氣性能的影響也越發重要。對于低頻設計線跡互連和板層的影響可以不考慮;當頻率超過50MHz時，互連關系和板層特性的影響不容忽視，必須對傳輸線效應加以考慮，在評定系統性能時也必須考慮印刷電路板板材的電參數。因此，高速系統的設計必須面對互連延遲引起的時序問題以及串擾、傳輸線效應等信號完整性(SI)問題。本文主要對互連延遲所引起的時序問題進行探討。

標簽： SDRAM DSP 信號傳輸延時

上傳時間： 2013-12-18

上傳用戶：如果你也聽說
NiosⅡ和USB接口的高速數據采集卡設計

基于fpga的高速數據采集卡設計制作

標簽： Nios USB 接口高速數據

上傳時間： 2014-12-28

上傳用戶：cx111111
基于FPGA的激光測距回波信號高速采集研究

在激光測距系統中，微弱回波信號的檢測處理一直是一個難題。本文主要討論了激光測距接收系統的實現方法，這種測距方法既適用于短距離的測量又適用于長距離的測量。首先介紹了脈沖式激光測距的原理，在此原理的基礎上，結合FPGA的高速信號處理能力，設計了高精度激光測距接收系統，并設計了回波信號接收與計數電路模塊。

標簽： FPGA 激光測距回波信號高速采集

上傳時間： 2013-10-19

上傳用戶：dxxx
基于SPI接口和FIFO緩沖器的大容量高速實時數據存儲方案

大容量高速實時數據存儲方案

標簽： FIFO SPI 接口大容量

上傳時間： 2013-11-18

上傳用戶：youke111
在FPGA中基于信元的FIFO設計方法實戰方法

　　設計工程師通常在FPGA上實現FIFO(先進先出寄存器)的時候，都會使用由芯片提供商所提供的FIFO。但是，由于其通用性使得其針對性變差，某些情況下會變得不方便或者將增加硬件成本。此時，需要進行自行FIFO設計。本文提供了一種基于信元的FIFO設計方法以供設計者在適當的時候選用。這種方法也適合于不定長包的處理。

標簽： FPGA FIFO 信元設計方法

上傳時間： 2014-01-13

上傳用戶：mengmeng444425
基于FPGA 的低成本長距離高速傳輸系統的設計與實現

為解決目前高速信號處理中的數據傳輸速度瓶頸以及傳輸距離的問題，設計并實現了一種基于FPGA 的高速數據傳輸系統，本系統借助Altera Cyclone III FPGA 的LVDS I/O 通道產生LVDS 信號，穩定地完成了數據的高速、遠距離傳輸。系統所需的8B/10B 編解碼、數據時鐘恢復(CDR)、串/并行轉換電路、誤碼率計算模塊均在FPGA 內利用VHDL 語言設計實現，大大降低了系統互聯的復雜度和成本，提高了系統集成度和穩定性。

標簽： FPGA 高速傳輸

上傳時間： 2013-10-30

上傳用戶：zhishenglu
基于FPGA的高速電路設計與仿真

現代數字信號處理從視頻擴展到了中頻甚至射頻,針對要求信號處理的處理速度越來越高、傳輸速率越來越快等特點,給出了一款使用高性能FPGA、DAC以及經先進的PCB設計工具設計、仿真的高速信號處理模塊,實現了對高速信號的實時接收和處理。關鍵詞:數字信號處理; 高速電路; FPGA;設計與仿真

標簽： FPGA 高速電路仿真

上傳時間： 2013-10-21

上傳用戶：wendy15
采用高速串行收發器Rocket I/O實現數據率為2.5 G

摘要: 串行傳輸技術具有更高的傳輸速率和更低的設計成本, 已成為業界首選, 被廣泛應用于高速通信領域。提出了一種新的高速串行傳輸接口的設計方案, 改進了Aurora 協議數據幀格式定義的弊端, 并采用高速串行收發器Rocket I/O, 實現數據率為2.5 Gbps的高速串行傳輸。關鍵詞: 高速串行傳輸; Rocket I/O; Aurora 協議為促使FPGA 芯片與串行傳輸技術更好地結合以滿足市場需求, Xilinx 公司適時推出了內嵌高速串行收發器RocketI/O 的Virtex II Pro 系列FPGA 和可升級的小型鏈路層協議———Aurora 協議。Rocket I/O支持從622 Mbps 至3.125 Gbps的全雙工傳輸速率, 還具有8 B/10 B 編解碼、時鐘生成及恢復等功能, 可以理想地適用于芯片之間或背板的高速串行數據傳輸。Aurora 協議是為專有上層協議或行業標準的上層協議提供透明接口的第一款串行互連協議, 可用于高速線性通路之間的點到點串行數據傳輸, 同時其可擴展的帶寬, 為系統設計人員提供了所需要的靈活性[4]。但該協議幀格式的定義存在弊端,會導致系統資源的浪費。本文提出的設計方案可以改進Aurora 協議的固有缺陷,提高系統性能, 實現數據率為2.5 Gbps 的高速串行傳輸, 具有良好的可行性和廣闊的應用前景。

標簽： Rocket 2.5 高速串行收發器

上傳時間： 2013-11-06

上傳用戶：smallfish
基于FPGA的高速串行傳輸接口研究與實現

摘　要:介紹了FPGA最新一代器件Virtex25上的高速串行收發器RocketIO。基于ML505開發平臺構建了一個高速串行數據傳輸系統,重點說明了該系統采用RocketIO實現1. 25Gbp s高速串行傳輸的設計方案。實現并驗證了采用FPGA完成千兆串行傳輸的功能目標,為后續采用FPGA實現各種高速協議奠定了良好的基礎。關鍵詞: FPGA;高速串行傳輸; RocketIO; GTP 在數字系統互連設計中,高速串行I/O技術取代傳統的并行I/O技術成為當前發展的趨勢。與傳統并行I/O技術相比,串行方案提供了更大的帶寬、更遠的距離、更低的成本和更高的擴展能力,克服了并行I/O設計存在的缺陷。在實際設計應用中,采用現場可編程門陣列( FPGA)實現高速串行接口是一種性價比較高的技術途徑。

標簽： FPGA 高速串行傳輸接口

上傳時間： 2013-11-22

上傳用戶：lingzhichao
基于FPGA實現的高速串行交換模塊實現方法研究

采用Xlinx公司的Virtex5系列FPGA設計了一個用于多種高速串行協議的數據交換模塊,并解決了該模塊實現中的關鍵問題.該交換模塊實現4X模式RapidIO協議與4X模式PCI Express協議之間的數據交換,以及自定義光纖協議與4X模式PCI Express協議之間的數據交換,實現了單字讀寫以及DMA操作,并提供高速穩定的傳輸帶寬.

標簽： FPGA 高速串行模塊實現方法

上傳時間： 2013-10-12

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