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高速數(shù)(shù)字電路設(shè)(shè)計(jì)(jì)

  • 基于FPGA的高速高階FIR濾波器設(shè)計(jì)

    　　隨著雷達(dá)、圖像、通信等領(lǐng)域?qū)π盘柛咚偬幚淼囊螅芯咳藛T正尋求高速的數(shù)字信號處理算法，以滿足這種高速地處理數(shù)據(jù)的需要。常用的高速實(shí)時數(shù)字信號處理的器件有ASIC、可編程的數(shù)字信號處理芯片、FPGA，等等。　　本文研究了時域FPGA上實(shí)現(xiàn)高速高階FIR數(shù)字濾波器結(jié)構(gòu)，并實(shí)現(xiàn)了高壓縮比的LFM脈沖信號的匹配濾波。文章根據(jù)FIR數(shù)字濾波器理論，分析比較實(shí)現(xiàn)了FIR濾波器的方法；使用并行分布式算法，在Xilinx的VirtexⅡFPGA系列芯片上設(shè)計(jì)了高速高階FIR濾波器。并詳細(xì)進(jìn)行了分析；設(shè)計(jì)出了一個256階的線性調(diào)頻脈沖壓縮信號的匹配濾波器設(shè)計(jì)實(shí)例，并用ModelSim軟件進(jìn)行了仿真。

    標(biāo)簽： FPGA FIR 濾波器設(shè)計(jì)

    上傳時間： 2013-07-18

    上傳用戶：yt1993410

  • 采用FPGA實(shí)現(xiàn)基于ATCA架構(gòu)的2.5Gbps串行背板接口

    當(dāng)前，在系統(tǒng)級互連設(shè)計(jì)中高速串行I/O技術(shù)迅速取代傳統(tǒng)的并行I/O技術(shù)正成為業(yè)界趨勢。人們已經(jīng)意識到串行I/O“潮流”是不可避免的，因?yàn)樵诟哂?Gbps的速度下，并行I/O方案已經(jīng)達(dá)到了物理極限，不能再提供可靠和經(jīng)濟(jì)的信號同步方法。基于串行I/O的設(shè)計(jì)帶來許多傳統(tǒng)并行方法所無法提供的優(yōu)點(diǎn)，包括：更少的器件引腳、更低的電路板空間要求、減少印刷電路板（PCB）層數(shù)、PCB布局布線更容易、接頭更小、EMI更少，而且抵抗噪聲的能力也更好。高速串行I/O技術(shù)正被越來越廣泛地應(yīng)用于各種系統(tǒng)設(shè)計(jì)中，包括PC、消費(fèi)電子、海量存儲、服務(wù)器、通信網(wǎng)絡(luò)、工業(yè)計(jì)算和控制、測試設(shè)備等。迄今業(yè)界已經(jīng)發(fā)展出了多種串行系統(tǒng)接口標(biāo)準(zhǔn)，如PCI Express、串行RapidIO、InfiniBand、千兆以太網(wǎng)、10G以太網(wǎng)XAUI、串行ATA等等。 Aurora協(xié)議是為私有上層協(xié)議或標(biāo)準(zhǔn)上層協(xié)議提供透明接口的串行互連協(xié)議，它允許任何數(shù)據(jù)分組通過Aurora協(xié)議封裝并在芯片間、電路板間甚至機(jī)箱間傳輸。Aurora鏈路層協(xié)議在物理層采用千兆位串行技術(shù)，每物理通道的傳輸波特率可從622Mbps擴(kuò)展到3.125Gbps。Aurora還可將1至16個物理通道綁定在一起形成一個虛擬鏈路。16個通道綁定而成的虛擬鏈路可提供50Gbps的傳輸波特率和最大40Gbps的全雙工數(shù)據(jù)傳輸速率。Aurora可優(yōu)化支持范圍廣泛的應(yīng)用，如太位級路由器和交換機(jī)、遠(yuǎn)程接入交換機(jī)、HDTV廣播系統(tǒng)、分布式服務(wù)器和存儲子系統(tǒng)等需要極高數(shù)據(jù)傳輸速率的應(yīng)用。 傳統(tǒng)的標(biāo)準(zhǔn)背板如VME總線和CompactPCI總線都是采用并行總線方式。然而對帶寬需求的不斷增加使新興的高速串行總線背板正在逐漸取代傳統(tǒng)的并行總線背板。現(xiàn)在，高速串行背板速率普遍從622Mbps到3.125Gbps，甚至超過10Gbps。AdvancedTCA（先進(jìn)電信計(jì)算架構(gòu)）正是在這種背景下作為新一代的標(biāo)準(zhǔn)背板平臺被提出并得到快速的發(fā)展。它由PCI工業(yè)計(jì)算機(jī)制造商協(xié)會（PICMG）開發(fā)，其主要目的是定義一種開放的通信和計(jì)算架構(gòu)，使它們能被方便而迅速地集成，滿足高性能系統(tǒng)業(yè)務(wù)的要求。ATCA作為標(biāo)準(zhǔn)串行總線結(jié)構(gòu)，支持高速互聯(lián)、不同背板拓?fù)洹⒏咝盘柮芏取?biāo)準(zhǔn)機(jī)械與電氣特性、足夠步線長度等特性，滿足當(dāng)前和未來高系統(tǒng)帶寬的要求。 采用FPGA設(shè)計(jì)高速串行接口將為設(shè)計(jì)帶來巨大的靈活性和可擴(kuò)展能力。Xilinx Virtex-IIPro系列FPGA芯片內(nèi)置了最多24個RocketIO收發(fā)器，提供從622Mbps到3.125Gbps的數(shù)據(jù)速率并支持所有新興的高速串行I/O接口標(biāo)準(zhǔn)。結(jié)合其強(qiáng)大的邏輯處理能力、豐富的IP核心支持和內(nèi)置PowerPC處理器，為企業(yè)從并行連接向串行連接的過渡提供了一個理想的連接平臺。 本文論述了采用Xilinx Virtex-IIPro FPGA設(shè)計(jì)傳輸速率為2.5Gbps的高速串行背板接口，該背板接口完全符合PICMG3.0規(guī)范。本文對串行高速通道技術(shù)的發(fā)展背景、現(xiàn)狀及應(yīng)用進(jìn)行了簡要的介紹和分析，詳細(xì)分析了所涉及到的主要技術(shù)包括線路編解碼、控制字符、逗點(diǎn)檢測、擾碼、時鐘校正、通道綁定、預(yù)加重等。同時對AdvancedTCA規(guī)范以及Aurora鏈路層協(xié)議進(jìn)行了分析， 并在此基礎(chǔ)上給出了FPGA的設(shè)計(jì)方法。最后介紹了基于Virtex-IIPro FPGA的ATCA接口板和MultiBERT設(shè)計(jì)工具，可在標(biāo)準(zhǔn)ATCA機(jī)框內(nèi)完成單通道速率為2.5Gbps的全網(wǎng)格互聯(lián)。

    標(biāo)簽： FPGA ATCA Gbps 2.5

    上傳時間： 2013-05-29

    上傳用戶：frank1234

  • 基于FPGA的高速IPSec協(xié)議實(shí)現(xiàn)技術(shù)研究

    隨著國際互聯(lián)網(wǎng)絡(luò)的迅猛發(fā)展，網(wǎng)絡(luò)應(yīng)用的不斷豐富，Intenret已經(jīng)從最初以學(xué)術(shù)交流為目的而演變?yōu)樯虡I(yè)行為，網(wǎng)絡(luò)安全性需求日益增加，高速網(wǎng)絡(luò)安全保密成為關(guān)注的焦點(diǎn)，在安全得到保障的情況下，為了滿足網(wǎng)速無限制的追求，高速網(wǎng)絡(luò)硬件加密設(shè)備也必將成為需求熱點(diǎn)。另一方面，IPSec協(xié)議被廣泛的應(yīng)用于防火墻和安全網(wǎng)關(guān)中，但對IPSec協(xié)議的處理會大大增加網(wǎng)關(guān)的負(fù)載，成為千兆網(wǎng)實(shí)現(xiàn)的瓶頸。本文便是針對上述現(xiàn)狀，研究基于高性能FPGA實(shí)現(xiàn)千兆IPSec協(xié)議的設(shè)計(jì)技術(shù)。 目前，國外IPSec協(xié)議實(shí)現(xiàn)已經(jīng)芯片化，達(dá)到幾千兆的速率，但是國內(nèi)產(chǎn)品多以軟件實(shí)現(xiàn)，速度難以提高。本文采用的基于FPGA的IPSec技術(shù)方案，采用硬件實(shí)現(xiàn)隧道模式下的IPSec協(xié)議，為IP分組及其上層協(xié)議數(shù)據(jù)提供機(jī)密性、數(shù)據(jù)完整性驗(yàn)證以及數(shù)據(jù)源驗(yàn)證等安全服務(wù)。在以VPN為實(shí)施方案的基礎(chǔ)上，構(gòu)建了以KDIPSec為設(shè)備原型以IPSec協(xié)議為出發(fā)點(diǎn)的千兆網(wǎng)絡(luò)系統(tǒng)環(huán)境模型，從硬件體系結(jié)構(gòu)到各個模塊的劃分以及各個模塊實(shí)現(xiàn)的功能這幾個方面描述了KDIPSec實(shí)現(xiàn)技術(shù)，最后描述了一些關(guān)鍵模塊的FPGA設(shè)計(jì)和和仿真。所有處理模塊均在Xilinx公司的FPGA芯片中實(shí)現(xiàn)，處理速率超過1Gb/s。

    標(biāo)簽： IPSec FPGA 協(xié)議 實(shí)現(xiàn)技術(shù)

    上傳時間： 2013-07-03

    上傳用戶：wfl_yy

  • 基于FPGA的數(shù)字化調(diào)頻DDS系統(tǒng)設(shè)計(jì)

    頻率合成技術(shù)廣泛應(yīng)用于通信、航空航天、儀器儀表等領(lǐng)域。目前，常用的頻率合成技術(shù)有直接式頻率合成，鎖相頻率合成和直接數(shù)字頻率合成(DDS)。本次設(shè)計(jì)是利用FPGA完成一個DDS系統(tǒng)并利用該系統(tǒng)實(shí)現(xiàn)模擬信號的數(shù)字化調(diào)頻。 DDS是把一系列數(shù)字量形式的信號通過D/A轉(zhuǎn)換形成模擬量形式的信號的合成技術(shù)。主要是利用高速存儲器作查尋表，然后通過高速D/A轉(zhuǎn)換器產(chǎn)生已經(jīng)用數(shù)字形式存入的正弦波(或其他任意波形)。一個典型的DDS系統(tǒng)應(yīng)包括：相位累加器，可在時鐘的控制下完成相位的累加；相位碼—幅度碼轉(zhuǎn)換電路，一般由ROM實(shí)現(xiàn)；DA轉(zhuǎn)換電路，將數(shù)字形式的幅度碼轉(zhuǎn)換成模擬信號。DDS系統(tǒng)可以很方便地獲得頻率分辨率很精細(xì)且相位連續(xù)的信號，也可以通過改變相位字改變信號的相位，因此也廣泛用于數(shù)字調(diào)頻和調(diào)相。本次數(shù)字化調(diào)頻的基本思想是利用AD轉(zhuǎn)換電路將模擬信號轉(zhuǎn)換成數(shù)字信號，同時用該數(shù)字信號與一個固定的頻率字累加，形成一個受模擬信號幅度控制的頻率字，從而獲得一個頻率受模擬信號的幅度控制的正弦波，即實(shí)現(xiàn)了調(diào)頻。該DDS數(shù)字化調(diào)頻方案的硬件系統(tǒng)是以FPGA為核心實(shí)現(xiàn)的。使用Altera公司的ACEX1K系列FPGA，整個系統(tǒng)由VHDL語言編程，開發(fā)軟件為MAX+PLUSⅡ。經(jīng)過實(shí)際測試，該系統(tǒng)在頻率較低時與理論值完全符合，但在高頻時，受器件速度的限制，波形有較大的失真。

    標(biāo)簽： FPGA DDS 數(shù)字化 調(diào)頻

    上傳時間： 2013-06-14

    上傳用戶：ljt101007

  • 基于OFDM的PLC通信系統(tǒng)同步模塊的FPGA實(shí)現(xiàn)

    電力線通信技術(shù)利用分布廣泛的低壓電力線作為通信信道，實(shí)現(xiàn)internet高速互連，為用戶提供互聯(lián)網(wǎng)訪問、視頻點(diǎn)播等服務(wù)，形成包括電力在內(nèi)的“四網(wǎng)合一”，目前正受到人們的關(guān)注。利用該技術(shù)，可以在居民區(qū)內(nèi)建立寬帶接入網(wǎng)，也可以利用遍布家庭各個房間的電源插座組成家庭局域網(wǎng)。但是電力線是傳輸電能的，因此通過電力線傳輸數(shù)據(jù)有許多的問題需要解決。 OFDM(正交頻分復(fù)用)技術(shù)是實(shí)現(xiàn)電力線通信的一項(xiàng)熱門技術(shù)。OFDM采用添加循環(huán)前綴的技術(shù)，能有效地降低ICI(信道間干擾)和ISI(碼間干擾)。同時通過使用正交的子信道，大大提高了頻譜資源利用率。FPGA作為可編程邏輯器件，具有設(shè)計(jì)時間短、投資少、風(fēng)險小的特點(diǎn)，而且可以反復(fù)修改，反復(fù)編程，直到完全滿足需要，具有其他方式無可比擬的方便性和靈活性，能夠加速數(shù)字系統(tǒng)的研發(fā)速度。本文著重研究了OFDM同步技術(shù)在FPGA上的實(shí)現(xiàn)。本論文主要是在項(xiàng)目組工作的基礎(chǔ)上構(gòu)造雙路信號數(shù)據(jù)糾正算法流程，提出最佳采樣點(diǎn)與載波相位估計(jì)算法，完善中各個子模塊算法的硬件設(shè)計(jì)流程。內(nèi)容安排如下：第一章介紹OFDM(正交頻分復(fù)用)技術(shù)的發(fā)展歷史、技術(shù)原理。第二章介紹了PLD的分類、工藝和結(jié)構(gòu)特點(diǎn)，以及FPGA的開發(fā)環(huán)境、開發(fā)流程和Verilog語言的特點(diǎn)。第三章對OFDM系統(tǒng)的同步模塊進(jìn)行詳細(xì)的闡述。第四章是OFDM同步算法的在FPGA上的實(shí)現(xiàn)，對各個子模塊進(jìn)行仿真，給出了仿真波形圖和系統(tǒng)性能分析。最后，第五章總結(jié)了全文的工作，對OFDM技術(shù)的實(shí)現(xiàn)需要進(jìn)一步完善的方面與后續(xù)工作進(jìn)行了探討。

    標(biāo)簽： OFDM FPGA PLC 通信系統(tǒng)

    上傳時間： 2013-04-24

    上傳用戶：hgy9473

  • 耦合、隔直和旁路電容的選擇

    耦合、隔直和旁路電容的選擇。。對電源方面會有一定的幫助。。

    標(biāo)簽： 耦合 旁路電容

    上傳時間： 2013-06-03

    上傳用戶：cc111

  • 華為《高速數(shù)字電路設(shè)計(jì)教材》

    這本書是專門為電路設(shè)計(jì)工程師寫的。它主要描述了模擬電路原理在高速數(shù)字電路設(shè)計(jì)中 的分析應(yīng)用。通過列舉很多的實(shí)例，作者詳細(xì)分析了一直困擾高速電路路設(shè)計(jì)工程師的鈴流、串?dāng)_和輻射噪音等問題。

    標(biāo)簽： 華為 高速數(shù)字電路 設(shè)計(jì)教材

    上傳時間： 2013-04-24

    上傳用戶：hsj3927

  • 基于ARMLinux的多道脈沖幅度分析器數(shù)字系統(tǒng)設(shè)計(jì)

    隨著電子技術(shù)的不斷發(fā)展，各種智能核儀器逐步走向自動化、智能化、數(shù)字化和便攜式的方向發(fā)展。針對傳統(tǒng)的多道脈沖幅度分析器體積大，人機(jī)交互不友好，不方便現(xiàn)場分析等的缺陷[5]。新型的高速、集成度高、界面友好的多道脈沖幅度分析器的陸續(xù)出現(xiàn)填補(bǔ)了這一缺點(diǎn)。 隨著電子技術(shù)的發(fā)展，以ARM為核的處理器技術(shù)的應(yīng)用領(lǐng)域不斷擴(kuò)大，相比較單片機(jī)而言，它的主頻高、運(yùn)算速度快，可以滿足多道脈沖幅度分析器的苛刻的時間上的要求。而且ARM處理器功耗小，適合于功耗要求比較苛刻的地方，這些方面的特點(diǎn)正好滿足了便攜式多道脈沖幅度分析器野外勘察的要求。同時，由于以ARM為核的處理器具有豐富的外設(shè)資源，這樣就簡化了外設(shè)電路及芯片的使用，降低了功耗并增強(qiáng)了產(chǎn)品的信賴性。另外，ARM芯片可以方便的移植操作系統(tǒng)，為多道脈沖幅度分析器多任務(wù)的管理和并行的處理，甚至硬實(shí)時功能的實(shí)現(xiàn)提供了前提。而且在ARM平臺使用嵌入式linux操作系統(tǒng)使多道脈沖幅度分析器的軟件易于升級。 智能化和小型化是多道脈沖幅度分析器的發(fā)展趨勢。智能化要求系統(tǒng)的自動化程度高、操作簡便、容錯性好。智能化除了需要控制軟件外，還需要軟件命令的執(zhí)行者即硬件控制電路來實(shí)現(xiàn)相應(yīng)的控制邏輯，兩者的結(jié)合才能真正的實(shí)現(xiàn)智能化。小型化要求系統(tǒng)的體積小、功耗小、便于攜帶；小型化除了要求采用微功耗的器件，還要求電路板的尺寸盡量的小且所用元件盡量的少，但小型化的同時必須保持系統(tǒng)的智能化，即不能減少智能化所要求的復(fù)雜的邏輯和時序的控制功能。為此采用高集成度的ARM芯片實(shí)現(xiàn)控制電路能滿意地同時滿足智能化和小型化的要求。在研制的多道脈沖幅度分析器中，幾乎所有的控制都可以用控制芯片來實(shí)現(xiàn)，如閾值設(shè)定、自動穩(wěn)譜以及多道數(shù)據(jù)采集，在節(jié)省了元件的數(shù)目和電路板的尺寸的同時仍能保持系統(tǒng)的智能化程度。 Linux內(nèi)核精簡而高效，可修改性強(qiáng)，支持多種體系結(jié)構(gòu)的處理器等，使得它是一個非常適合于嵌入式開發(fā)和應(yīng)用的操作系統(tǒng)。嵌入式Linux可以運(yùn)行的硬件平臺十分廣泛，從x86、MIPS、POWERPC到ARM，以及其他許多硬件體系結(jié)構(gòu)。目前在世界范圍內(nèi)，ARM體系結(jié)構(gòu)的SOC逐漸占領(lǐng)32位嵌入式微處理器市場，ARM處理器及技術(shù)的應(yīng)用幾乎已經(jīng)深入到各個領(lǐng)域，例如：工業(yè)控制，無線通訊，網(wǎng)絡(luò)，消費(fèi)類電子，成像等。 本課題采用三星公司生產(chǎn)的ARM(Advanced RISC Machines，先進(jìn)精簡指令集機(jī)器)芯片S3C2410A設(shè)計(jì)并研制了一種便攜式的核數(shù)據(jù)采集系統(tǒng)設(shè)計(jì)方案。利用ARM芯片豐富的外設(shè)資源對傳統(tǒng)的多道脈沖幅度分析器進(jìn)行改進(jìn)和簡化。系統(tǒng)由前端探測器系統(tǒng)，以及由線性脈沖放大器、甄別電路、控制電路、采樣保持電路組成的前置電路，中央處理器模塊，顯示模塊，用戶交互模塊，存儲模塊，網(wǎng)絡(luò)傳輸模塊等多個模塊組成。本設(shè)計(jì)基于ARM9芯片S3C2410，并在此平臺上移植了嵌入式linux操作系統(tǒng)來進(jìn)行任務(wù)的調(diào)度和處理等。 電路板核心板部分設(shè)計(jì)采用6層PCB板結(jié)構(gòu)，這樣增加了系統(tǒng)可靠性，提高了電磁兼容的穩(wěn)定性。數(shù)據(jù)采集系統(tǒng)是多道脈沖幅度分析器的核心，A/D轉(zhuǎn)換直接使用了S3C2410內(nèi)置的ADC(Analog to Digital Converter,模數(shù)轉(zhuǎn)換器)，在2.5 MHz的轉(zhuǎn)換時鐘下最大轉(zhuǎn)換速度500 KSPS(Kilo-Samples per second,千采樣點(diǎn)每秒)，滿足了系統(tǒng)最低轉(zhuǎn)換時間≤5 μs的要求，并且控制簡單，簡化了外部接口電路。由于SD(Secure Digital Card，安全數(shù)碼卡)卡存儲容量大、攜帶方便、成本低等優(yōu)點(diǎn)，所以設(shè)計(jì)中采用其作為外部的數(shù)據(jù)存儲設(shè)備,其驅(qū)動部分采用SD卡軟件包，為開發(fā)帶來了方便。本設(shè)計(jì)采用640*480的6.4寸LCD(Liquid Crystal Display，液晶顯示)屏作為人機(jī)交互的顯示部分，并且通過Qt/Embedded為系統(tǒng)提供圖形用戶界面的應(yīng)用框架和窗口系統(tǒng)。其中包括了波形顯示部分和用戶菜單設(shè)置部分，這樣方便了用戶操作。系統(tǒng)的數(shù)據(jù)存取方面是基于SQLite嵌入式小型數(shù)據(jù)庫而進(jìn)行的。為了方便數(shù)據(jù)向上位機(jī)的傳輸，系統(tǒng)設(shè)計(jì)中采用XML(Extensible Markup Language，可擴(kuò)展標(biāo)記語言)格式來組織傳輸?shù)臄?shù)據(jù)，通過基于TCP/IP(Transmission Control Protocol/Internet Protocol)協(xié)議的Linux下Socket套接字編程，來進(jìn)行與上位機(jī)或PC(Personal Computer,個人計(jì)算機(jī)或桌面機(jī))等的連接和數(shù)據(jù)傳輸。

    標(biāo)簽： ARMLinux 多道 分析器 脈沖幅度

    上傳時間： 2013-04-24

    上傳用戶：tzl1975

  • 基于ARM的DeviceNet從站開發(fā)

    DeviceNet現(xiàn)場總線標(biāo)準(zhǔn)作為工業(yè)現(xiàn)場總線的國際標(biāo)準(zhǔn)，其開放性和先進(jìn)性得到了廣泛關(guān)注和充分肯定。開發(fā)符合DeviceNet現(xiàn)場標(biāo)準(zhǔn)的自動化產(chǎn)品意義重大，也是必要的。 文中從現(xiàn)場通用的老式串口（RS232和RS485）與新興DeviceNet網(wǎng)絡(luò)的兼容問題以及模擬量，數(shù)字量和多種總線等多功能的一體化問題為出發(fā)點(diǎn)，以Atmel的32位ARM7高速處理器為開發(fā)平臺，充分發(fā)揮其處理高速和功能多樣的優(yōu)勢，同時結(jié)合DeviceNet現(xiàn)場總線高效和診斷的優(yōu)點(diǎn)，開發(fā)了一個帶8路數(shù)字量輸入，8數(shù)字量輸出，4路模擬量輸入以及RS232為底層自定義協(xié)議串口，RS485為底層的在線可配置Modbus協(xié)議的DevciceNet一體化通訊網(wǎng)關(guān)。 最后文中還利用雙口RAM的協(xié)同處理能力，構(gòu)成雙CPU處理能力的結(jié)構(gòu)，將avr162的8位處理器處理PROFIBUS總線數(shù)據(jù)，而將32位的ARM7處理器處理DeviceNet總線數(shù)據(jù)。文中特別從系統(tǒng)硬件開發(fā)和軟件開發(fā)兩方面加以闡述，并結(jié)合OMRON PLC主站測試系統(tǒng)，最終成功給于測試。 為了便于讀者理解和文章的完整性，本文首先對DeviceNet現(xiàn)場總線標(biāo)準(zhǔn)做了簡單介紹；后根據(jù)DeviceNet標(biāo)準(zhǔn)對所需求的產(chǎn)品的進(jìn)行總體設(shè)計(jì)，以及相應(yīng)的DeviceNet網(wǎng)關(guān)的硬件和軟件的設(shè)計(jì)和開發(fā)。最后，搭建了DeviceNet-Modbus測試系統(tǒng)和DeviceNet-PROFIBUS DP兩套測試系統(tǒng)對所開發(fā)產(chǎn)品進(jìn)行的了功能測試。本課題按照預(yù)期設(shè)計(jì)思想完成了DeviceNet多功能網(wǎng)關(guān)的軟硬件的開發(fā)，并將系統(tǒng)程序下載到處理器中，在測試平臺下能夠長時間的正常運(yùn)行，達(dá)到了期望效果。

    標(biāo)簽： DeviceNet ARM

    上傳時間： 2013-04-24

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  • 基于ARM的流體網(wǎng)絡(luò)測控系統(tǒng)的設(shè)計(jì)與實(shí)現(xiàn)

    隨著計(jì)算機(jī)、通信、電子技術(shù)的進(jìn)步，嵌入式系統(tǒng)和以太網(wǎng)技術(shù)的融合將成為嵌入式技術(shù)未來的重要發(fā)展方向。基于ARM的嵌入式系統(tǒng)由于具有低功耗、高性能、低成本、可以進(jìn)行多任務(wù)操作等優(yōu)點(diǎn)，在控制領(lǐng)域得到了越來越廣泛的應(yīng)用。 本選題來自中山大學(xué)與北京航天五院合作研制的流體網(wǎng)絡(luò)系統(tǒng)地面原理樣機(jī)控制器設(shè)計(jì)項(xiàng)目。論文研究的主要目的是利用基于ARM920T內(nèi)核的嵌入式微處理器AT91RM9200融合多傳感器設(shè)計(jì)一種可以在地面實(shí)驗(yàn)室環(huán)境中可靠運(yùn)行的數(shù)據(jù)采集與溫度控制系統(tǒng)。 本文從嵌入式測控系統(tǒng)的硬件實(shí)現(xiàn)和軟件設(shè)計(jì)兩方面進(jìn)行分析。在硬件設(shè)計(jì)上，主控制板以Atmel公司生產(chǎn)的AT91RM9200 CPU為核心，主要包括串口模塊、存儲模塊、以太網(wǎng)接口模塊、基于SPI串行接口設(shè)計(jì)的數(shù)據(jù)采集模塊（A/D）、基于I2C接口設(shè)計(jì)的PID控制信號輸出模塊（D/A）和采用PIO接口設(shè)計(jì)的開關(guān)控制輸出模塊等電路，其中后三個模塊承擔(dān)了流體網(wǎng)絡(luò)回路的傳感器數(shù)據(jù)采集，關(guān)鍵點(diǎn)的溫度控制和多路電磁閥的開關(guān)控制等任務(wù)，后文將重點(diǎn)介紹。在軟件設(shè)計(jì)方面，主要分兩個方面進(jìn)行討論，分別為主控制器上基于嵌入式Linux系統(tǒng)的軟件和上位機(jī)采用Visual C++編寫的監(jiān)控軟件。主控制器軟件采用多線程進(jìn)行設(shè)計(jì)，包括主線程、服務(wù)器子線程和數(shù)據(jù)采集子線程，三個線程同時運(yùn)行，提高了系統(tǒng)的運(yùn)行效率。上位機(jī)和主控制器通過接入以太網(wǎng)中，然后由服務(wù)器線程和上位機(jī)客戶端利用socket套接字實(shí)現(xiàn)通信。同時上位機(jī)軟件也提供形象美觀的圖形用戶界面，配合主控制器實(shí)現(xiàn)特定的溫度、流量和壓力監(jiān)控。 本論文設(shè)計(jì)的嵌入式測控系統(tǒng)充分利用了AT91RM9200內(nèi)嵌的的強(qiáng)大功能模塊，包括SPI接口模塊和I2C接口模塊等，可廣泛應(yīng)用于控制領(lǐng)域。對該系統(tǒng)的一些研究成果和設(shè)計(jì)方法具有一定的先進(jìn)性和良好的實(shí)用性，具有良好的應(yīng)用前景。

    標(biāo)簽： ARM 流體 網(wǎng)絡(luò)測控

    上傳時間： 2013-06-30

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