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高階譜估計時延

  • WP409利用Xilinx FPGA打造出高端比特精度和周期精度浮點DSP算法實現方案

    WP409利用Xilinx FPGA打造出高端比特精度和周期精度浮點DSP算法實現方案: High-Level Implementation of Bit- and Cycle-Accurate Floating-Point DSP Algorithms with Xilinx FPGAs

    標簽: Xilinx FPGA 409 DSP

    上傳時間: 2013-11-07

    上傳用戶:defghi010

  • Xilinx FPGA全局時鐘資源的使用方法

    目前,大型設計一般推薦使用同步時序電路。同步時序電路基于時鐘觸發沿設計,對時鐘的周期、占空比、延時和抖動提出了更高的要求。為了滿足同步時序設計的要求,一般在FPGA設計中采用全局時鐘資源驅動設計的主時鐘,以達到最低的時鐘抖動和延遲。 FPGA全局時鐘資源一般使用全銅層工藝實現,并設計了專用時鐘緩沖與驅動結構,從而使全局時鐘到達芯片內部的所有可配置單元(CLB)、I/O單元 (IOB)和選擇性塊RAM(Block Select RAM)的時延和抖動都為最小。為了適應復雜設計的需要,Xilinx的FPGA中集成的專用時鐘資源與數字延遲鎖相環(DLL)的數目不斷增加,最新的 Virtex II器件最多可以提供16個全局時鐘輸入端口和8個數字時鐘管理模塊(DCM)。與全局時鐘資源相關的原語常用的與全局時鐘資源相關的Xilinx器件原語包括:IBUFG、IBUFGDS、BUFG、BUFGP、BUFGCE、 BUFGMUX、BUFGDLL和DCM等,如圖1所示。  

    標簽: Xilinx FPGA 全局時鐘資源

    上傳時間: 2014-01-01

    上傳用戶:maqianfeng

  • 采用FPGA的多路高壓IGBT驅動觸發器研制

    為有效控制固態功率調制設備,提高系統的可調性和穩定性,介紹了一種基于現場可編程門陣列( FPGA)和微控制器(MCU) 的多路高壓IGBT 驅動觸發器的設計方法和實現電路。該觸發器可選擇內或外觸發信號,可遙控或本控,能產生多路頻率、寬度和延時獨立可調的脈沖信號,信號的輸入輸出和傳輸都使用光纖。將該觸發器用于高壓IGBT(3300 V/ 800 A) 感應疊加脈沖發生器中進行實驗測試,給出了實驗波形。結果表明,該多路高壓IGBT驅動觸發器輸出脈沖信號達到了較高的調整精度,頻寬’脈寬及延時可分別以步進1 Hz、0. 1μs、0. 1μs 進行調整,滿足了脈沖發生器的要求,提高了脈沖功率調制系統的性能。

    標簽: FPGA IGBT 多路 驅動

    上傳時間: 2013-10-22

    上傳用戶:zhulei420

  • 毫米波低相噪捷變頻高分辨率雷達頻率源設計

    設計了一種由直接數字頻率合成(DDS)、倍頻鏈構成的三次變頻直接頻率合成方案,實現了低相噪捷變頻高分辨率毫米波雷達頻率合成器設計。利用直接頻率合成器的倍頻輸出取代傳統三次變頻毫米波頻率源的鎖相環(PLL),同時提供線性調頻(LFM)信號,優化DDS和變頻方案的頻率配置關系。利用FPGA電路進行高速控制,較好地解決了毫米波頻率合成器各技術指標之間的矛盾。實測結果表明,采用該方案的毫米波頻率合成器在本振跳頻帶寬為160 MHz時,線性調頻頻率分辨率可達0.931 Hz,最大頻率轉換時間小于2 ?滋s,最大雜散低于-60 dBc,相位噪聲優于-90 dBc/Hz。

    標簽: 毫米波 捷變 高分辨率 雷達

    上傳時間: 2014-01-06

    上傳用戶:brain kung

  • 地面模擬系統DBF接收機設計

    在衛星的地面測試中,地面模擬系統發送遙控遙測信號并接收衛星的返回信號,將其下變頻到中頻進行解調,從而獲取衛星工作狀態和運行環境,模擬其在軌運行工作情況。針對目前采用有源相控陣天線技術的衛星地面測試,本文設計實現了一種DBF體制的地面模擬系統接收機,該接收機采用超外差式二次變頻設計,具有高增益、低噪聲系數、低群時延波動、良好的通道間幅相一致性和穩定性,同時集成度高,體積小,可制造性強,能夠充分的滿足采用有源相控陣技術的衛星地面測試要求。

    標簽: DBF 模擬系統 收機設計

    上傳時間: 2013-11-11

    上傳用戶:我累個乖乖

  • AR9331高功率CPE裸板

    納拓科技應用AR9331開發設計出一款高功率CPE,同時可以做高功率無線ap和網橋,在無線網絡通信中有廣泛應用

    標簽: 9331 CPE AR 高功率

    上傳時間: 2013-11-17

    上傳用戶:qiulin1010

  • 一種低延時片上網絡路由器的設計與實現

    通過分析流水線結構和單周期結構的片上網絡路由器,提出了一種低延時片上網絡路由器的設計,并在SMIC 0.13um Mixed-signal/RF 1.2V/3.3V工藝進行流片驗證。芯片測試結果表明,該路由器可以在300 MHz時鐘頻率下工作,并且在相同負載下,與其他結構的路由器相比較,其能夠在較低延時下完成數據包傳送功能。

    標簽: 低延時 片上網絡 路由器

    上傳時間: 2014-12-28

    上傳用戶:bakdesec

  • 低能耗和低時延的無線傳感器網絡數據融合算法

    針對無線傳感器網絡的節點能量有限,且在進行信息傳輸時存在數據沖突、傳輸延時等問題,提出并設計了基于最大生存周期的無線傳感器網絡數據融合算法。該算法將整個網絡中的節點分成多個簇,并根據節點的傳輸范圍,將每個簇中的節點均勻分布,每個節點根據自己的本地信息和剩余能量選擇通信方式向簇頭節點傳輸數據,從而形成傳輸數據的最短路徑;并根據集中式TDMA(時分多址)調度模型,運用基于微粒群的Pareto優化方法,使得網絡在完成規定的信息傳輸時每個節點耗費的平均時隙和平均能耗最優。仿真結果表明,上述算法不但可以最大化網絡的生存時間,還可以有效的降低數據融合時間,減少網絡延時。

    標簽: 低能耗 時延 無線傳感器 網絡數據

    上傳時間: 2014-12-29

    上傳用戶:看到了沒有

  • 容遲網絡中基于復制策略的單播路由算法研究

    容遲/容延網絡(Delay Tolerant Network/DTN)泛指由于節點移動、能量管理、調度等原因而出現頻繁中斷、甚至長時間處于中斷狀態的一類網絡。針對DTN具有的時延高、割裂頻繁、節點能量受限、以及節點移動性等特點,通過對DTN中基于復制策略的單播路由策略進行分類和比較,提出了如何優化DTN單播路由算法、提高網絡傳輸率的建議。

    標簽: 容遲網絡 策略 路由 算法研究

    上傳時間: 2013-11-24

    上傳用戶:xiaojie

  • 基于光纖傳輸的延時系統設計

    延時系統或稱為延遲線在雷達、導航和通信等領域的應用非常廣泛。文中介紹了一種基于光纖傳輸的延時系統的研制,克服了傳統延遲系統在實現手段方面的瓶頸,滿足了雷達、導航、通信等電子設備中對電信號的長延遲需求。

    標簽: 光纖傳輸 延時 系統設計

    上傳時間: 2013-11-20

    上傳用戶:jennyzai

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