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  • 單片機(jī)與微型打印機(jī)的接口設(shè)計(jì)

    在分析TPUP 微型打印機(jī)控打原理的基礎(chǔ)上, 設(shè)計(jì)了以AT89S52 為核心的微型打印機(jī)接口, 介紹了AT89S52 單片機(jī)接口應(yīng)用設(shè)置、接口轉(zhuǎn)換電路及微打的串行通信方法,此方法也可應(yīng)用于其它類(lèi)型的微

    標(biāo)簽: 單片機(jī) 微型打印機(jī) 接口設(shè)計(jì)

    上傳時(shí)間: 2013-06-29

    上傳用戶(hù):trepb001

  • 超寬帶脈沖與MB-OFDM物理層的FPGA實(shí)現(xiàn)

    現(xiàn)代通信系統(tǒng)對(duì)帶寬和數(shù)據(jù)速率的要求越來(lái)越高,超寬帶(ultra-wideband,UWB)通信以其傳輸速率高、空間容量大、成本低、功耗低的優(yōu)點(diǎn),成為解決企業(yè)、家庭、公共場(chǎng)所等高速因特網(wǎng)接入的需求與越來(lái)越擁擠的頻率資源分配之間的矛盾的技術(shù)手段。 論文主要圍繞兩方面展開(kāi)分析:一是介紹用于UWB無(wú)載波脈沖調(diào)制及直接序列碼分多址調(diào)制(DS-CDMA)的新型脈沖,即Hermite正交脈沖,并且分析了這種構(gòu)建UWB多元通信和多用戶(hù)通信的系統(tǒng)性能。二是分析了UWB的多帶頻分復(fù)用物理層提案(MBOA)的調(diào)制技術(shù),并在FPGA上實(shí)現(xiàn)了調(diào)制模塊。正交Hermite脈沖集被提出用于UWB的M元雙正交調(diào)制系統(tǒng),獲得高數(shù)據(jù)速率。調(diào)整脈沖的脈寬因子和中心頻率能使脈沖滿(mǎn)足FCC的頻譜要求。M元雙正交調(diào)制的接收機(jī)需要M/2個(gè)相關(guān)器,遠(yuǎn)比M元正交調(diào)制所需的相關(guān)器數(shù)量少。誤碼率一定時(shí),維數(shù)M的增加可獲得高的比特率和低的信噪比。雖然高階的Hermite脈沖易受抖動(dòng)時(shí)延的影響,但當(dāng)抖動(dòng)時(shí)延范圍小于0.02ns時(shí),其影響較為不明顯。本文認(rèn)為1~8階的Hermite脈沖皆可用,可構(gòu)成16元雙正交系統(tǒng)。 正交Hermite脈沖集也可以構(gòu)造UWB多用戶(hù)系統(tǒng)。各用戶(hù)的信息用不同的Hermite脈沖同時(shí)傳輸,其多用戶(hù)的誤比特率上限低于高斯單脈沖構(gòu)成的PPM多用戶(hù)系統(tǒng)的誤比特率,所以其系統(tǒng)性能更優(yōu)。正交Hermite脈沖還可以用于UWB的DS-CDMA調(diào)制,在8個(gè)脈沖可用的情況下,最多可容64個(gè)用戶(hù)同時(shí)通信。 基于MBOA提出的UWB物理層協(xié)議,本文用Verilog硬件語(yǔ)言實(shí)現(xiàn)了調(diào)制與解調(diào)結(jié)構(gòu),并用Modelsim做了時(shí)序驗(yàn)證。用Verilog編程實(shí)現(xiàn)的輸出數(shù)據(jù)與Matlab生成的UWB建模的輸出結(jié)果一致。為了達(dá)到UWBMB-OFDM系統(tǒng)的FFT處理器的要求,一個(gè)混和基多通道流水線的FFT算法結(jié)構(gòu)被提出。其有效的實(shí)現(xiàn)方法也被提出。這種結(jié)構(gòu)采用多通道以獲得高的數(shù)據(jù)吞吐量。此外,它用于存儲(chǔ)和復(fù)數(shù)乘法器的硬件損耗相比其他的FFT處理器是最少的。高基的FFT蝶算減少了復(fù)數(shù)乘法器的數(shù)量。在132MHz的工作頻率下,整個(gè)128點(diǎn)FFT變換在此結(jié)構(gòu)模式下只需要242.4ns,滿(mǎn)足了MBOA的要求。

    標(biāo)簽: MB-OFDM FPGA 超寬帶 脈沖

    上傳時(shí)間: 2013-07-29

    上傳用戶(hù):TI初學(xué)者

  • RS(255,223)譯碼器的FPGA實(shí)現(xiàn)及其性能測(cè)試

      本課題首先研究了常規(guī)的RS譯碼器的算法,確定在關(guān)鍵方程的計(jì)算中采用一種新改進(jìn)的BM算法,然后提出了基于復(fù)數(shù)基的有限域快速并行乘法器和利用冪指數(shù)相減進(jìn)行除法計(jì)算的有限域除法器,通過(guò)這些優(yōu)化方法提高了RS譯碼器的速度,減少了譯碼延時(shí)和硬件資源使用,最后利用VHDL硬件描述語(yǔ)言在FPGA上實(shí)現(xiàn)了流水線處理的RS(255,223)譯碼器?!? 本課題實(shí)現(xiàn)的RS(255,223)硬件譯碼器的性能在國(guó)內(nèi)具有領(lǐng)先水平,對(duì)我國(guó)以后航天項(xiàng)目高速數(shù)據(jù)傳輸系統(tǒng)的設(shè)計(jì)有著很大的意義?!?/p>

    標(biāo)簽: FPGA 255 223 譯碼器

    上傳時(shí)間: 2013-06-29

    上傳用戶(hù):gokk

  • 采用FPGA實(shí)現(xiàn)基于ATCA架構(gòu)的2.5Gbps串行背板接口

    當(dāng)前,在系統(tǒng)級(jí)互連設(shè)計(jì)中高速串行I/O技術(shù)迅速取代傳統(tǒng)的并行I/O技術(shù)正成為業(yè)界趨勢(shì)。人們已經(jīng)意識(shí)到串行I/O“潮流”是不可避免的,因?yàn)樵诟哂?Gbps的速度下,并行I/O方案已經(jīng)達(dá)到了物理極限,不能再提供可靠和經(jīng)濟(jì)的信號(hào)同步方法。基于串行I/O的設(shè)計(jì)帶來(lái)許多傳統(tǒng)并行方法所無(wú)法提供的優(yōu)點(diǎn),包括:更少的器件引腳、更低的電路板空間要求、減少印刷電路板(PCB)層數(shù)、PCB布局布線更容易、接頭更小、EMI更少,而且抵抗噪聲的能力也更好。高速串行I/O技術(shù)正被越來(lái)越廣泛地應(yīng)用于各種系統(tǒng)設(shè)計(jì)中,包括PC、消費(fèi)電子、海量存儲(chǔ)、服務(wù)器、通信網(wǎng)絡(luò)、工業(yè)計(jì)算和控制、測(cè)試設(shè)備等。迄今業(yè)界已經(jīng)發(fā)展出了多種串行系統(tǒng)接口標(biāo)準(zhǔn),如PCI Express、串行RapidIO、InfiniBand、千兆以太網(wǎng)、10G以太網(wǎng)XAUI、串行ATA等等。 Aurora協(xié)議是為私有上層協(xié)議或標(biāo)準(zhǔn)上層協(xié)議提供透明接口的串行互連協(xié)議,它允許任何數(shù)據(jù)分組通過(guò)Aurora協(xié)議封裝并在芯片間、電路板間甚至機(jī)箱間傳輸。Aurora鏈路層協(xié)議在物理層采用千兆位串行技術(shù),每物理通道的傳輸波特率可從622Mbps擴(kuò)展到3.125Gbps。Aurora還可將1至16個(gè)物理通道綁定在一起形成一個(gè)虛擬鏈路。16個(gè)通道綁定而成的虛擬鏈路可提供50Gbps的傳輸波特率和最大40Gbps的全雙工數(shù)據(jù)傳輸速率。Aurora可優(yōu)化支持范圍廣泛的應(yīng)用,如太位級(jí)路由器和交換機(jī)、遠(yuǎn)程接入交換機(jī)、HDTV廣播系統(tǒng)、分布式服務(wù)器和存儲(chǔ)子系統(tǒng)等需要極高數(shù)據(jù)傳輸速率的應(yīng)用。 傳統(tǒng)的標(biāo)準(zhǔn)背板如VME總線和CompactPCI總線都是采用并行總線方式。然而對(duì)帶寬需求的不斷增加使新興的高速串行總線背板正在逐漸取代傳統(tǒng)的并行總線背板?,F(xiàn)在,高速串行背板速率普遍從622Mbps到3.125Gbps,甚至超過(guò)10Gbps。AdvancedTCA(先進(jìn)電信計(jì)算架構(gòu))正是在這種背景下作為新一代的標(biāo)準(zhǔn)背板平臺(tái)被提出并得到快速的發(fā)展。它由PCI工業(yè)計(jì)算機(jī)制造商協(xié)會(huì)(PICMG)開(kāi)發(fā),其主要目的是定義一種開(kāi)放的通信和計(jì)算架構(gòu),使它們能被方便而迅速地集成,滿(mǎn)足高性能系統(tǒng)業(yè)務(wù)的要求。ATCA作為標(biāo)準(zhǔn)串行總線結(jié)構(gòu),支持高速互聯(lián)、不同背板拓?fù)?、高信?hào)密度、標(biāo)準(zhǔn)機(jī)械與電氣特性、足夠步線長(zhǎng)度等特性,滿(mǎn)足當(dāng)前和未來(lái)高系統(tǒng)帶寬的要求。 采用FPGA設(shè)計(jì)高速串行接口將為設(shè)計(jì)帶來(lái)巨大的靈活性和可擴(kuò)展能力。Xilinx Virtex-IIPro系列FPGA芯片內(nèi)置了最多24個(gè)RocketIO收發(fā)器,提供從622Mbps到3.125Gbps的數(shù)據(jù)速率并支持所有新興的高速串行I/O接口標(biāo)準(zhǔn)。結(jié)合其強(qiáng)大的邏輯處理能力、豐富的IP核心支持和內(nèi)置PowerPC處理器,為企業(yè)從并行連接向串行連接的過(guò)渡提供了一個(gè)理想的連接平臺(tái)。 本文論述了采用Xilinx Virtex-IIPro FPGA設(shè)計(jì)傳輸速率為2.5Gbps的高速串行背板接口,該背板接口完全符合PICMG3.0規(guī)范。本文對(duì)串行高速通道技術(shù)的發(fā)展背景、現(xiàn)狀及應(yīng)用進(jìn)行了簡(jiǎn)要的介紹和分析,詳細(xì)分析了所涉及到的主要技術(shù)包括線路編解碼、控制字符、逗點(diǎn)檢測(cè)、擾碼、時(shí)鐘校正、通道綁定、預(yù)加重等。同時(shí)對(duì)AdvancedTCA規(guī)范以及Aurora鏈路層協(xié)議進(jìn)行了分析, 并在此基礎(chǔ)上給出了FPGA的設(shè)計(jì)方法。最后介紹了基于Virtex-IIPro FPGA的ATCA接口板和MultiBERT設(shè)計(jì)工具,可在標(biāo)準(zhǔn)ATCA機(jī)框內(nèi)完成單通道速率為2.5Gbps的全網(wǎng)格互聯(lián)。

    標(biāo)簽: FPGA ATCA Gbps 2.5

    上傳時(shí)間: 2013-05-29

    上傳用戶(hù):frank1234

  • FPGA測(cè)試技術(shù)研究

      論文首先介紹了SRAM型FPGA的典型代表XC4000系列的結(jié)構(gòu)和主要特性,并對(duì)XC4000系列器件的配置模式和配置順序做了簡(jiǎn)單介紹。根據(jù)XC4000系列器件各組成模塊的功能和特點(diǎn),可以將其分為可編程邏輯功能塊(CLB)、輸入輸出功能塊(IOB)、互連資源(IR)、可配置接口模塊(CIM)和進(jìn)位邏輯(CLM)等五大部分組成。 對(duì)于這五個(gè)功能模塊,可以采用“分治法”分別考慮各個(gè)模塊的測(cè)試問(wèn)題。論文隨后深入討論了各模塊的測(cè)試問(wèn)題,由于RAM測(cè)試的特殊性,所以對(duì)函數(shù)發(fā)生器RAM模式的測(cè)試單獨(dú)進(jìn)行了討論。

    標(biāo)簽: FPGA 測(cè)試 技術(shù)研究

    上傳時(shí)間: 2013-06-29

    上傳用戶(hù):牛津鞋

  • Codewarrior使用教程

    Codewarrior使用教程,和我上傳的使用指南差不多,給和一樣用飛思卡爾的新手提供參考

    標(biāo)簽: Codewarrior 使用教程

    上傳時(shí)間: 2013-07-29

    上傳用戶(hù):maizezhen

  • AD420程序

    AD420中文資料和程序,詳細(xì)介紹了AD420的使用方法

    標(biāo)簽: 420 AD 程序

    上傳時(shí)間: 2013-05-29

    上傳用戶(hù):魚(yú)魚(yú)魚(yú)yu

  • 數(shù)字信號(hào)處理及其matlab實(shí)現(xiàn).pdf

    數(shù)字信號(hào)處理、離散時(shí)間信號(hào)與系統(tǒng)、DFT、FFT等,MATLAB仿真

    標(biāo)簽: matlab 數(shù)字信號(hào)處理

    上傳時(shí)間: 2013-07-29

    上傳用戶(hù):685

  • 上位機(jī)與下位機(jī)

    上位機(jī)與下位機(jī)的概念 初學(xué)者要好好搞清楚的

    標(biāo)簽: 上位機(jī) 下位機(jī)

    上傳時(shí)間: 2013-07-29

    上傳用戶(hù):busterman

  • ccs3.3入門(mén)

    ccs3.3入門(mén)級(jí)資料歡迎大家下載使用,

    標(biāo)簽: ccs 3.3

    上傳時(shí)間: 2013-07-29

    上傳用戶(hù):gxrui1991

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