在Altera公司的Cyclone系列FPGA開發(fā)板上試驗的按鍵中斷程序，希望對那些學(xué)習(xí)中斷開發(fā)的初學(xué)者有幫助。 pio_key.v是verilog編寫的按鍵中斷程序，對應(yīng)四個按鍵，按其中任何一個鍵都可以發(fā)送一個中斷； keyint.c是Nios中編寫的C程序，用于檢測按鍵的中斷，如果檢測到中斷，會檢測是哪個按鍵按下，從而執(zhí)行相應(yīng)的程序！
標(biāo)簽： Cyclone Altera FPGA 開發(fā)板
上傳時間： 2014-06-11
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本文介紹了一種基于NIOS II軟核處理器實現(xiàn)對LCD-LQ057Q3DC02控制的新方法。在設(shè)計中利用FPGA的Altera的SOPC Builder定制NIOS II軟核處理器及其與顯示功能相關(guān)的“軟” 硬件模塊來協(xié)同實現(xiàn)顯示控制的軟硬件設(shè)計。利用SOPC技術(shù)，將NIOS II CPU和LCD控制器放在同一片F(xiàn)PGA中，解決了通常情況下必須使用LCD 控制專用芯片才能解決LCD顯示的問題。
標(biāo)簽： NIOS Builder Altera LCD-LQ
上傳時間： 2017-09-06
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用CPU配置Altera公司的FPGA，簡單明了，通俗易懂。
上傳時間： 2013-11-25
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電子書-Altera FPGA_CPLD設(shè)計 Quartus ii軟件FPGA設(shè)計 基礎(chǔ)篇+高級篇合集
上傳時間： 2022-02-16
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該文檔為Altera-軟件無線電數(shù)字下變頻技術(shù)研究及FPGA實現(xiàn)講解文檔，是一份很不錯的參考資料，具有較高參考價值，感興趣的可以下載看看………………
上傳時間： 2022-03-11
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基于Altera的FPGA設(shè)計的硬件除法器，適合感興趣的學(xué)習(xí)者學(xué)習(xí)，可以提高自己的能力，大家可以多交流哈
上傳時間： 2022-05-20
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基于Altera的Max10M08 FPGA的評估板設(shè)計(PCB+原理圖)2
標(biāo)簽： altera max10m08 fpga 評估 設(shè)計 pcb 原理圖
上傳時間： 2022-07-25
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隨著當(dāng)今科學(xué)技術(shù)的迅猛發(fā)展，數(shù)字圖像處理技術(shù)正在各個行業(yè)得到廣泛的應(yīng)用，而FPGA技術(shù)的不斷成熟改變了通常采用并行計算機(jī)或數(shù)字信號處理器(DSP)、專用集成電路(ASIC)等作為嵌入式處理器的慣例?？删幊踢壿嬈骷?FPGA)憑借其較低的開發(fā)成本、較高的并行處理速度、較大的靈活性及其較短的開發(fā)周期等特點，在圖像處理系統(tǒng)中有獨特的優(yōu)勢。 本文提出了一種基于FPGA的圖像采集處理系統(tǒng)解決方案，并選用低成本高性能的Altera公司的CycloneIII系列FPGA EP3C40F324為核心，設(shè)計開發(fā)了圖像采集處理的軟硬件綜合系統(tǒng)。文章闡述了如何在FPGA中嵌入NiosII軟核處理器并完成圖像采集處理系統(tǒng)功能的設(shè)計方案。硬件電路上，系統(tǒng)設(shè)計了三塊電路板：FPGA核心處理板、圖像采集卡、圖像顯示卡，其中通過I2C總線對采集卡的工作模式進(jìn)行配置，在采集模塊控制下，將采集到的圖像數(shù)據(jù)存儲到SDRAM；根據(jù)VGA顯示原理及其時序關(guān)系，設(shè)計了VGA顯示輸出控制模塊，合成了VGA工作的控制信號，又根據(jù)VGA顯示器的工業(yè)標(biāo)準(zhǔn)，合成VGA接口的水平和幀同步信號。邏輯硬件上，應(yīng)用SOPCBuilder工具生成了FPGA內(nèi)部的邏輯硬件功能模塊，定制了NiosII IP core、CMOS圖像采集模塊、VGA Controller及其I2C總線接口，系統(tǒng)各模塊間通過Avalon總線連接起來。軟件部分，在NiosII內(nèi)核處理器上實現(xiàn)了彩色圖像顏色空間轉(zhuǎn)換、二值化、形態(tài)學(xué)腐蝕處理及其目標(biāo)定位等算法。實驗結(jié)果證明了本文提出的方案及算法的正確性，可行性。
標(biāo)簽： FPGA 圖像采集 處理系統(tǒng)
上傳時間： 2013-08-05
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現(xiàn)實生活中的語音不可避免的要受到周圍環(huán)境的影響，背景噪聲例如機(jī)械噪聲、街頭音樂噪音，其他說話者的話音等均會嚴(yán)重地影響語音信號的質(zhì)量：此外傳輸系統(tǒng)本身也會產(chǎn)生各種噪聲，因此接收端的信號為帶噪語音信號?；殳B在語音信號中的噪聲按類別可分為環(huán)境噪聲等的加法性噪聲及電器線路干擾等的乘法性噪聲；按性質(zhì)可分為平穩(wěn)噪聲和非平穩(wěn)噪聲。 語音增強(qiáng)的根本目的就是凈化語音質(zhì)量。把不需要的噪音減低到最小程度。但是由于噪音的復(fù)雜性，很難歸納出一個統(tǒng)一的特征，因此不可能尋求一種算法完全適應(yīng)于所有的噪音消除，因此語音增強(qiáng)是一個復(fù)雜的工程。 有關(guān)抗噪聲技術(shù)的研究以及實際環(huán)境下的語音信號處理系統(tǒng)的開發(fā)，在國內(nèi)外已經(jīng)成為語音信號處理非常重要的研究課題，已經(jīng)作了大量的研究工作，取得了豐富的研究成果。本文僅對加性噪聲下的語音增強(qiáng)技術(shù)做了較為仔細(xì)的討論，我們先給出語音信號處理的基本理論，它是語音增強(qiáng)算法研究和實現(xiàn)的理論基礎(chǔ)，在此基礎(chǔ)總結(jié)了自適應(yīng)信號處理技術(shù)的特點以及在語音增強(qiáng)方面的應(yīng)用。選取工程領(lǐng)域最常用的自適應(yīng)LMS濾波算法和RLS濾波算法作為研究對象，提出了利用最小均方誤差意義下自適應(yīng)濾波器的輸出信號與主通道噪聲信號的等效關(guān)系，得到濾波器最佳自適應(yīng)參數(shù)的方法，并分析了在平穩(wěn)和非平穩(wěn)噪聲環(huán)境下，L M S濾波器族和R L S濾波器在不同噪音輸入下的權(quán)系數(shù)收斂速度、權(quán)系數(shù)穩(wěn)定性、跟蹤輸入信號的能力和信噪比的改善等特性。 研究了MATLAB語言程序設(shè)計和使用MALTLAB對語音算法進(jìn)行仿真、并輸入了多種實際環(huán)境下的噪音進(jìn)行濾波仿真并對仿真的結(jié)果進(jìn)行比較和分析?？偨Y(jié)出了LMS、NLMS、SIGN-ERROR-LMS、RLS自適應(yīng)濾波器在語音濾波方面的特點 和應(yīng)用情況。 最后在MATLAB仿真的基礎(chǔ)上，利用Altera公司的Cyclone2系列FPGA芯片和多種EDA工具，完成了L M S自適應(yīng)濾波器的FPGA設(shè)計。 關(guān)鍵詞：語音增強(qiáng)，背景噪音，自適應(yīng)濾波器，LMS，RLS，F(xiàn)PGA
標(biāo)簽： FPGA 語音增強(qiáng) 算法研究
上傳時間： 2013-04-24
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隨著計算機(jī)和微電子技術(shù)的飛速發(fā)展，基于數(shù)字信號處理的示波器、信號發(fā)生器、邏輯分析儀和頻譜分析儀等測量儀器已經(jīng)應(yīng)用到各個領(lǐng)域并且發(fā)揮著重要作用，但這些儀器昂貴的價格阻礙了它們的普遍使用。 本文針對電子測量儀器技術(shù)發(fā)展和普及的情況，結(jié)合用FPGA實現(xiàn)數(shù)字信號處理的優(yōu)勢，研究一種基于FPGA的輔助性獨立電予測量儀器的軟件系統(tǒng)。這種儀器可以作為數(shù)?；旌想娐窚y試和驗證的工具，用來觀察模擬信號波形、數(shù)字信號時序波形、模擬信號的幅度頻譜，也可以用來產(chǎn)生DDS信號。在硬件選擇上，使用具有Altera公司CycloneⅡ器件的平臺來實現(xiàn)單片DSP系統(tǒng)，這種芯片成本低廉、工作速度快、技術(shù)兼容性好；在軟件設(shè)計上，采用基于FPGA的可編程數(shù)字邏輯設(shè)計方法，這種方法具有開發(fā)難度小、功能擴(kuò)展簡單等優(yōu)點。設(shè)計中采用的關(guān)鍵技術(shù)包括：基于FPGA和IP Core的Verilog HDL設(shè)計、數(shù)據(jù)采集、數(shù)據(jù)存儲、數(shù)據(jù)處理以及數(shù)據(jù)波形的實時顯示。對這些技術(shù)的研究探討不僅有理論研究價值，在科學(xué)實驗和產(chǎn)品設(shè)計中同樣具有重要的實用價值。系統(tǒng)的設(shè)計以低資源、高性能為目標(biāo)，設(shè)計中采用了科學(xué)的模塊劃分、設(shè)計與集成的方法，在保持原四種信號處理功能不變的前提下，盡量多的節(jié)約各種FPGA資源，為實現(xiàn)低成本的輔助電子測量儀器提供了可能。
標(biāo)簽： FPGA 多功能電子 測量系統(tǒng)
上傳時間： 2013-06-05
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