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CLOCK

  • 報(bào)時(shí)小鬧鐘 本程序是一個(gè)用匯編編的精致的圖形時(shí)鐘

    報(bào)時(shí)小鬧鐘 本程序是一個(gè)用匯編編的精致的圖形時(shí)鐘,運(yùn)行時(shí)雙擊CLOCK圖標(biāo)即可, 鐘表顯示的時(shí)間為本機(jī)系統(tǒng)的時(shí)間。   按b鍵可擴(kuò)大畫(huà)面 ;按s鍵可縮小畫(huà)面;按c鍵可改變顏色;按e鍵可聽(tīng)音樂(lè); 按q鍵退出本程序.

    標(biāo)簽: 鬧鐘 程序 匯編 圖形

    上傳時(shí)間: 2013-12-20

    上傳用戶:lyy1234

  • 本例展示了如何利用外設(shè)TIM2來(lái)產(chǎn)生四路頻率不同的信號(hào)。 TIM2時(shí)鐘設(shè)置為36MHz

    本例展示了如何利用外設(shè)TIM2來(lái)產(chǎn)生四路頻率不同的信號(hào)。 TIM2時(shí)鐘設(shè)置為36MHz,預(yù)分頻設(shè)置為2,使用輸出比較-翻轉(zhuǎn)模式(Output Compare Toggle Mode)。 TIM2計(jì)數(shù)器時(shí)鐘可表達(dá)為:TIM2 counter CLOCK = TIMxCLK / (Prescaler +1) = 12 MHz 設(shè)置TIM2_CCR1寄存器值為32768,則CC1更新頻率為TIM2計(jì)數(shù)器時(shí)鐘頻率除以CCR1寄存器值,為366.2 Hz。因此,TIM2通道1可產(chǎn)生一個(gè)頻率為183.1 Hz的周期信號(hào)。 同理,根據(jù)寄存器TIM2_CCR2 、TIM2_CCR3和 TIM2_CCR4的值,TIM2通道2可產(chǎn)生一個(gè)頻率為366.3 Hz的周期信號(hào);TIM2通道3可產(chǎn)生一個(gè)頻率為732.4 Hz的周期信號(hào);TIM2通道4可產(chǎn)生一個(gè)頻率為1464.8 Hz的周期信號(hào)。 可以通過(guò)示波器觀察各路輸出

    標(biāo)簽: TIM2 MHz 36 如何利用

    上傳時(shí)間: 2014-01-22

    上傳用戶:plsee

  • 本例展示了如何設(shè)置TIM工作在輸出比較-非主動(dòng)模式(Output Compare Inactive mode)

    本例展示了如何設(shè)置TIM工作在輸出比較-非主動(dòng)模式(Output Compare Inactive mode),并產(chǎn)生相應(yīng)的中斷。 TIM2時(shí)鐘設(shè)置為36MHz,預(yù)分頻設(shè)置為35999,TIM2計(jì)數(shù)器時(shí)鐘可表達(dá)為: TIM2 counter CLOCK = TIMxCLK / (Prescaler +1) = 1 KHz 設(shè)置TIM2_CCR1寄存器值為1000, CCR1寄存器值1000除以TIM2計(jì)數(shù)器時(shí)鐘頻率1KHz,為1000毫秒。因此,經(jīng)過(guò)1000毫秒的時(shí)延,置PC.06輸出為低電平。 同理,根據(jù)寄存器TIM2_CCR2 、TIM2_CCR3和 TIM2_CCR4的值,經(jīng)過(guò)500毫秒的時(shí)延,置PC.07輸出為低電平;經(jīng)過(guò)250毫秒的時(shí)延,置PC.08輸出為低電平;經(jīng)過(guò)125毫秒的時(shí)延,置PC.09輸出為低電平。 輸出比較寄存器的值決定時(shí)延的大小,當(dāng)計(jì)數(shù)器的值小于這個(gè)值的時(shí)候,點(diǎn)亮與PC.06-PC.09相連的LED;當(dāng)計(jì)數(shù)器的值達(dá)到這個(gè)值得時(shí)候,產(chǎn)生中斷,在TIM2的4個(gè)通道相應(yīng)的中斷里,把它們一一關(guān)閉。

    標(biāo)簽: Inactive Compare Output mode

    上傳時(shí)間: 2013-12-20

    上傳用戶:ghostparker

  • 虛擬I2C總線匯編程序軟件包 I2C 軟件包的底層子程序

    虛擬I2C總線匯編程序軟件包 I2C 軟件包的底層子程序,使用前要定義好SCL和SDA。在標(biāo)準(zhǔn)80C51模式(12 CLOCK)下,對(duì)主頻要求是不高于12MHz(1個(gè)機(jī)器周期1us)若Fosc>12MHz,則要增加相應(yīng)的NOP指令數(shù)。在使用本軟件包時(shí),請(qǐng)?jiān)谀愕某绦虻奈次布尤?INCLUDE (VI2C_ASM.ASM)即可。

    標(biāo)簽: I2C 軟件包 虛擬 總線

    上傳時(shí)間: 2014-12-01

    上傳用戶:yimoney

  • MCS-51單片機(jī)模擬I2C軟件包本模擬I2C軟件包包含了I2C操作的底層子程序

    MCS-51單片機(jī)模擬I2C軟件包本模擬I2C軟件包包含了I2C操作的底層子程序,使用前要定義 好SCL和SDA。在標(biāo)準(zhǔn)8051模式(12 CLOCK)下,對(duì)主頻要求是不高于12MHz(即1個(gè) 機(jī)器周期1us) 若Fosc>12MHz則要增加相應(yīng)的NOP指令數(shù)。(總線時(shí)序符合I2C標(biāo) 準(zhǔn)模式,100Kbit/S)

    標(biāo)簽: I2C MCS 模擬 軟件包

    上傳時(shí)間: 2014-11-04

    上傳用戶:wang5829

  • This is GPS in matlab calculatePseudoranges finds relative pseudoranges for all satellites listed

    This is GPS in matlab calculatePseudoranges finds relative pseudoranges for all satellites listed in CHANNELLIST at the specified millisecond of the processed signal. The pseudoranges contain unknown receiver CLOCK offset. It can be found by the least squares position search procedure.

    標(biāo)簽: calculatePseudoranges pseudoranges satellites relative

    上傳時(shí)間: 2017-03-09

    上傳用戶:時(shí)代電子小智

  • Enhanced version of the Serial Peripheral Interface available on Motorola s MC68HC11 family of CPUs.

    Enhanced version of the Serial Peripheral Interface available on Motorola s MC68HC11 family of CPUs.Enhancements include a wider supported operating frequency range, 4deep read and write fifos, and programmable transfer count dependent interrupt generation. As with the SPI found in MC68HC11 processors the core features programmable CLOCK phase [CPHA] and CLOCK polarity [CPOL]. The core features an 8bit wishbone interface. Very simple, very small.

    標(biāo)簽: Peripheral Interface available Enhanced

    上傳時(shí)間: 2014-12-06

    上傳用戶:invtnewer

  • Decimal counter which is counting from 256 to 0. After that there will appear logic "1" in out. You

    Decimal counter which is counting from 256 to 0. After that there will appear logic "1" in out. You can stop counting by pressing sequence. I called it detonation CLOCK :]

    標(biāo)簽: counting Decimal counter appear

    上傳時(shí)間: 2014-10-13

    上傳用戶:731140412

  • TLC548和TLC549是以8位開(kāi)關(guān)電容逐次逼近A/D轉(zhuǎn)換器為基礎(chǔ)而構(gòu)造的CMOS A/D轉(zhuǎn)換器。它們?cè)O(shè) 計(jì)成能通過(guò)3態(tài)數(shù)據(jù)輸出和模擬輸入與微處理器或外圍設(shè)備串行接口。TLC548和TLC549僅

    TLC548和TLC549是以8位開(kāi)關(guān)電容逐次逼近A/D轉(zhuǎn)換器為基礎(chǔ)而構(gòu)造的CMOS A/D轉(zhuǎn)換器。它們?cè)O(shè) 計(jì)成能通過(guò)3態(tài)數(shù)據(jù)輸出和模擬輸入與微處理器或外圍設(shè)備串行接口。TLC548和TLC549僅用輸入/輸出時(shí) 鐘(I/O CLOCK) 和芯片選擇(CS) 輸入作數(shù)據(jù)控制。TLC548的最高I/O CLOCK輸入頻率為2.048MHz, 而TLC549的I/O CLOCK輸入頻率最高可達(dá)1.1MHz。 有關(guān)與大多數(shù)通用微處理器接口的詳細(xì)資料已由工廠 準(zhǔn)備好,可供使用。

    標(biāo)簽: TLC 548 549 CMOS

    上傳時(shí)間: 2013-11-28

    上傳用戶:aig85

  • This example sets up the PLL in x10/2 mode, divides SYSCLKOUT by six to reach a 25Mhz HSPCLK (assumi

    This example sets up the PLL in x10/2 mode, divides SYSCLKOUT by six to reach a 25Mhz HSPCLK (assuming a 30Mhz XCLKIN). The CLOCK divider in the ADC is not used so that the ADC will see the 25Mhz on the HSPCLK. Interrupts are enabled and the EVA is setup to generate a periodic ADC SOC on SEQ1. Two channels are converted, ADCINA3 and ADCINA2.

    標(biāo)簽: SYSCLKOUT example divides HSPCLK

    上傳時(shí)間: 2014-01-25

    上傳用戶:ljt101007

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