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  • LTC1099半閃速8位AD轉(zhuǎn)換數(shù)字光電二極管陣列

    This application note describes a Linear Technology "Half-Flash" A/D converter, the LTC1099, being connected to a 256 element line scan photodiode array. This technology adapts itself to handheld (i.e., low power) bar code readers, as well as high resolution automated machine inspection applications..  

    標(biāo)簽: 1099 LTC 8位 AD轉(zhuǎn)換

    上傳時(shí)間: 2013-11-21

    上傳用戶:lchjng

  • LTC1062的低通濾波器應(yīng)用

    Highlights the LTC1062 as a lowpass filter in a phase lock loop. Describes how the loop's bandwidth can be increased and the VCO output jitter reduced when the LTC1062 is the loop filter. Compares it with a passive RC loop filter. Also discussed is the use of LTC1062 as simple bandpass and bandstop filter.

    標(biāo)簽: 1062 LTC 低通濾波器

    上傳時(shí)間: 2013-10-24

    上傳用戶:chens000

  • 新型精密運(yùn)算放大器應(yīng)用

    Application considerations and circuits for the LT1001 and LT1002 single and dual precision amplifiers are illustrated in a number of circuits, including strain gauge signal conditioners, linearized platinum RTD circuits, an ultra precision dead zone circuit for motor servos and other examples.

    標(biāo)簽: 精密 運(yùn)算放大器

    上傳時(shí)間: 2013-10-18

    上傳用戶:dreamboy36

  • 一種DDS任意波形發(fā)生器的ROM優(yōu)化方法

    提出了一種改進(jìn)的基于直接頻率合成技術(shù)(DDS)的任意波形發(fā)生器在現(xiàn)場(chǎng)可編程門陣列(FPGA)上的實(shí)現(xiàn)方法。首先將三角波、正弦波、方波和升/降鋸齒波的波形數(shù)據(jù)寫入片外存儲(chǔ)器,當(dāng)調(diào)用時(shí)再將相應(yīng)的數(shù)據(jù)移入FPGA的片上RAM,取代分區(qū)塊的將所有類型波形數(shù)據(jù)同時(shí)存儲(chǔ)在片上RAM中的傳統(tǒng)方法;再利用正弦波和三角波的波形在4個(gè)象限的對(duì)稱性以及鋸齒波的線性特性,通過(guò)硬件反相器對(duì)波形數(shù)據(jù)和尋址地址值進(jìn)行處理,實(shí)現(xiàn)了以1/4的數(shù)據(jù)量還原出精度不變的模擬信號(hào),從而將整體的存儲(chǔ)量減小為原始設(shè)計(jì)方案的5%。經(jīng)驗(yàn)證,這種改進(jìn)方法正確可行,能夠大大降低開發(fā)成本。

    標(biāo)簽: DDS ROM 任意波形發(fā)生器

    上傳時(shí)間: 2013-12-25

    上傳用戶:日光微瀾

  • 超高頻窄帶單級(jí)低噪聲放大器的設(shè)計(jì)

    文中介紹了一款超高頻窄帶低噪聲放大器電路,該電路結(jié)構(gòu)小巧(20 mm ×13 mm ,厚度為0.6 mm),功能可靠、穩(wěn)定。放大器芯片采用3SK318YB,該芯片具有高增益、低噪聲等特點(diǎn)。電路主要用于超高頻段微波通信,電路拓?fù)浣Y(jié)構(gòu)采用反饋型、穩(wěn)定衰減器法和低端增益衰減法進(jìn)行設(shè)計(jì)。生產(chǎn)成品并經(jīng)測(cè)試,該產(chǎn)品性價(jià)比高,完全達(dá)到了設(shè)計(jì)要求

    標(biāo)簽: 超高頻 窄帶 低噪聲放大器

    上傳時(shí)間: 2013-11-03

    上傳用戶:xja31415

  • 基于選擇進(jìn)位32位加法器的硬件電路實(shí)現(xiàn)

    為了縮短加法電路運(yùn)行時(shí)間,提高FPGA運(yùn)行效率,利用選擇進(jìn)位算法和差額分組算法用硬件電路實(shí)現(xiàn)32位加法器,差額分組中的加法單元是利用一種改進(jìn)的超前進(jìn)位算法實(shí)現(xiàn),選擇進(jìn)位算法可使不同的分組單元并行運(yùn)算,利用低位的運(yùn)算結(jié)果選擇高位的進(jìn)位為1或者進(jìn)位為零的運(yùn)算結(jié)果,節(jié)省了進(jìn)位選擇等待的時(shí)間,最后利用XILINX進(jìn)行時(shí)序仿真,在FPGA上進(jìn)行驗(yàn)證,可穩(wěn)定運(yùn)行在高達(dá)50兆的頻率,理論分析與計(jì)算機(jī)仿真表明該算法切實(shí)可行、有效并且易于實(shí)現(xiàn)。

    標(biāo)簽: 進(jìn)位 加法器 硬件 電路實(shí)現(xiàn)

    上傳時(shí)間: 2013-12-19

    上傳用戶:jshailingzzh

  • 基于云計(jì)算的冷鏈物流配送車輛路徑優(yōu)化方法研究

    針對(duì)冷鏈物流配送車輛路徑優(yōu)化問(wèn)題,分析云計(jì)算模式下處理配送車輛實(shí)時(shí)路徑的優(yōu)勢(shì),建立了冷鏈物流配送車輛路徑優(yōu)化應(yīng)用服務(wù)架構(gòu);并在該架構(gòu)下獲取多源實(shí)時(shí)交通信息,分析車輛配送時(shí)間和綜合成本,構(gòu)建了冷鏈物流配送車輛路徑優(yōu)化模型,并在云計(jì)算環(huán)境下利用粗粒度并行遺傳算法對(duì)模型進(jìn)行求解,實(shí)驗(yàn)結(jié)果表明云計(jì)算環(huán)境下冷藏車輛實(shí)時(shí)路徑優(yōu)化方法是有效的,該方法對(duì)冷鏈物流配送成本實(shí)現(xiàn)精細(xì)化控制,提高配送服務(wù)效率,具有實(shí)際意義。

    標(biāo)簽: 云計(jì)算 物流配送 方法研究 車輛路徑

    上傳時(shí)間: 2013-10-08

    上傳用戶:peterli123456

  • 對(duì)OC門的研究及其應(yīng)用

    為了讓讀者確實(shí)理解TTL與非門與OC門的區(qū)別,熟練地掌握OC門的應(yīng)用,通過(guò)對(duì)TTL與非門的分析,和對(duì)其弊端的指出,說(shuō)明研制OC門的理由,總結(jié)了OC門上拉電阻的作用和計(jì)算方法,對(duì)OC門上拉電阻的計(jì)算方法有立新的說(shuō)明,總結(jié)了OC門的所有優(yōu)點(diǎn)。

    標(biāo)簽:

    上傳時(shí)間: 2013-10-10

    上傳用戶:yy_cn

  • 有源濾波器建模與控制策略研究

    合理利用有效的控制策略提高有源濾波器的本身的補(bǔ)償性能越來(lái)越成為各國(guó)學(xué)者研究重點(diǎn)。本文從有源濾波器的數(shù)學(xué)模型出發(fā),詳述有源濾波器的數(shù)學(xué)建模過(guò)程。并且針對(duì)諧波電流的檢測(cè)需要較高的準(zhǔn)確度和較好的實(shí)時(shí)性以及有源濾波器工作時(shí)的非線性與不確定性的特點(diǎn),基于瞬時(shí)無(wú)功功率補(bǔ)償法的諧波電流檢測(cè)方法。有效的計(jì)算出電網(wǎng)中諧波電流、無(wú)功以及負(fù)序電流。并根據(jù)該算法的特點(diǎn),將實(shí)時(shí)檢測(cè)出的畸變電流通過(guò)控制算法,研制的有源濾波器可對(duì)不對(duì)稱三相負(fù)載起到平衡作用。在MATLAB/simulink平臺(tái)下搭建仿真模型,與傳統(tǒng)的有源濾波器進(jìn)行對(duì)比,仿真結(jié)果表明這種有源濾波器能夠更加迅速、精確的補(bǔ)償諧波電流。

    標(biāo)簽: 有源濾波器 建模 控制策略

    上傳時(shí)間: 2013-10-10

    上傳用戶:風(fēng)行天下

  • HDL的可綜合設(shè)計(jì)簡(jiǎn)介

    本文簡(jiǎn)單探討了verilog HDL設(shè)計(jì)中的可綜合性問(wèn)題,適合HDL初學(xué)者閱讀     用組合邏輯實(shí)現(xiàn)的電路和用時(shí)序邏輯實(shí)現(xiàn)的   電路要分配到不同的進(jìn)程中。   不要使用枚舉類型的屬性。   Integer應(yīng)加范圍限制。    通常的可綜合代碼應(yīng)該是同步設(shè)計(jì)。   避免門級(jí)描述,除非在關(guān)鍵路徑中。

    標(biāo)簽: HDL 綜合設(shè)計(jì)

    上傳時(shí)間: 2013-10-21

    上傳用戶:smallfish

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