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FIFO

FirstInputFirstOutput的縮寫，先入先出隊(duì)列，這是一種傳統(tǒng)的按序執(zhí)行方法，先進(jìn)入的指令先完成并引退，跟著才執(zhí)行第二條指令。

system verilog FIFO env

system verilog FIFO env

標(biāo)簽： verilog system FIFO env

上傳時(shí)間： 2013-12-26

上傳用戶：685
FX2Pipe is a small high speed USB transfer program which can pipe stdin into the FX2 FIFO or back fr

FX2Pipe is a small high speed USB transfer program which can pipe stdin into the FX2 FIFO or back from the FIFO to stdout.

標(biāo)簽： transfer FX2Pipe program small

上傳時(shí)間： 2017-06-11

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是深度為7的FIFO

是深度為7的FIFO

標(biāo)簽： FIFO

上傳時(shí)間： 2017-06-15

上傳用戶：小寶愛考拉
FIFO的verilog描述

FIFO的verilog描述

標(biāo)簽： verilog FIFO

上傳時(shí)間： 2013-12-01

上傳用戶：llandlu
FIFO算法,FIFO算法

FIFO算法,FIFO算法，FIFO算法，FIFO算法，FIFO算法，FIFO算法

標(biāo)簽： FIFO 算法

上傳時(shí)間： 2017-06-16

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包含幾個(gè)用不同方式（共享內(nèi)存、socket、FIFO、消息隊(duì)列等）實(shí)現(xiàn)進(jìn)程通信的小程序

包含幾個(gè)用不同方式（共享內(nèi)存、socket、FIFO、消息隊(duì)列等）實(shí)現(xiàn)進(jìn)程通信的小程序，包含詳細(xì)注釋，足以解釋各種方式進(jìn)程通信的實(shí)現(xiàn)原理和編程方法

標(biāo)簽： socket FIFO 方式共享內(nèi)存

上傳時(shí)間： 2013-12-15

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異步FIFO的設(shè)計(jì) 包括testbench 已調(diào)試成功

異步FIFO的設(shè)計(jì) 包括testbench 已調(diào)試成功

標(biāo)簽： testbench FIFO 調(diào)試

上傳時(shí)間： 2014-01-05

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先進(jìn)先出存儲(chǔ)電路FIFO

先進(jìn)先出存儲(chǔ)電路FIFO，實(shí)現(xiàn)隊(duì)列存儲(chǔ)結(jié)構(gòu)

標(biāo)簽： FIFO 存儲(chǔ)電路

上傳時(shí)間： 2014-11-01

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UART realization for at89c5131 with FIFO and interrupts.

UART realization for at89c5131 with FIFO and interrupts.

標(biāo)簽： realization interrupts c5131 UART

上傳時(shí)間： 2017-06-18

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This paper will discuss the design of an asynchronous FIFO,Asynchronous FIFOs are widely used in the

This paper will discuss the design of an asynchronous FIFO,Asynchronous FIFOs are widely used in the computer networking industry to receive data at a particular frequency and transmit them at another frequency. An asynchronous FIFO has two different clocks: one for read and one for write.

標(biāo)簽： Asynchronous asynchronous the discuss

上傳時(shí)間： 2013-12-09

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FIFO

system verilog FIFO env

FX2Pipe is a small high speed USB transfer program which can pipe stdin into the FX2 FIFO or back fr

是深度為7的FIFO

FIFO的verilog描述

FIFO算法,FIFO算法

包含幾個(gè)用不同方式（共享內(nèi)存、socket、FIFO、消息隊(duì)列等）實(shí)現(xiàn)進(jìn)程通信的小程序

異步FIFO的設(shè)計(jì) 包括testbench 已調(diào)試成功

先進(jìn)先出存儲(chǔ)電路FIFO

UART realization for at89c5131 with FIFO and interrupts.

This paper will discuss the design of an asynchronous FIFO,Asynchronous FIFOs are widely used in the