用VHDL語(yǔ)言在CPLD/FPGA上實(shí)現(xiàn)浮點(diǎn)運(yùn)算的方法
標(biāo)簽: VHDL CPLD FPGA 語(yǔ)言
上傳時(shí)間: 2015-04-27
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USB控制器VHDL程(usb_xilinx_vhdl),用XILINX公司的FPGA實(shí)現(xiàn)
標(biāo)簽: usb_xilinx_vhdl XILINX FPGA VHDL
上傳時(shí)間: 2013-12-19
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用verilog語(yǔ)言在fpga中實(shí)現(xiàn)fifo功能!
標(biāo)簽: verilog fpga fifo 語(yǔ)言
上傳時(shí)間: 2015-05-02
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用vhdl編寫的基于fpga的數(shù)字頻率計(jì)程序算法
標(biāo)簽: vhdl fpga 編寫 數(shù)字頻率計(jì)
上傳時(shí)間: 2015-05-03
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用8031加載ALtera的FPGA,也可用于Xilinx的FPGA的加載
標(biāo)簽: ALtera 8031 FPGA
上傳時(shí)間: 2014-12-08
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viterbi譯碼器的一種fpga實(shí)現(xiàn).是一個(gè)cs252 的project的result 供大家研究用
標(biāo)簽: viterbi project result fpga
上傳時(shí)間: 2013-12-16
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在公司做的一個(gè)用FPGA實(shí)現(xiàn)的數(shù)字電視系統(tǒng)中 ASI轉(zhuǎn)TS流的程序
標(biāo)簽: FPGA ASI 數(shù)字電視 TS流
上傳時(shí)間: 2015-05-14
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用四階(定步長(zhǎng))龍格--庫(kù)塔法求解初值問題,其中一階微分方程未y =f(x,y)
標(biāo)簽: 初值
上傳時(shí)間: 2013-12-08
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用改進(jìn)的歐拉方法求解初值問題,其中一階微分方程未y =f(x,y)
上傳時(shí)間: 2013-12-17
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最近去看監(jiān)視器材,看到他們的監(jiān)視軟體 就突發(fā)奇想自己來寫一個(gè)看看 程式會(huì)把移動(dòng)中的物體用綠色框框起來 並且把當(dāng)時(shí)的影像存成jpg檔(我把這個(gè)功能註解起來了) 我這個(gè)程式是在UltraEdit(類似記事本)下寫成的 程式裡用到JMF套件 主程式是webcamCapture.java
標(biāo)簽: Ultr jpg 程式 器材
上傳時(shí)間: 2015-05-22
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