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這是一本介紹如何高效編寫fpga，\r\n用少量的資源完成復扎的結構，\r\n很不錯，也很詳細，可以說很經典。
標簽： fpga 編寫 代碼
上傳時間： 2013-09-01
上傳用戶：清山綠水
FPGA原理設計與應用，請用dgreader free.exe打開
標簽： FPGA
上傳用戶：gps6888
基于FPGA測控系統研究論文，內容相當不錯，解壓后格式為nh用CAJViewer打開
標簽： FPGA 測控 系統研究 論文
上傳用戶：蔣清華嗯
關于用CPLD和FPGA做插補算法的內容,對于想用FPGA做控制的朋友是個好的借鑒!
標簽： FPGA CPLD 插補算法 控制
上傳時間： 2013-09-02
上傳用戶：taox
這是我用vhdl語言，在fpga內部做了一個雙口ram的程序。我的郵箱：wleechina@163.com
標簽： vhdl 語言
上傳用戶：jhksyghr
一個基于FPGA的串口程序,已經經過驗證,對用FPGA做串口的朋友提供參考和借鑒!
標簽： FPGA 串口程序
上傳用戶：a82531317
用CADENCE做VHDL語言實驗的教程
標簽： CADENCE VHDL 語言實驗 教程
上傳時間： 2013-09-04
上傳用戶：wangchong
無淪是用離散邏輯、可編程邏輯，還是用全定制硅器件實現的任何數字設計，為了成功地操\r\n作，可靠的時鐘是非常關鍵的。設計不良的時鐘在極限的溫度、電壓或制造工藝的偏差情況下將\r\n導致錯誤的行為，并且調試困難、花銷很大。 在設計PLD/FPGA時通常采用幾種時鐘類型。時鐘可\r\n分為如下四種類型：全局時鐘、門控時鐘、多級邏輯時鐘和波動式時鐘。多時鐘系統能夠包括上\r\n述四種時鐘類型的任意組合。
標簽： FPGA PLD 時鐘
上傳用戶：yelong0614
1、 利用FLEX10的片內RAM資源，根據DDS原理，設計產生正弦信號的各功能模塊和頂層原理圖； 2、 利用實驗板上的TLC7259轉換器，將1中得到的正弦信號，通過D/A轉換，通過ME5534濾波后在示波器上觀察； 3、 輸出波形要求： 在輸入時鐘頻率為16KHz時，輸出正弦波分辨率達到1Hz； 在輸入時鐘頻率為4MHz時，輸出正弦波分辨率達到256Hz； 4、 通過RS232C通信，實現FPGA和PC機之間串行通信，從而實現用PC機改變頻率控制字，實現對輸出正弦波頻率的控制。
標簽： FPGA PC機 串行通信 輸出
上傳時間： 2013-09-06
上傳用戶：zhuimenghuadie
viterbi譯碼器的一種fpga實現.是一個cs252\r\n的project的result\r\n供大家研究用
標簽： viterbi fpga 譯碼器
上傳用戶：dsgkjgkjg
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