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FPGA EDK

  • PLD、FPGA優秀設計的十條戒律

    PLD、FPGA優秀設計的十條戒律, 該文淺顯易懂的介紹了一個優秀設計必須考慮的問題,給出了設計方法和建議。仔細閱讀和消化本文,對提高PLD/FPGA設計水平大有裨益

    標簽: FPGA PLD

    上傳時間: 2013-11-23

    上傳用戶:tsfh

  • WP312 - 賽靈思新一代28nm FPGA技術概覽

        賽靈思選用 28nm 高介電層金屬閘 (HKMG) 高性能低 功耗技術,并將該技術與新型一體化 ASMBLTM 架構相結合,從而推出能降低功耗、提高性能的新一代FPGA。這些器件實現了前所未有的高集成度和高帶寬,為系統架構師和設計人員提供了一種可替代 ASSP和 ASIC 的全面可編程解決方案。

    標簽: FPGA 312 WP 28

    上傳時間: 2013-10-10

    上傳用戶:TF2015

  • FPGA設計重利用方法(Design Reuse Methodology)

      FPGAs have changed dramatically since Xilinx first introduced them just 15 years ago. In thepast, FPGA were primarily used for prototyping and lower volume applications; custom ASICswere used for high volume, cost sensitive designs. FPGAs had also been too expensive and tooslow for many applications, let alone for System Level Integration (SLI). Plus, the development

    標簽: Methodology Design Reuse FPGA

    上傳時間: 2013-10-23

    上傳用戶:旗魚旗魚

  • XAPP520將符合2.5V和3.3V I/O標準的7系列FPGA高性能I/O Bank進行連接

    XAPP520將符合2.5V和3.3V I/O標準的7系列FPGA高性能I/O Bank進行連接  The I/Os in Xilinx® 7 series FPGAs are classified as either high range (HR) or high performance (HP) banks. HR I/O banks can be operated from 1.2V to 3.3V, whereas HP I/O banks are optimized for operation between 1.2V and 1.8V. In circumstances that require an HP 1.8V I/O bank to interface with 2.5V or 3.3V logic, a range of options can be deployed. This application note describes methodologies for interfacing 7 series HP I/O banks with 2.5V and 3.3V systems

    標簽: XAPP FPGA Bank 520

    上傳時間: 2013-11-19

    上傳用戶:yyyyyyyyyy

  • WP409利用Xilinx FPGA打造出高端比特精度和周期精度浮點DSP算法實現方案

    WP409利用Xilinx FPGA打造出高端比特精度和周期精度浮點DSP算法實現方案: High-Level Implementation of Bit- and Cycle-Accurate Floating-Point DSP Algorithms with Xilinx FPGAs

    標簽: Xilinx FPGA 409 DSP

    上傳時間: 2013-11-07

    上傳用戶:defghi010

  • WP373-賽靈思推出Virtex-7,Kintex-7,Artix-7三大全新系列FPGA

        賽靈思推出的三款全新產品系列不僅發揮了臺積電28nm 高介電層金屬閘 (HKMG) 高性能低功耗 (HPL) 工藝技術前所未有的功耗、性能和容量優勢,而且還充分利用 FPGA 業界首款統一芯片架構無與倫比的可擴展性,為新一代系統提供了綜合而全面的平臺基礎。目前,隨著賽靈思 7 系列 (Virtex®-7、Kintex™-7 和Artix™-7 系列) 的推出,賽靈思將系統功耗、性價比和容量推到了全新的水平,這在很大程度上要歸功于臺積電 28nm HKMG 工藝出色的性價比優勢以及芯片和軟件層面上的設計創新。結合業經驗證的 EasyPath™成本降低技術,上述新系列產品將為新一代系統設計人員帶來無與倫比的價值

    標簽: Virtex Kintex Artix FPGA

    上傳時間: 2013-11-15

    上傳用戶:chenhr

  • WWP248 - 移植到Virtex-5 FPGA的指南

      由于Virtex-5 器件的基礎架構與以往的FPGA 器件不同,因此,要為特定設計選擇合適的Virtex-5 器件并非易事。大多數情況下,設計應采用類似的陣列大小(器件數量)并且比以前的目標器件至少低一個速度級別(如從中速級別到慢速級別)。但是,這種建議對于有些情況卻并不適用。本節將介紹一些會影響Virtex-5 FPGA 器件選擇標準的設計風格和特征。

    標簽: Virtex FPGA WWP 248

    上傳時間: 2013-10-18

    上傳用戶:yuyizhixia

  • 大規模FPGA設計中的多點綜合技術

      本文介紹了在大規模FPGA設計中可以提高綜合效率和效果的多點綜合技術,本文適合大規模FPGA的設計者和Synplify pro的用戶閱讀。  

    標簽: FPGA 大規模 多點

    上傳時間: 2013-11-23

    上傳用戶:lbbyxmraon

  • ETL-002 Altera Cyclone III系列FPGA開發板簡介

    ETL-002 FPGA開發板是以Altera公司的最新系列Cyclone III中的3C10為主芯片,并提供了極為豐富的芯片外圍接口資源以及下載線,數據線以及資料光盤等。除了這些硬件外,我們還提供了十多個接口實驗,并公開了電路原理圖和實驗的Verilog源代碼,以便于大家對照學習,并可以在該開發板上進行二次開發。

    標簽: Cyclone Altera FPGA ETL

    上傳時間: 2013-10-29

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  • 電子工程師創新設計必備寶典之FPGA開發全攻略

    2008年,我參加了幾次可編程器件供應商舉辦的技術研討會,讓我留下深刻印象的是參加這些研討會的工程師人數之多,簡直可以用爆滿來形容,很多工程師聚精會神地全天聽講,很少出現吃完午飯就閃人的現象,而且工程師們對研討會上展出的基于可編程器件的通信、消費電子、醫療電子、工業等解決方案也有濃厚的興趣,這和其他器件研討會形成了鮮明的對比。 Garnter和iSuppli公布的數據顯示:2008年,全球半導體整體銷售出現25年以來首次萎縮現象,但是,可編程器件卻還在保持了增長,預計2008年可編程邏輯器件(PLD)市場銷售額增長7.6%,可編程器件的領頭羊美國供應商賽靈思公司2008年營業收入預計升6.5%!在全球經濟危機的背景下,這是非常驕人的業績!也足見可編程器件在應用領域的熱度沒有受到經濟危機的影響!這可能也解釋了為什么那么多工程師對可編程器件感興趣吧。 在與工程師的交流中,我發現,很多工程師非常需要普及以FPGA為代表的可編程器件的應用開發知識,也有很多工程師苦于進階無門,缺乏專業、權威性的指導,在Google上搜索后,我發現很少有幫助工程師設計的FPGA電子書,即使有也只是介紹一些概念性的基礎知識,缺乏實用性和系統性,于是,我萌生了出版一本指導工程師FPGA應用開發電子書的想法,而且這個電子書要突出實用性,讓大家都可以免費下載,并提供許多技巧和資源信息,很高興美國賽靈思公司對這個想法給予了大力支持,賽靈思公司亞太區市場經理張俊偉小姐和高級產品經理梁曉明先生對電子書提出了寶貴的意見,并提供了大量FPGA設計資源,也介紹了一些FPGA設計高手參與了電子書的編撰,很短的時間內,一個電子書項目團隊組建起來,北京郵電大學的研究生田耘先生和賽靈思公司上海辦事處的蘇同麒先生等人都參與了電子書的編寫,他們是有豐富設計經驗的高手,在大家的共同努力下,這本凝結著智慧的FPGA電子書終于和大家見面了!我希望這本電子書可以成為對FPGA有興趣或正在使用FPGA進行開發的工程師的手頭設計寶典之一,也希望這個電子書可以對工程師們學習FPGA開發和進階有實用的幫助!如果可能,未來我們還將出版后續版本!

    標簽: FPGA 電子工程師 創新設計 寶典

    上傳時間: 2013-10-21

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