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II軟核

  • 基于FPGA的多通道DMA控制器的IP核設(shè)計(jì).rar

    當(dāng)前,隨著電子技術(shù)的飛速發(fā)展,智能化系統(tǒng)中需要傳輸?shù)臄?shù)據(jù)量日益增大,要求數(shù)據(jù)傳送的速度也越來越快,傳統(tǒng)的數(shù)據(jù)傳輸方式已無法滿足目前的要求。在此前提下,采用高速數(shù)據(jù)傳輸技術(shù)成為必然,DMA(直接存儲器訪問)技術(shù)就是較理想的解決方案之一,能夠滿足信息處理實(shí)時性和準(zhǔn)確性的要求。 本文以EDA工具、硬件描述語言和可編程邏輯器件(FPGA)為技術(shù)支撐,設(shè)計(jì)DMA控制器的總體結(jié)構(gòu)。在通道檢測模塊中,解決了信號抗干擾和請求信號撤銷問題,并提出并行通道檢測算法;在優(yōu)先級管理模塊中提出了動態(tài)優(yōu)先級端口響應(yīng)機(jī)制;在傳輸模塊中采用狀態(tài)機(jī)的設(shè)計(jì)思想設(shè)計(jì)多個通道的數(shù)據(jù)傳輸。通過各模塊問題的解決及新方法的采用,最終設(shè)計(jì)出基于FPGA的多通道DMA控制器的IP軟核。實(shí)驗(yàn)仿真結(jié)果表明,本控制器傳輸速度較快,主頻達(dá)100MHz以上,且工作穩(wěn)定。

    標(biāo)簽: FPGA DMA 多通道

    上傳時間: 2013-05-16

    上傳用戶:希醬大魔王

  • 基于FPGA的8051單片機(jī)IP核設(shè)計(jì)及應(yīng)用.rar

    單片微型計(jì)算機(jī)(單片機(jī))是將微處理器CPU、程序存儲器、數(shù)據(jù)存儲器、定時/計(jì)數(shù)器、輸入/輸出并行接口等集成在一起。由于單片機(jī)具有專門為嵌入式系統(tǒng)設(shè)計(jì)的體系結(jié)構(gòu)與指令系統(tǒng),所以它最能滿足嵌入式系統(tǒng)的應(yīng)用要求。Intel公司生產(chǎn)的MCS-51系列單片機(jī)是我國目前應(yīng)用最廣的單片機(jī)之一。 隨著可編程邏輯器件設(shè)計(jì)技術(shù)的發(fā)展,每個邏輯器件中門電路的數(shù)量越來越多,一個邏輯器件就可以完成本來要由很多分立邏輯器件和存儲芯片完成的功能。這樣做減少了系統(tǒng)的功耗和成本,提高了性能和可靠性。FPGA就是目前最受歡迎的可編程邏輯器件之一。IP核是將一些在數(shù)字電路中常用但比較復(fù)雜的功能塊,設(shè)計(jì)成可修改參數(shù)的模塊,讓其他用戶可以直接調(diào)用這些模塊,這樣就大大減輕了工程師的負(fù)擔(dān),避免重復(fù)勞動。隨著FPGA的規(guī)模越來越大,設(shè)計(jì)越來越復(fù)雜,使用IP核是一個發(fā)展趨勢。 本課題結(jié)合FPGA與8051單片機(jī)的優(yōu)點(diǎn),主要針對以下三個方面研究: (1)FPGA開發(fā)平臺的硬件實(shí)現(xiàn)選用Xilinx公司的XC3S500E-PQ208-4-C作為核心器件,采用Intel公司的EEPROM芯片2816A和SRAM芯片6116作為片內(nèi)程序存儲器,搭建FPGA的硬件開發(fā)平臺。 (2)用VHDL語言實(shí)現(xiàn)8051IP核分析研究8051系列單片機(jī)內(nèi)部各模塊結(jié)構(gòu)以及各部分的連接關(guān)系,實(shí)現(xiàn)了基于FPGA的8051IP核。主要包括如下幾個模塊:CPU模塊、片內(nèi)數(shù)據(jù)存儲器模塊、定時/計(jì)數(shù)器模塊、并行端口模塊、串行端口模塊、中斷處理模塊、同步復(fù)位模塊等。 (3)基于FPGA的8051IP核應(yīng)用用所設(shè)計(jì)的8051IP核,實(shí)現(xiàn)了對一個4×4鍵盤的監(jiān)測掃描、鍵盤確認(rèn)、按鍵識別等應(yīng)用。

    標(biāo)簽: FPGA 8051 單片機(jī)

    上傳時間: 2013-06-21

    上傳用戶:stampede

  • 基于FPGA的JPEG壓縮編碼的研究與實(shí)現(xiàn).rar

    隨著移動終端、多媒體、通信、圖像掃描技術(shù)的發(fā)展,圖像應(yīng)用日益廣泛,壓縮編碼技術(shù)對圖像處理中大量數(shù)據(jù)的存儲和傳輸至關(guān)重要。同時, FPGA單片規(guī)模的不斷擴(kuò)大,在FPGA芯片內(nèi)實(shí)現(xiàn)復(fù)雜的數(shù)字信號處理系統(tǒng)也成為現(xiàn)實(shí),因此采用FPGA實(shí)現(xiàn)圖像壓縮已成為一種必然趨勢。JPEG靜態(tài)圖像壓縮標(biāo)準(zhǔn)應(yīng)用非常廣泛,是圖像壓縮中主要的標(biāo)準(zhǔn)之一。研究JPEG圖像壓縮在FPGA上的實(shí)現(xiàn),具有廣闊的應(yīng)用背景。 論文從實(shí)際工程應(yīng)用出發(fā),通過設(shè)計(jì)圖像壓縮的IP核,完成JPEG壓縮算法在FPGA上的實(shí)現(xiàn)。首先闡述JPEG基本模式的壓縮編碼的標(biāo)準(zhǔn),然后在設(shè)計(jì)規(guī)劃過程中,采用SOC的設(shè)計(jì)思想,給出整個系統(tǒng)的內(nèi)部結(jié)構(gòu)、層次劃分,對各個模塊的HDL實(shí)現(xiàn)進(jìn)行詳細(xì)的描述,最后完成整體驗(yàn)證。方案采用了IP核復(fù)用的設(shè)計(jì)技術(shù),基于Xilinx公司本身的IP核,進(jìn)行了再次開發(fā)。在研究JPEG標(biāo)準(zhǔn)的核心算法DCT的基礎(chǔ)上,加以改進(jìn),設(shè)計(jì)了適合器件結(jié)構(gòu)的基于DA算法的DCT變換的IP核。通過結(jié)構(gòu)和算法的優(yōu)化,提高了速度,減少占用過多的片內(nèi)資源。 設(shè)計(jì)基于Xilinx的Virtex- II系列的FPGA的硬件平臺,在ISE7.1中編譯綜合,最后通過Modelsim仿真驗(yàn)證。分辨率為352×288大小的源圖像,在不同的壓縮等級設(shè)置下,均測試通過。仿真驗(yàn)證的結(jié)果表明:基于FPGA的JPEG壓縮編碼占用較少的硬件資源,可在較高的工作頻率下運(yùn)行,設(shè)計(jì)在速度和資源利用率方面達(dá)到了較優(yōu)的狀態(tài),能夠滿足一般圖像壓縮的要求。 整個設(shè)計(jì)可以作為單獨(dú)的JPEG編碼芯片也可以作為IP核添加到其他系統(tǒng)中去,具有一定的使用價值。

    標(biāo)簽: FPGA JPEG 壓縮編碼

    上傳時間: 2013-04-24

    上傳用戶:nairui21

  • USB接口引擎的軟核設(shè)計(jì)與FPGA兌現(xiàn).rar

    USB(UniversalSerialBus,通用串行總線)是當(dāng)今消費(fèi)電子產(chǎn)品和儀器設(shè)備中應(yīng)用最廣的接口協(xié)議之一,然而目前國內(nèi)的USB芯片只有極少數(shù)幾款,產(chǎn)品研究善處于起步階段,絕大部分產(chǎn)品主要由國外的IC設(shè)計(jì)芯片廠商如Cypress、NEC等一些國際著名公司提供。因而,如果能夠自主開發(fā)設(shè)計(jì)USB芯片以替代國外同類產(chǎn)品,將會有很好的市場前景和利潤空間。 本論文課題是針對基于FPGA(FieldProgrammableGateArray,現(xiàn)場可編程門陣列器件)的數(shù)字電子產(chǎn)品應(yīng)用設(shè)計(jì)一種實(shí)際可復(fù)用的USB接口引擎軟核。該軟核主要是用于處理USB標(biāo)準(zhǔn)協(xié)議包的通信處理,通過外接MCU(MultipointControlUnit,微控制器)就可以實(shí)現(xiàn)完整的USB接口通訊功能。它的功能相當(dāng)于一些USB引擎的專用芯片如:Philips的PDIUSBD12等,其優(yōu)點(diǎn)是結(jié)構(gòu)簡單、靈活性高、復(fù)用設(shè)計(jì)方便。 功能仿真和綜合測試結(jié)果顯示本論文所設(shè)計(jì)的接口引擎軟核符合設(shè)計(jì)要求,并且軟核的性能和市場上同類產(chǎn)品基本一致。本論文的創(chuàng)新之處在于:1、從可配置性角度出發(fā)設(shè)計(jì)了低速、全速、高速三種可選模式;2、支持最多31個可配置端點(diǎn);3、采用了可綜合、可移植的RTL(RegisterTransferLevel,寄存器傳輸級)代碼設(shè)計(jì)規(guī)則,同時也開發(fā)了可綜合的驗(yàn)證測試代碼;4、完全由硬件實(shí)現(xiàn)USB通信功能。

    標(biāo)簽: FPGA USB 接口

    上傳時間: 2013-07-18

    上傳用戶:JasonC

  • 二維DCT/IDCT處理核的FPGA設(shè)計(jì)與實(shí)現(xiàn)

    離散余弦變換(DCT)及其反變換(IDCT)在圖像編解碼方面應(yīng)用十分廣泛,至今已被JPEG、MPEG-1、MPEG-2、MPEG-4和H.26x等國際標(biāo)準(zhǔn)所采用。由于其計(jì)算量較大,軟件實(shí)現(xiàn)往往難以滿足實(shí)時處理的要求,因而在很多實(shí)際應(yīng)用中需要采用硬件設(shè)計(jì)的DCT/IDCT處理電路來滿足我們對處理速度的要求。本文所研究的內(nèi)容就是針對圖像處理應(yīng)用的8×8二維DCT/IDCT處理核的硬件實(shí)現(xiàn)。 本文首先介紹了DCT和IDCT在圖像處理中的作用和原理,詳細(xì)說明了DCT變換實(shí)現(xiàn)圖像壓縮的過程,并與其它變換比較說明了用DCT變換實(shí)現(xiàn)圖像壓縮的優(yōu)勢。接著,分析研究了DCT的各種快速算法,總結(jié)了前人對DCT快速算法及其實(shí)現(xiàn)所做的研究。本文給出了兩種性能、資源上有一定差異的二維DCT/IDCT的FPGA設(shè)計(jì)方案。兩種方案均利用DCT的行列分離特性,采用流水線設(shè)計(jì)技術(shù),將二維DCT/IDCT實(shí)現(xiàn)轉(zhuǎn)化為兩個一維DCT/IDCT實(shí)現(xiàn)。在一維DCT/IDCT設(shè)計(jì)中,根據(jù)圖像處理的特點(diǎn)對Loeffler算法的數(shù)據(jù)流進(jìn)行了優(yōu)化,通過合理安排時鐘周期數(shù)和簡化各周期內(nèi)的操作,大大縮短了關(guān)鍵路徑的執(zhí)行時間,從而提高了流水線的執(zhí)行速度。最后,對所設(shè)計(jì)的DCT/IDCT處理核進(jìn)行了綜合和時序仿真。 結(jié)果表明,當(dāng)使用Altera公司的MERCURY系列FPGA器件時,本文設(shè)計(jì)的方案一能夠在116M時鐘頻率下正確完成8×8的二維DCT或IDCT的邏輯運(yùn)算,消耗2827個邏輯單元;方案二能夠在74M時鐘頻率下正常工作,消耗1629個邏輯單元。

    標(biāo)簽: IDCT FPGA DCT 二維

    上傳時間: 2013-07-14

    上傳用戶:3291976780

  • 基于CPLD/FPGA的IP核設(shè)計(jì)

    本文介紹了一個基于CPLD/FPGA的嵌入式IP核設(shè)計(jì)。論文在闡述可編程邏輯器件及其發(fā)展趨勢的基礎(chǔ)上,探討了知識產(chǎn)權(quán)復(fù)用理念,MCU的復(fù)雜化設(shè)計(jì)以及數(shù)字信號傳輸與處理的速度要求。結(jié)合國內(nèi)外對CPLD/FPGA的使用現(xiàn)狀,引出了在CPLD/FPGA上開發(fā)嵌入式模塊程序的理念并提出了設(shè)計(jì)實(shí)現(xiàn)方法和設(shè)計(jì)實(shí)例。課題的設(shè)計(jì)目標(biāo)為開發(fā)一個基于CPLD/FPGA的USBIP模塊,實(shí)現(xiàn)開發(fā)板與PC機(jī)之間的USB通信。設(shè)計(jì)過程首先進(jìn)行硬件設(shè)計(jì),在FPGA開發(fā)板上開發(fā)擴(kuò)展板;其次用ISE開發(fā)軟件進(jìn)行FPGA數(shù)字化設(shè)計(jì);在軟件開發(fā)完成后,將配置生成的比特流文件通過JTAG電纜下載到FPGA開發(fā)板上,實(shí)現(xiàn)FPGA開發(fā)板與PC機(jī)之間的通信。 該設(shè)計(jì)具有很高的實(shí)用性,它進(jìn)一步擴(kuò)大了可編程芯片的領(lǐng)地,將復(fù)雜專有芯片擠向高端和超復(fù)雜應(yīng)用;它使得IP資源復(fù)用理念得到更普遍的應(yīng)用;為基于FPGA的嵌入式系統(tǒng)設(shè)計(jì)提供了廣闊的思路。

    標(biāo)簽: CPLD FPGA IP核

    上傳時間: 2013-07-05

    上傳用戶:隱界最新

  • μCOS-II微小內(nèi)核分析

    周立功公司做的一個μCOS-II微小內(nèi)核分析的PPT.是初學(xué)很好一個資料,多的就不說了,下了就知道.

    標(biāo)簽: COS-II 內(nèi)核分析

    上傳時間: 2013-07-07

    上傳用戶:66wji

  • 基于ARM多核平臺的打印機(jī)JPEG高速解碼引擎設(shè)計(jì)與實(shí)現(xiàn)

    大多數(shù)現(xiàn)在的PCL打印機(jī)驅(qū)動程序都是將需要打印的文件(包括圖形或者文本)處理成JPEG文件發(fā)送到打印機(jī)進(jìn)行打印,因?yàn)檫@樣一方面可以減少發(fā)送給打印機(jī)的數(shù)據(jù)量,一方面可以極大的簡化驅(qū)動程序的開發(fā)。而在打印機(jī)內(nèi)部,這些JPEG文件又被解碼成BMP文件進(jìn)行進(jìn)一步的處理。采用這種方式工作的打印機(jī)JPEG解碼的工作占據(jù)了其CPU時間的一半以上,所以JPEG文件解碼引擎是打印機(jī)的核心之一,提高JPEG的解碼速度對于提高打印機(jī)的處理能力至關(guān)重要。 同時,JPEG文件解碼工作是一個計(jì)算密集型的作業(yè),主要有兩個辦法提高它的速度:一個是設(shè)計(jì)更高效的算法,一個是采用性能更加強(qiáng)勁的CPU設(shè)備。在單核CPU的嵌入式環(huán)境中,JPEG編解碼速度已經(jīng)幾乎到了極限,難有提升的空間,然而近兩年多核嵌入式芯片的出現(xiàn),為大幅度提升它的性能提供了可能。 本文基于嵌入式的Linux平臺,采用ARM11 MPCore4核處理器,針對PCL,XL打印機(jī)控制語言的JPEG文件解碼設(shè)計(jì)和實(shí)現(xiàn)了一個高速引擎,主要內(nèi)容為: 分析和解碼PCL,XL文件,提取出其中的JPEG文件。 對JPEG文件實(shí)現(xiàn)并行化解碼,在多個處理器核上并行處理,并針對多核處理器構(gòu)架進(jìn)行內(nèi)存讀取等方面的優(yōu)化。 針對多核處理器的特點(diǎn)和優(yōu)勢,設(shè)計(jì)和實(shí)現(xiàn)多線程調(diào)度算法。 總結(jié)和提取數(shù)據(jù),分析多核處理器相對于單核處理器的性能提升。 另外,為便于讀者理解,文中簡要介紹了ARM(SIMD)指令集,嵌入式匯編以及與硬件相關(guān)的一些概念。

    標(biāo)簽: JPEG ARM 多核 打印機(jī)

    上傳時間: 2013-06-16

    上傳用戶:scorpion

  • 基于ARMμCLinux的核地球物理數(shù)據(jù)采集系統(tǒng)的研究

    核地球物理勘探是集核探測技術(shù)、電子技術(shù)、計(jì)算機(jī)技術(shù)為一體,能夠快速、準(zhǔn)確地分析出核素的相關(guān)信息及參數(shù)的一門綜合性很強(qiáng)的學(xué)科。目前己廣泛應(yīng)用于鈾礦勘探、地質(zhì)填圖、油氣勘測以及尋找各種金屬和非金屬礦產(chǎn)等諸多領(lǐng)域。其中核地球物理數(shù)據(jù)的采集和處理是核地球物理勘探研究的重要課題之一,它將直接對測量結(jié)果產(chǎn)生影響。 本系統(tǒng)設(shè)計(jì)是架構(gòu)在基于ARM7TDMI核的16/32位處理器S3C44BOX的硬件基礎(chǔ)上,移植了嵌入式μCLinux操作系統(tǒng)、JFFS2文件系統(tǒng)、以及MiniGUI圖形開發(fā)庫。通過利用S3C44BOX處理器快速的運(yùn)算速度、豐富的外圍設(shè)備和嵌入式μCLinux操作系統(tǒng)及其豐富的軟件資源,編寫了系統(tǒng)引導(dǎo)代碼、集成了LCD、MCA硬件設(shè)備的驅(qū)動程序、開發(fā)了GPS、GPRS應(yīng)用程序。本論文研究成果主要有: 1.研制了基于高端的16/32位ARM7TDMI處理器S3C44BOX為控制核心、外圍電路帶有LCD顯示以及時鐘和存儲電路的核數(shù)據(jù)采集系統(tǒng)。該系統(tǒng)能夠穩(wěn)定運(yùn)行在60MHz頻率,無需上位機(jī),用戶就可與之進(jìn)行交互工作,能夠獨(dú)立完成能譜數(shù)據(jù)的采集、分析、存儲等功能。系統(tǒng)具有低功耗、小型化、高性價比等特點(diǎn)。 2.實(shí)現(xiàn)了嵌入式μCLinux操作系統(tǒng)在采集系統(tǒng)上的移植。隨著嵌入式系統(tǒng)的迅速發(fā)展,嵌入式操作系統(tǒng)在核儀器研制中的應(yīng)用不僅能夠提高系統(tǒng)的穩(wěn)定性,而且通過充分利用Linux豐富的軟件資源,能夠快速的完成系統(tǒng)的定制和開發(fā),構(gòu)建復(fù)雜的軟件系統(tǒng)。 3.實(shí)現(xiàn)了基于μCLinux的JFFS2嵌入式文件系統(tǒng)的移植,安全可靠的管理了系統(tǒng)引導(dǎo)代碼、#CLinux操作系統(tǒng)內(nèi)核映象文件、譜處理程序和數(shù)據(jù)等。 4.初步實(shí)現(xiàn)了GPS定位、GPRS數(shù)據(jù)無線傳輸?shù)墓δ堋?/p>

    標(biāo)簽: CLinux ARM 地球 物理

    上傳時間: 2013-04-24

    上傳用戶:dreamboy36

  • 基于ARM的嵌入式強(qiáng)實(shí)時內(nèi)核設(shè)計(jì)

    隨著國內(nèi)工業(yè)化、數(shù)字化的迅速發(fā)展,嵌入式開發(fā)在IT行業(yè)中的重要性越來越顯著。嵌入式開發(fā)領(lǐng)域?qū)Ξa(chǎn)品的功能性、穩(wěn)定性、實(shí)時性等方面的要求也越來越高。 采用嵌入式實(shí)時操作系統(tǒng)作為開發(fā)平臺,以高性能的嵌入式處理器為工業(yè)控制等領(lǐng)域的主控制器可以有效地提高系統(tǒng)的可靠性、實(shí)時性、和軟件編程的靈活性。在嵌入式處理器方面,ARM構(gòu)架已經(jīng)在高性能、低功耗、低成本的嵌入式領(lǐng)域里占領(lǐng)先地位。而在嵌入式操作系統(tǒng)方面,適合國內(nèi)發(fā)展方向的解決方案以及系統(tǒng)基礎(chǔ)結(jié)構(gòu)方面并不理想。首先,國外成熟的嵌入式實(shí)時操作系統(tǒng)大都成本高、結(jié)構(gòu)復(fù)雜,不適合強(qiáng)實(shí)時應(yīng)用;其次,因大部分實(shí)時操作系統(tǒng)不公開源碼,使開發(fā)的產(chǎn)品存在安全隱患。而類似μC/OS-II的小型強(qiáng)實(shí)時嵌入式操作系統(tǒng)內(nèi)核雖然具有低成本、易控制、小規(guī)模、高性能等特性,但這類系統(tǒng)的基礎(chǔ)較為薄弱,面臨產(chǎn)品化和商業(yè)化還有一定的距離。 本文針對這種情況,結(jié)合現(xiàn)有的操作系統(tǒng)內(nèi)核理論及嵌入式強(qiáng)實(shí)時系統(tǒng)的特殊需求,特別是對μC/OS-Ⅱ的研究分析基礎(chǔ)上,面向強(qiáng)實(shí)時應(yīng)用,設(shè)計(jì)、構(gòu)造了一種適合在32位ARM處理器環(huán)境下使用的內(nèi)核。這樣做的目的是為了提供一個基礎(chǔ)牢固、值得信賴的基本平臺。 本文研究工作主要集中在以下幾個方面: 針對嵌入式環(huán)境中高效、簡潔、易擴(kuò)展、易剪裁的要求,對內(nèi)核體系結(jié)構(gòu)框架進(jìn)行了設(shè)計(jì)。內(nèi)核整體上采用分層結(jié)構(gòu),在各層中采用功能相對獨(dú)立的模塊:在最底層借鑒微核的原理,只提供最基本的功能模塊。 針對系統(tǒng)快速和穩(wěn)定的實(shí)時響應(yīng)能力需求,為IRQ中斷建立了統(tǒng)一的中斷入口,采用合理的半嵌套工作方式;保留FIQ為不可屏蔽中斷,在快速反應(yīng)場合使用;引入中斷分段處理機(jī)制解決中斷和任務(wù)的ITC機(jī)制共享,需要硬保護(hù)機(jī)制相互協(xié)調(diào)所引起的硬保護(hù)機(jī)制被隱性地泛濫使用問題。 針對應(yīng)用提出的系統(tǒng)行為的可預(yù)測性需求,在調(diào)度算法方面采用基于優(yōu)先級位圖的搶占閾值調(diào)度算法,提高了處理器的利用率和任務(wù)集合的可調(diào)度性,減少了內(nèi)核存儲開銷;在共享資源訪問控制方面,以優(yōu)先級天花板協(xié)議為依據(jù),使用互斥事件解決優(yōu)先級反轉(zhuǎn)和死鎖問題的發(fā)生。 為了保障系統(tǒng)的強(qiáng)實(shí)時性能,本文還對內(nèi)核的時鐘管理、內(nèi)存管理等方面進(jìn)行了設(shè)計(jì)。最后,通過實(shí)時性能測試,結(jié)果表明該實(shí)時內(nèi)核有很好的強(qiáng)實(shí)時特性。

    標(biāo)簽: ARM 嵌入式 內(nèi)核設(shè)計(jì)

    上傳時間: 2013-04-24

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