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II軟核

  • 基于ARMμCOSⅡ的核數(shù)據(jù)采集系統(tǒng)研制

    核能譜儀中的數(shù)據(jù)采集系統(tǒng),集核探測技術(shù)、電子技術(shù)、計(jì)算機(jī)技術(shù)為一體,以多道脈沖幅度分析器為核心部件,能夠快速、準(zhǔn)確地提取出核素的相關(guān)信息及參數(shù)。現(xiàn)已于勘探、建材放射性檢測及環(huán)境放射性監(jiān)測等領(lǐng)域得到廣泛應(yīng)用。隨著嵌入式技術(shù)的發(fā)展,以32位ARM為核心的微控制器已被引入進(jìn)來,提高了數(shù)據(jù)采集的速度和精度,同時(shí)嵌入式操作系統(tǒng)的引入也為功能擴(kuò)展、系統(tǒng)集成提供了高效的開發(fā)平臺。 本論文介紹的核數(shù)據(jù)采集系統(tǒng)即以ARM微控制器LPC2148和實(shí)時(shí)操作系統(tǒng)μC/OS-II為平臺,譜數(shù)據(jù)采集為基本功能,在此基礎(chǔ)上擴(kuò)展GPS和GPRS模塊,可實(shí)現(xiàn)GPS信息和核信號的實(shí)時(shí)、同步接收,保存和顯示,并可將采集的數(shù)據(jù)通過GPRS網(wǎng)絡(luò)及時(shí)傳到采集中心進(jìn)行譜數(shù)據(jù)處理和GPS差分定位,為野外多點(diǎn)測量及遠(yuǎn)程監(jiān)測提供了有效的手段。 課題以教育部的高等學(xué)校博士學(xué)科點(diǎn)專項(xiàng)科研基金項(xiàng)目“基于3GS技術(shù)的便攜式核地球物理數(shù)據(jù)采集系統(tǒng)研究(項(xiàng)目編號:20040616014)”為依托,本人在已有研究成果的基礎(chǔ)上,進(jìn)行了相關(guān)改進(jìn)和系統(tǒng)集成: (1)選用軌對軌運(yùn)算放大器,改進(jìn)了峰值檢測電路,增大了脈沖峰值的測量精度。 (2)數(shù)據(jù)采集系統(tǒng)以32位ARM微控制器LPC2148為核心,外圍電路帶有LCD顯示,系統(tǒng)具有低功耗、小型化、高性價(jià)比等特點(diǎn)。 (3)實(shí)現(xiàn)了核數(shù)據(jù)采集系統(tǒng)對GPS、GPRS的集成。 (4)完成嵌入式μC/OS-II操作系統(tǒng)在LPC2148上的移植、操作系統(tǒng)的搭建,及各功能模塊的設(shè)計(jì)與集成。

    標(biāo)簽: ARM COS 數(shù)據(jù)采集系統(tǒng)

    上傳時(shí)間: 2013-04-24

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  • 基于Avalon總線的8051MCU IP核的設(shè)計(jì)

    設(shè)計(jì)了一款基于Avalon總線的8051MCU IP核。它支持MCS-51指令集,優(yōu)化內(nèi)部的結(jié)構(gòu),通過采用流水線技術(shù)、指令映射技術(shù)、指令預(yù)取技術(shù)、微代碼技術(shù)等極大的提高了IP核的工作速度,使IP核在100MHz時(shí)鐘下,能夠單周期執(zhí)行一條指令。本設(shè)計(jì)使用Modelsim軟件完成了功能仿真和時(shí)序仿真,并在以Altera 公司的Cyclone II FPGA芯片為核心的DE2開發(fā)板上完成了硬件驗(yàn)證。

    標(biāo)簽: Avalon 8051 MCU 總線

    上傳時(shí)間: 2013-11-02

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  • 基于Quartus II免費(fèi)IP核的雙端口RAM設(shè)計(jì)實(shí)例

      QuartusII中利用免費(fèi)IP核的設(shè)計(jì)   作者:雷達(dá)室   以設(shè)計(jì)雙端口RAM為例說明。   Step1:打開QuartusII,選擇File—New Project Wizard,創(chuàng)建新工程,出現(xiàn)圖示對話框,點(diǎn)擊Next;

    標(biāo)簽: Quartus RAM IP核 雙端口

    上傳時(shí)間: 2014-12-28

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  • 基于FPGA的DDS IP核設(shè)計(jì)方案

    以Altera公司的Quartus Ⅱ 7.2作為開發(fā)工具,研究了基于FPGA的DDS IP核設(shè)計(jì),并給出基于Signal Tap II嵌入式邏輯分析儀的仿真測試結(jié)果。將設(shè)計(jì)的DDS IP核封裝成為SOPC Builder自定義的組件,結(jié)合32位嵌入式CPU軟核Nios II,構(gòu)成可編程片上系統(tǒng)(SOPC),利用極少的硬件資源實(shí)現(xiàn)了可重構(gòu)信號源。該系統(tǒng)基本功能都在FPGA芯片內(nèi)完成,利用 SOPC技術(shù),在一片 FPGA 芯片上實(shí)現(xiàn)了整個(gè)信號源的硬件開發(fā)平臺,達(dá)到既簡化電路設(shè)計(jì)、又提高系統(tǒng)穩(wěn)定性和可靠性的目的。

    標(biāo)簽: FPGA DDS IP核 設(shè)計(jì)方案

    上傳時(shí)間: 2013-11-06

    上傳用戶:songkun

  • 基于Quartus II免費(fèi)IP核的雙端口RAM設(shè)計(jì)實(shí)例

      QuartusII中利用免費(fèi)IP核的設(shè)計(jì)   作者:雷達(dá)室   以設(shè)計(jì)雙端口RAM為例說明。   Step1:打開QuartusII,選擇File—New Project Wizard,創(chuàng)建新工程,出現(xiàn)圖示對話框,點(diǎn)擊Next;

    標(biāo)簽: Quartus RAM IP核 雙端口

    上傳時(shí)間: 2013-10-18

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  • 基于FPGA的DDS IP核設(shè)計(jì)方案

    以Altera公司的Quartus Ⅱ 7.2作為開發(fā)工具,研究了基于FPGA的DDS IP核設(shè)計(jì),并給出基于Signal Tap II嵌入式邏輯分析儀的仿真測試結(jié)果。將設(shè)計(jì)的DDS IP核封裝成為SOPC Builder自定義的組件,結(jié)合32位嵌入式CPU軟核Nios II,構(gòu)成可編程片上系統(tǒng)(SOPC),利用極少的硬件資源實(shí)現(xiàn)了可重構(gòu)信號源。該系統(tǒng)基本功能都在FPGA芯片內(nèi)完成,利用 SOPC技術(shù),在一片 FPGA 芯片上實(shí)現(xiàn)了整個(gè)信號源的硬件開發(fā)平臺,達(dá)到既簡化電路設(shè)計(jì)、又提高系統(tǒng)穩(wěn)定性和可靠性的目的。

    標(biāo)簽: FPGA DDS IP核 設(shè)計(jì)方案

    上傳時(shí)間: 2013-12-22

    上傳用戶:forzalife

  • 在W78E58處理器上移植的uCOS-II

    在W78E58處理器上移植的uCOS-II,有完整的注解,可以快速在在其它51核上運(yùn)行。

    標(biāo)簽: uCOS-II W78E58 處理器 移植

    上傳時(shí)間: 2014-01-18

    上傳用戶:yuzsu

  • 此源碼是利用altera公司的NIOS II IDE開發(fā)的

    此源碼是利用altera公司的NIOS II IDE開發(fā)的,功能是通過spi 核控制AD/DA發(fā)三角波

    標(biāo)簽: altera NIOS IDE II

    上傳時(shí)間: 2013-12-15

    上傳用戶:c12228

  • VGA的IP核

    VGA的IP核,可直接用于nios II的應(yīng)用里,在DE2板子直接使用

    標(biāo)簽: VGA IP核

    上傳時(shí)間: 2016-02-24

    上傳用戶:yyq123456789

  • ISP1362的IP核

    ISP1362的IP核,可直接用于nios II的應(yīng)用里,在DE2板子直接使用

    標(biāo)簽: 1362 ISP IP核

    上傳時(shí)間: 2013-12-24

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