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IP多播網(wǎng)絡(luò)

  • easy,51pro,3.0編程器在2.0的基礎(chǔ)上增加了更多的芯片器件

    easy,51pro,3.0編程器在2.0的基礎(chǔ)上增加了更多的芯片器件

    標(biāo)簽: easy 3.0 2.0 pro

    上傳時(shí)間: 2013-07-25

    上傳用戶:qazwsc

  • 基于ARM平臺(tái)及短消息的多點(diǎn)溫度監(jiān)測(cè)系統(tǒng)設(shè)計(jì)

    隨著現(xiàn)代控制技術(shù)的飛速發(fā)展和傳統(tǒng)工業(yè)改造的逐步實(shí)現(xiàn),能夠獨(dú)立工作的溫度檢測(cè)和顯示系統(tǒng)已經(jīng)應(yīng)用于諸多領(lǐng)域。傳統(tǒng)的溫度監(jiān)測(cè)系統(tǒng)可靠性和實(shí)時(shí)性相對(duì)較差,溫度測(cè)量的精度和準(zhǔn)確度較低,而且大多采用有線方式對(duì)整個(gè)系統(tǒng)進(jìn)行控制,這不利于應(yīng)用的擴(kuò)展。近年來(lái),嵌入式系統(tǒng)和無(wú)線通信技術(shù)(特別是短消息業(yè)務(wù))受到遠(yuǎn)程監(jiān)測(cè)領(lǐng)域研究者的密切關(guān)注,成為一個(gè)研究熱點(diǎn)。本文提出了一種將帶有I2C總線的ARM嵌入式微處理器和短消息業(yè)務(wù)(SMS)用于溫度檢測(cè)系統(tǒng)中的方法,實(shí)現(xiàn)了溫度的多點(diǎn)監(jiān)測(cè)。本文的主要研究?jī)?nèi)容如下: (1)多點(diǎn)溫度監(jiān)測(cè)系統(tǒng)硬件設(shè)計(jì)。采用以ARM微處理器LPC2290芯片為核心的嵌入式工控板,通過對(duì)Benq無(wú)線通信模塊M22的控制,接收并識(shí)別監(jiān)測(cè)中心發(fā)過來(lái)的短消息內(nèi)容,實(shí)現(xiàn)了多點(diǎn)溫度的采集及顯示;采用八個(gè)帶有I2C總線接口的數(shù)字溫度傳感器LM75,組成八點(diǎn)溫度采集電路:利用帶有I2C總線接口的LED驅(qū)動(dòng)器件ZLG7290及共陰式數(shù)碼管為溫度顯示電路,保證了溫度測(cè)量的精度和準(zhǔn)確度。 (2)多點(diǎn)溫度監(jiān)測(cè)系統(tǒng)軟件設(shè)計(jì)。根據(jù)整個(gè)監(jiān)測(cè)系統(tǒng)的特點(diǎn),提出了軟件設(shè)計(jì)的總體思路,并以ADS1.2為集成開發(fā)環(huán)境,將μC/OS-Ⅱ嵌入式操作系統(tǒng)的相關(guān)代碼移植到LPC2290中;采用分層體系思想,使用標(biāo)準(zhǔn)C語(yǔ)言編寫程序,結(jié)合嵌入式操作系統(tǒng)的任務(wù)管理、信號(hào)量等機(jī)制,并調(diào)用相關(guān)的應(yīng)用程序接口函數(shù)(API函數(shù)),設(shè)計(jì)了包括溫度采集、溫度顯示、短消息接收與發(fā)送等多個(gè)子程序。 (3)監(jiān)測(cè)中心軟件設(shè)計(jì)。為了增強(qiáng)系統(tǒng)控制和數(shù)據(jù)管理功能,使用Visual C++6.0及ADO數(shù)據(jù)庫(kù)技術(shù)編寫了監(jiān)測(cè)中心軟件人機(jī)交互界面,通過串口使另一M22無(wú)線通信模塊同監(jiān)測(cè)中心上位機(jī)的通信,實(shí)現(xiàn)了在PC機(jī)上發(fā)送短消息指令對(duì)下位機(jī)進(jìn)行遠(yuǎn)程控制,并將接收到的數(shù)據(jù)存儲(chǔ)在Access數(shù)據(jù)庫(kù)中以便分析處理。 嵌入式技術(shù)和短消息業(yè)務(wù)在一定程度上提高了多點(diǎn)溫度監(jiān)測(cè)系統(tǒng)的測(cè)量精度、可靠性、穩(wěn)定性和實(shí)時(shí)性,對(duì)改進(jìn)遠(yuǎn)程監(jiān)測(cè)系統(tǒng)的控制方式和數(shù)據(jù)傳輸方式有一定的意義,也為對(duì)嵌入式應(yīng)用項(xiàng)目的開發(fā)奠定了基礎(chǔ)。

    標(biāo)簽: ARM 多點(diǎn) 溫度監(jiān)測(cè) 系統(tǒng)設(shè)計(jì)

    上傳時(shí)間: 2013-07-08

    上傳用戶:feichengweoayauya

  • MDIO接口邏輯設(shè)計(jì)及其FPGA驗(yàn)證

    隨著集成電路技術(shù)的飛速發(fā)展,芯片的規(guī)模越來(lái)越大,集成度越來(lái)越高,工作頻率越來(lái)越快,但是芯片的設(shè)計(jì)能力卻面臨巨大的挑戰(zhàn)。而IP核的重用則是解決當(dāng)今芯片設(shè)計(jì)所面臨問題的最有效的解決方法。 MDIO接口模塊為以太網(wǎng)接口芯片中MAC層對(duì)PHY器件的控制管理接口。隨著以太網(wǎng)技術(shù)的快速發(fā)展以及MAC應(yīng)用越來(lái)越廣泛,MDIO接口模塊的應(yīng)用也越來(lái)越多,因此將MDIO接口模塊設(shè)計(jì)成可重用的IP核對(duì)于以各種太網(wǎng)接口集成芯片的設(shè)計(jì)具有很重要的作用。 本文詳細(xì)描述了MDIO接口模塊IP核的設(shè)計(jì),介紹了該IP核的系統(tǒng)結(jié)構(gòu)以及各個(gè)子模塊的詳細(xì)設(shè)計(jì)方法,對(duì)此IP核進(jìn)行了仿真驗(yàn)證,最后進(jìn)行了FPGA測(cè)試,功能和性能達(dá)到了要求,最終通過了IP審核流程并且已成功應(yīng)用于企業(yè)的以太網(wǎng)接口芯片中。

    標(biāo)簽: MDIO FPGA 接口 邏輯設(shè)計(jì)

    上傳時(shí)間: 2013-07-20

    上傳用戶:nanfeicui

  • 單片機(jī)多功能調(diào)試助手V1.1.9

    特色在于為之量身定制了一款多功能調(diào)試軟件,不僅含有串口調(diào)試功能、而且該軟件強(qiáng)大之處支持USB數(shù)據(jù)收發(fā)、網(wǎng)絡(luò)數(shù)據(jù)收發(fā)、51/AVR單片機(jī)波特率計(jì)算、數(shù)碼管字型碼生成、進(jìn)制轉(zhuǎn)換、點(diǎn)陣生成、校驗(yàn)值(奇偶校驗(yàn)/校驗(yàn)和/CRC冗余循環(huán)校驗(yàn))/BMP轉(zhuǎn)16進(jìn)制、服務(wù)器、在線更新等功能。

    標(biāo)簽: 單片機(jī) 多功能 調(diào)試助手

    上傳時(shí)間: 2013-06-17

    上傳用戶:梧桐

  • 16QAM基帶Modem的FPGA芯片設(shè)計(jì)

    本文對(duì)16QAM基帶Modem的FPGA芯片設(shè)計(jì)進(jìn)行了研究與論述.首先介紹了16QAM調(diào)制的原理和16QAM基帶Modem的FPGA芯片總體設(shè)計(jì),以及一些FPGA設(shè)計(jì)的基本原則.接著介紹了高性能濾波器的FPGA設(shè)計(jì)方法,并采用多相結(jié)構(gòu)濾波器和分布式算法(DA)設(shè)計(jì)了發(fā)送端平方根升余弦滾降濾波器.然后介紹了自適應(yīng)盲均衡器的設(shè)計(jì),該均衡器是一個(gè)復(fù)數(shù)結(jié)構(gòu)的橫向?yàn)V波器,采用復(fù)用抽頭的結(jié)構(gòu)來(lái)節(jié)省資源,本文對(duì)自適應(yīng)均衡器的核心運(yùn)算單元-采用booth編碼算法設(shè)計(jì)的高性能乘累加(MAC)運(yùn)算單元進(jìn)行了詳細(xì)描述.接下來(lái)介紹了載波恢復(fù)環(huán)路的FPGA設(shè)計(jì),這是一個(gè)數(shù)字二階鎖相環(huán),本文推導(dǎo)了數(shù)字二階鎖相環(huán)和模擬二階鎖相環(huán)的對(duì)應(yīng)關(guān)系.DD相位檢測(cè)算法中的反正切函數(shù)tan

    標(biāo)簽: Modem FPGA QAM 16

    上傳時(shí)間: 2013-04-24

    上傳用戶:dajin

  • WCDMA多用戶檢測(cè)算法的研究和下行鏈路解復(fù)用技術(shù)的FPGA實(shí)現(xiàn)

    本文首先在介紹多用戶檢測(cè)技術(shù)的原理以及系統(tǒng)模型的基礎(chǔ)上,對(duì)比分析了幾種多用戶檢測(cè)算法的性能,給出了算法選擇的依據(jù)。為了同時(shí)克服多址干擾和多徑干擾,給出了融合多用戶檢測(cè)與分集合并技術(shù)的接收機(jī)結(jié)構(gòu)。 接著,針對(duì)WCDMA反向鏈路信道結(jié)構(gòu),介紹了擴(kuò)頻使用的OVSF碼和擾碼,分析了擾碼的延時(shí)自相關(guān)特性和互相關(guān)特性,指出了存在多址干擾和多徑干擾的根源。在此基礎(chǔ)上,給出了解相關(guān)檢測(cè)器的數(shù)學(xué)公式推導(dǎo)和結(jié)構(gòu)框圖,并仿真研究了用戶數(shù)、擴(kuò)頻比、信道估計(jì)精度等參數(shù)對(duì)系統(tǒng)性能的影響。 常規(guī)的干擾抵消是基于chip級(jí)上的抵消,需要對(duì)用戶信號(hào)重構(gòu),因此具有較高的復(fù)雜度。在解相關(guān)檢測(cè)器的基礎(chǔ)上,衍生出符號(hào)級(jí)上的干擾抵消。通過仿真,給出了算法中涉及的干擾抑制控制權(quán)值、干擾抵消級(jí)數(shù)等參數(shù)的最佳取值,并進(jìn)行了算法性能比較。仿真結(jié)果驗(yàn)證了該算法的有效性。 最后,介紹了WCDMA系統(tǒng)移動(dòng)臺(tái)解復(fù)用技術(shù)的硬件實(shí)現(xiàn),在FPGA平臺(tái)上分別實(shí)現(xiàn)了與基站和安捷倫8960儀表的互聯(lián)互通。

    標(biāo)簽: WCDMA FPGA 多用戶檢測(cè) 下行鏈路

    上傳時(shí)間: 2013-07-29

    上傳用戶:jiangxin1234

  • 基于FPGA的多路E1反向復(fù)用傳輸芯片的設(shè)計(jì)與實(shí)現(xiàn)

    隨著電信數(shù)據(jù)傳輸對(duì)速率和帶寬的要求變得越來(lái)越迫切,原有建成的網(wǎng)絡(luò)是基于話音傳輸業(yè)務(wù)的網(wǎng)絡(luò),已不能適應(yīng)當(dāng)前的需求.而建設(shè)新的寬帶網(wǎng)絡(luò)需要相當(dāng)大的投資且建設(shè)工期長(zhǎng),無(wú)法滿足特定客戶對(duì)高速數(shù)據(jù)傳輸?shù)慕谛枨?反向復(fù)用技術(shù)是把一個(gè)單一的高速數(shù)據(jù)流在發(fā)送端拆散并放在兩個(gè)或者多個(gè)低速數(shù)據(jù)鏈路上進(jìn)行傳輸,在接收端再還原為高速數(shù)據(jù)流.該文提出一種基于FPGA的多路E1反向復(fù)用傳輸芯片的設(shè)計(jì)方案,使用四個(gè)E1構(gòu)成高速數(shù)據(jù)的透明傳輸通道,支持E1線路間最大相對(duì)延遲64ms,通過鏈路容量調(diào)整機(jī)制,可以動(dòng)態(tài)添加或刪除某條E1鏈路,實(shí)現(xiàn)靈活、高效的利用現(xiàn)有網(wǎng)絡(luò)實(shí)現(xiàn)視頻、數(shù)據(jù)等高速數(shù)據(jù)的傳輸,能夠節(jié)省帶寬資源,降低成本,滿足客戶的需求.系統(tǒng)分為發(fā)送和接收兩部分.發(fā)送電路實(shí)現(xiàn)四路E1的成幀操作,數(shù)據(jù)拆分采用線路循環(huán)與幀間插相結(jié)合的方法,A路插滿一幀(30時(shí)隙)后,轉(zhuǎn)入B路E1間插數(shù)據(jù),依此類推,循環(huán)間插所有的數(shù)據(jù).接收電路進(jìn)行HDB3解碼,幀同步定位(子幀同步和復(fù)幀同步),線路延遲判斷,FIFO和SDRAM實(shí)現(xiàn)多路數(shù)據(jù)的對(duì)齊,最后按照約定的高速數(shù)據(jù)流的幀格式輸出數(shù)據(jù).整個(gè)數(shù)字電路采用Verilog硬件描述語(yǔ)言設(shè)計(jì),通過前仿真和后仿真的驗(yàn)證.以30萬(wàn)門的FPGA器件作為硬件實(shí)現(xiàn),經(jīng)過綜合和布線,特別是寫約束和增量布線手動(dòng)調(diào)整電路的布局,降低關(guān)鍵路徑延時(shí),最終滿足設(shè)計(jì)要求.

    標(biāo)簽: FPGA 多路 傳輸 片的設(shè)計(jì)

    上傳時(shí)間: 2013-07-16

    上傳用戶:asdkin

  • 基于FPGA的可編程控制器現(xiàn)場(chǎng)集成技術(shù)應(yīng)用研究

    傳統(tǒng)PLC使用時(shí)會(huì)出現(xiàn)一些問題,如程序死循環(huán)、程序跑飛、需要龐大的編譯系統(tǒng)作支持和不能實(shí)現(xiàn)精確位置控制等等;而發(fā)展到OPENPLC后,這些問題依然存在。為了更好地解決這些問題,本文提出一種全新的可編程控制器現(xiàn)場(chǎng)集成技術(shù),用FPGA來(lái)實(shí)現(xiàn)PLC的功能,拋棄傳統(tǒng)PLC“程序”的概念,以“硬件線路”來(lái)實(shí)現(xiàn)控制功能,不論在經(jīng)濟(jì)上還是在性能上都具有更大的優(yōu)勢(shì)。 本課題在對(duì)國(guó)內(nèi)外可編程控制器,重點(diǎn)是HardPLC的開發(fā)和應(yīng)用的進(jìn)展進(jìn)行概述和分析的基礎(chǔ)上,系統(tǒng)開展了HardPLC組成模塊原理及其仿真模擬的研究。本研究的主要貢獻(xiàn)為: 1.對(duì)比分析了CPLD和FPGA的性能特點(diǎn),闡明了Xilinx公司FPGA芯片結(jié)構(gòu)的兩個(gè)創(chuàng)新概念,指出了其優(yōu)越性能的結(jié)構(gòu)基礎(chǔ); 2.系統(tǒng)分析了用HardPLC實(shí)現(xiàn)控制系統(tǒng)時(shí)的一些通用模塊,對(duì)每個(gè)模塊的工作原理進(jìn)行了深入的探討,用VHDL語(yǔ)言建立了每個(gè)模塊的模型,在此基礎(chǔ)上進(jìn)行了仿真、綜合,為進(jìn)一步研究可編程控制器的現(xiàn)場(chǎng)集成奠定了基礎(chǔ); 3.在仿真綜合的基礎(chǔ)上,用所建立的模型完成了特定邏輯控制系統(tǒng)的控制要求,充分展示了其實(shí)際應(yīng)用的可行性; 4.在分析Xilinx公司SPARTANII系列FPGA芯片配置模式的基礎(chǔ)上,確定了應(yīng)用于實(shí)際的基于CPLD控制的FPGA芯片SlaveParallel配置模式。 本課題研究建立的模型對(duì)于開發(fā)具有我國(guó)自主知識(shí)產(chǎn)權(quán)的HardPLC組成IP庫(kù)具有一定的理論意義;對(duì)特定系統(tǒng)的控制實(shí)現(xiàn),充分展示了基于FPGA的可編程控制器現(xiàn)場(chǎng)集成技術(shù)可以廣泛應(yīng)用于工控領(lǐng)域,加大推廣力度和建立更多的IP庫(kù),在許多應(yīng)用場(chǎng)合可以取代傳統(tǒng)的PLC控制系統(tǒng),為工控領(lǐng)域提供高可靠、低價(jià)格、簡(jiǎn)單易操作的解決方案,這將帶來(lái)巨大的社會(huì)經(jīng)濟(jì)效益;所確定的FPGA芯片配置模式可廣泛應(yīng)用于對(duì)FPGA芯片配置數(shù)據(jù)的加載,在實(shí)踐生產(chǎn)中具有重要的實(shí)用價(jià)值。

    標(biāo)簽: FPGA 可編程控制器 集成技術(shù) 應(yīng)用研究

    上傳時(shí)間: 2013-05-30

    上傳用戶:dtvboyy

  • 基于FPGA的視頻壓縮IP核設(shè)計(jì)

    結(jié)合視頻壓縮的理論以及IP核設(shè)計(jì)中對(duì)于仿真驗(yàn)證的要求,本文設(shè)計(jì)了視頻壓縮IP核FPGA仿真驗(yàn)證平臺(tái).其硬件子平臺(tái)以Xilinx公司XC2V3000為核心,針對(duì)視頻壓縮IP核應(yīng)用仿真要求設(shè)計(jì)外圍電路,構(gòu)建一個(gè)視頻壓縮IP核的硬件仿真原型,采用運(yùn)行于上位機(jī)上的控制和驅(qū)動(dòng)軟件作為軟件解碼子平臺(tái).同時(shí)還設(shè)計(jì)了完全獨(dú)立于硬件之外的ModelSim軟件仿真驗(yàn)證平臺(tái).以FPGA仿真驗(yàn)證平臺(tái)為載體,本文設(shè)計(jì)了基于H.263協(xié)議的視頻壓縮IP核.經(jīng)過ModelSim下的軟件平臺(tái)仿真調(diào)試與硬件平臺(tái)調(diào)試相結(jié)合的手段,作者完成了視頻壓縮IP核的仿真驗(yàn)證.

    標(biāo)簽: FPGA 視頻壓縮 IP核

    上傳時(shí)間: 2013-05-31

    上傳用戶:ikemada

  • 基于多相濾波的寬帶DDC及其FPGA實(shí)現(xiàn)

    隨著現(xiàn)代雷達(dá)技術(shù)的不斷發(fā)展,電子偵察設(shè)備面臨電磁環(huán)境日益復(fù)雜多變,發(fā)展寬帶化、數(shù)字化、多功能、軟件化的電子偵察設(shè)備已是一項(xiàng)重要的任務(wù).然而,目前的寬帶A/D與后續(xù)DSP之間的工作速率總有一到兩個(gè)數(shù)量級(jí)的差別,二者之間的瓶頸成為電子偵察系統(tǒng)數(shù)字化的最大障礙.通信領(lǐng)域軟件無(wú)線電的成功應(yīng)用為電子偵察系統(tǒng)的發(fā)展提供了一種理想模式.另一方面,微電子技術(shù)的快速發(fā)展,以及FPGA的廣泛應(yīng)用,在很大程度上影響了數(shù)字電路的設(shè)計(jì)與開發(fā).這也為解決高速A/D與DSP處理能力之間的矛盾提供了一種有效的解決方法.為了解決寬帶A/D與后續(xù)DSP之間的瓶頸問題,本文給出了一種基于多相濾波的寬帶數(shù)字下變頻結(jié)構(gòu),并從軟件無(wú)線電原理出發(fā),從理論推導(dǎo)和計(jì)算機(jī)仿真兩方面對(duì)該結(jié)構(gòu)進(jìn)行了驗(yàn)證,并進(jìn)一步給出該結(jié)構(gòu)改進(jìn)方案以及改進(jìn)的多相濾波數(shù)字下變頻結(jié)構(gòu)的硬件實(shí)現(xiàn)方法.本文將多相濾波下變頻的并行結(jié)構(gòu)應(yīng)用到數(shù)字下變頻電路中,并在后繼的混頻模塊中也采用并行混頻的方式來(lái)實(shí)現(xiàn),不僅在一定程度上解決了二者之間的瓶頸問題,同時(shí)也大大提高了實(shí)時(shí)處理速度.經(jīng)過多相濾波下變頻處理后的數(shù)據(jù),在速率和數(shù)據(jù)量上都有大幅減少,達(dá)到了現(xiàn)有通用DSP器件處理能力的要求.另外,本人還用FPGA設(shè)計(jì)了實(shí)驗(yàn)電路,利用微機(jī)串口,與實(shí)驗(yàn)?zāi)繕?biāo)板進(jìn)行控制和數(shù)據(jù)交換.利用FPGA的在線編程特性,可以方便靈活的對(duì)各種實(shí)現(xiàn)方法加以驗(yàn)證和比較.

    標(biāo)簽: FPGA DDC 多相濾波 寬帶

    上傳時(shí)間: 2013-04-24

    上傳用戶:moerwang

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