Verilog 編寫的ISP1362的控制器Ip核，altera公司DE2系統中的源程序
標簽： Verilog 1362 ISP Ip核
上傳時間： 2016-09-17
上傳用戶：稀世之寶039
電子測量技術 ELECTR0NIC MEASI瓜EMENT TECHN0L0GY 第29卷第3期 2006年6月 PS／2設備接口Ip核設計 王 豪黃啟俊常 勝 (武漢大學物理學院微電子與固體電子學實驗室武漢430072) 摘要：用Verilog硬件描述語言實現了PS／2設備接口的II)核設計，詳細描述了II)核的結構劃分和各模塊的 設計思想，并在FPGA上進行驗證。結果表明此 核功能正確，可以方便地在SOPC系統中復用。
標簽： ELECTR0NIC TECHN0L0GY MEASI EMENT
上傳時間： 2014-11-18
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SPI經典Ip核 可以直接用于工程的開發和利用
標簽： SPI 工程
上傳時間： 2016-09-24
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DMA VHDL 設計Ip核經常遇到大數據交換要用DMA，本Ip核來自開源組織，免費開源版
標簽： DMA VHDL Ip核 大數據
上傳時間： 2013-12-12
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是一些quartusII下的Ip核，自主開發的。包括有vga，ram等
標簽： quartusII Ip核
上傳時間： 2014-01-16
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此Ip核是xvga視頻接口控制器，主要針對xilinx公司的開發工具
標簽： xvga 視頻接口 控制器
上傳時間： 2016-10-03
上傳用戶：大三三
altera的15個Ip核的源碼，可能有用
標簽： altera Ip核 源碼
上傳用戶：wys0120
基于NIOS的CF卡應用(包括了軟件和硬件),ALTERA的IP庫中只提供了底層的硬件寄存器描述頭文件.這是個基于Ip核HAL的軟件,以及相應的硬件設計示例.
標簽： ALTERA NIOS HAL 軟件
上傳時間： 2016-10-16
上傳用戶：youke111
xilinx里的乘法器Ip核程序，booth乘法 wallace tree算法 4-2壓縮編碼 超前進位加法
標簽： xilinx 乘法器 程序
上傳時間： 2016-10-17
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VHDL版的C8051核(C8051).evatronix公司的Ip核
標簽： C8051 evatronix VHDL Ip核
上傳時間： 2013-12-25
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