Optimized Link State Routing是IETF正在研究的、用于移動式無線行動網絡（這里，不僅終端用戶可移動，路由器和服務器等也可以）的幾個協議之一。該項目的實施彌補了Hipercom項目的一個內容。
標簽： Optimized Routing State Link
上傳時間： 2015-04-27
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UM-OLSR is an OLSR (Optimized Link State Routing protocol) implementation for the ns2 network simulator.
標簽： implementation Optimized protocol UM-OLSR
上傳時間： 2016-11-06
上傳用戶：zaizaibang
本備忘錄說明了OSPF協議版本2。OSPF是一種連接狀態/LINK-state路由協議，被設計用于單一的自制系統/Autonomous System中。每個OSPF路由器都維持著同樣的數據庫以描述AS的拓撲結構，并以此數據庫來創建最短路徑樹并計算路由表。
標簽： OSPF LINK-state 協議 版本
上傳時間： 2017-09-19
上傳用戶：youlongjian0
J-Link用戶手冊(中文)，是學習ARM開發的好東知。
上傳時間： 2013-04-24
上傳用戶：mingaili888
·摘要： 針對DSP芯片TS201的LINK口互連在高速數據通信中存在數據錯誤、突發數據塊傳輸不穩定等缺點,在分析其通信協議的基礎上,并結合實際應用,提出了設計LINK口通信的關鍵要求,給出設計的要點,設計與實現了TS201的LINK 121互連以及FPGA(Xilinx公司的XC4VFX60)與TS201 LINK口互連,得到了實際測試結果;結果表明,所設計的LINK口互連具備的優點有
上傳時間： 2013-06-08
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ST-Link仿真器驅動程序(IAR EWARM V5升級版)
上傳時間： 2013-04-24
上傳用戶：hewenzhi
J-LINK驅動程序arm v4.10b，需要的下載用用吧。
上傳時間： 2013-04-24
上傳用戶：chfanjiang
FPGA-based link layer chip S19202 configuration
標簽： configuration FPGA-based S19202 layer
上傳時間： 2013-08-18
上傳用戶：xsnjzljj
本文論述了狀態機的verilog編碼風格,以及不同編碼風格的優缺點，Steve Golson's 1994 paper, "State Machine Design Techniques for Verilog and VHDL" [1], is agreat paper on state machine design using Verilog, VHDL and Synopsys tools. Steve's paper alsooffers in-depth background concerning the origin of specific state machine types.This paper, "State Machine Coding Styles for Synthesis," details additional insights into statemachine design including coding style approaches and a few additional tricks.
標簽： Synthesis Machine Coding Styles
上傳時間： 2013-10-15
上傳用戶：dancnc
One of the strengths of Synplify is the Finite State Machine compiler. This is a powerfulfeature that not only has the ability to automatically detect state machines in the sourcecode, and implement them with either sequential, gray, or one-hot encoding. But alsoperform a reachability analysis to determine all the states that could possibly bereached, and optimize away all states and transition logic that can not be reached.Thus, producing a highly optimal final implementation of the state machine.
標簽： Synplicity Machine Verilog Design
上傳時間： 2013-10-23
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