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本程序是在一位全加器的基礎上設計一個16位的加法器,用Verilog HDL語言描述.
標簽： Verilog HDL 程序 全加器
上傳時間： 2013-12-03
上傳用戶：moerwang
SSI對從外設器件接收到的數據執行串行到并行轉換。CPU可以訪問SSI數據寄存器來發送和獲得數據。發送和接收路徑利用內部FIFO存儲單元進行緩沖，以允許最多8個16位的值在發送和接收模式中獨立地存儲。 使用 ssi 控制1位數碼管的顯示
標簽： SSI FIFO CPU 發送
上傳時間： 2014-01-24
上傳用戶：pinksun9
本源代碼演示了通過串口利用MPI協議與西門子PLC S7-300系統通訊的實現方式。
標簽： MPI 300 PLC 源代碼
上傳時間： 2013-12-28
上傳用戶：風之驕子
本設計是用32位的并行全加器的,可以實現浮點運算!
標簽： 并行 全加器 浮點運算
上傳時間： 2014-01-22
上傳用戶：WMC_geophy
串補的次同步振蕩的研究及其仿真的論文十分好的東西
標簽： 仿真 論文 十分
上傳時間： 2017-09-27
上傳用戶：yy541071797
基于DSP高頻通訊全橋開關電源的研究與設計，輸出可驅動幾KV，10A以上大功率負載
標簽： DSP 開關電源
上傳時間： 2015-04-13
上傳用戶：1791623988
標簽： DSP 全橋開關 大功率 電源
移相全橋DC_DC變換器的應用研究_趙文武 (1).pdf
標簽： 變換器
上傳時間： 2015-04-29
上傳用戶：dotsmall
開關電源相關專輯 119冊 749M脈寬調制DC／DC全橋變換器的軟開關技術 140頁 3.3M.pdf
標簽：
上傳時間： 2014-05-05
上傳用戶：時代將軍
開關電源相關專輯 119冊 749M脈寬調制DC_DC全橋變換器的軟開關》 140頁 2.7M.pdf
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