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  • 數字頻率計是一種用來測試周期性變化信號工作頻率的裝置。其原理是在規定的單位時間(閘門時間)內

    數字頻率計是一種用來測試周期性變化信號工作頻率的裝置。其原理是在規定的單位時間(閘門時間)內,記錄輸入的脈沖的個數。我們可以通過改變記錄脈沖的閘門時間來切換測頻量程。本文利用EDA技術中的Max+plusⅡ作為開發工具,設計了基于FPGA的8位十進制頻率計,并下載到在系統可編程實驗板的EPF10K20TC144-4器件中測試實現了其功能。

    標簽: 數字頻率計 周期 變化 信號

    上傳時間: 2013-12-31

    上傳用戶:1079836864

  • 生成Trick文件工具 1.Open command line 2.input tricktest Usage: TrickTest -f -o -i -f source mpeg2 fil

    生成Trick文件工具 1.Open command line 2.input tricktest Usage: TrickTest -f -o -i -f source mpeg2 file to trick -o trick output directory -i output file id -m max coding error, default 0 -b max bitrate for trick generate, default 0 mean no limit -s trick buffer block size, must be n*188 -l log file, default c:\tricktest.log example: tricktest -f 黑鷹行動.mpg -o c:\temp -i A -m 1000 -b 3750000 soure file: 黑鷹行動.mpg output directory: c:\temp filename: 000000A,000000A.ff,000000A.fr,000000A.vvx max coding error: 1000 trick generation speed: 3750000 bps a

    標簽: TrickTest tricktest command source

    上傳時間: 2014-01-23

    上傳用戶:水口鴻勝電器

  • 系統介紹EDA技術的發展概述

    系統介紹EDA技術的發展概述,相關概念,VHDL語言、MAX+PULS、QUARTUS的設計方法。

    標簽: EDA 發展

    上傳時間: 2017-06-25

    上傳用戶:003030

  • 三: 針對帶表頭結點的單鏈表

    三: 針對帶表頭結點的單鏈表,試編寫下列函數。 (1) 定位函數Locate:在單鏈表中尋找第i個結點。若找到,則函數返回第i個結點的地址;若找不到,則函數返回NULL。 (2) 求最大值函數max:通過一趟遍歷在單鏈表中確定值最大的結點。 (3) 統計函數number:統計單鏈表中具有給定值x的所有元素。 (4) 建立函數create:根據一維數組a[n]建立一個單鏈表,使單鏈表中各元素的次序與a[n]中各元素的次序相同,要求該程序的時間復雜性為O(n)。 (5) 整理函數tidyup:在非遞減有序的單鏈表中刪除值相同的多余結點。

    標簽: 表頭 單鏈表

    上傳時間: 2017-07-20

    上傳用戶:CSUSheep

  • 文中介紹了QPSK調制解調的原理

    文中介紹了QPSK調制解調的原理,并基于FPGA實現了QPSK調制解調電路。MAX+PLUSII環境下的仿真結果表明了該設計的正確性。

    標簽: QPSK 調制解調

    上傳時間: 2017-08-08

    上傳用戶:hoperingcong

  • 秒信號發生器

    秒信號發生器,供初學者了解vhdl的編程方法,程序非常簡單。編程環境使用Max+Plus IIV10.12

    標簽: 信號發生器

    上傳時間: 2014-01-17

    上傳用戶:xinzhch

  • 使用VHDL語言編寫的簡易數字存儲示波器

    使用VHDL語言編寫的簡易數字存儲示波器,用MAX+PlusII仿真驗證。VHDL編寫了采樣、存儲寫、存儲讀和顯示4個模塊。采樣使用ADC0809,存儲器使用6264,顯示使用DAC0832。

    標簽: VHDL 語言 編寫 數字存儲示波器

    上傳時間: 2014-12-22

    上傳用戶:李夢晗

  • 實現簡單CPU功能的源碼

    實現簡單CPU功能的源碼,可以實現加減乘除和移位功能,VHDL代碼,程序運行在MAX PULS和Quartua上。

    標簽: CPU 源碼

    上傳時間: 2017-08-17

    上傳用戶:wab1981

  • 賦權有向圖中心問題 問題描述: 設G=(V,E)是一個賦權有向圖

    賦權有向圖中心問題 問題描述: 設G=(V,E)是一個賦權有向圖,v是G的一個頂點, v的偏心距定義為: Max {w∈ V,從w到v的最短路徑長度} G中偏心距最小的頂點稱為G的中心。試利用Floyd 算法設計一個求賦權有向圖中心的算法。

    標簽:

    上傳時間: 2017-08-17

    上傳用戶:klin3139

  • 該系統利用VHDL語言、PLD設計出租車計費系統

    該系統利用VHDL語言、PLD設計出租車計費系統,以MAX+PLUSⅡ軟件作為開發平臺,設計了出租車計費器系統程序并進行了程序仿真。使其實現計費以及預置和模擬汽車啟動、停止、暫停等功能,并動態掃描顯示車費數目。

    標簽: VHDL PLD 出租車計費系統

    上傳時間: 2017-08-30

    上傳用戶:kernaling

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