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PCI 總線學習筆記

  • PCI橋接IP Core的VeriIog HDL實現

    PCI總線是目前最為流行的一種局部性總線 通過對PCI總線一些典型功能的分析以及時序的闡述,利用VetilogHDL設計了一個將非PCI功能設備轉接到PC1總線上的IP Core 同時,通過在ModeISim SE PLUS 6.0 上運行測試程序模塊,得到了理想的仿真數據波形,從軟件上證明了功能的實現。

    標簽: VeriIog Core PCI HDL

    上傳時間: 2014-12-30

    上傳用戶:himbly

  • PCI總線的應用

    The PCI Special Interest Group disclaims all warranties and liability for the use of this document and the information contained herein and assumes no responsibility for any errors that may appear in this document, nor does the PCI Special Interest Group make a commitment to update the information contained herein.

    標簽: PCI 總線

    上傳時間: 2013-11-01

    上傳用戶:KSLYZ

  • PCI總線規范及其接口

    作為一種獨立于處理器的局部總線,PCI非常適用于網絡適配器、硬盤驅動器、全動態視頻卡、圖形卡及各類高速外設。據稱,目前有90%的Pentium處理器采用PCI做為系統總線。

    標簽: PCI 總線規范 接口

    上傳時間: 2013-11-07

    上傳用戶:liaocs77

  • 基于Virtex5的PCI接口電路

    PCI Express是由Intel,Dell,Compaq,IBM,Microsoft等PCI SIG聯合成立的Arapahoe Work Group共同草擬并推舉成取代PCI總線標準的下一代標準。PCI Express利用串行的連接特點能輕松將數據傳輸速度提到一個很高的頻率,達到遠遠超出PCI總線的傳輸速率。一個PCI Express連接可以被配置成x1,x2,x4,x8,x12,x16和x32的數據帶寬。x1的通道能實現單向312.5 MB/s(2.5 Gb/s)的傳輸速率。Xilinx公司的Virtex5系列FPGA芯片內嵌PCI-ExpressEndpoint Block硬核,為實現單片可配置PCI-Express總線解決方案提供了可能?! ”疚脑谘芯縋CI-Express接口協議和PCI-Express Endpoint Block硬核的基礎上,使用Virtex5LXT50 FPGA芯片設計PCI Express接口硬件電路,實現PCI-Express數據傳輸

    標簽: Virtex5 PCI 接口電路

    上傳時間: 2013-12-27

    上傳用戶:wtrl

  • XAPP708 -133MHz PCI-X到128MB DDR小型DIMM存儲器橋

      The Virtex-4 features, such as the programmable IDELAY and built-in FIFO support, simplifythe bridging of a high-speed, PCI-X core to large amounts of DDR-SDRAM memory. Onechallenge is meeting the PCI-X target initial latency specification. PCI-X Protocol Addendum tothe PCI Local Bus Specification Revision 2.0a ([Ref 6]) dictates that when a target signals adata transfer, "the target must do so within 16 clocks of the assertion of FRAME#." PCItermination transactions, such as Split Response/Complete, are commonly used to meet thelatency specifications. This method adds complexity to the design, as well as additional systemlatency. Another solution is to increase the ratio of the memory frequency to the PCI-X busfrequency. However, this solution increases the required power and clock resource usage.

    標簽: PCI-X XAPP DIMM 708

    上傳時間: 2013-11-24

    上傳用戶:18707733937

  • PCI-PCI橋在線讀寫EEPROM的技巧

      PCI-PCI 橋啟動時,一般需要從EEPROM 預讀取配置數據。更改EEPROM中的數據一般需要專用的燒結器,這給調試過程帶來不便。尤其是采用表貼封裝的EEPROM。本文以Intel 公司的Dec21554PCI-PCI 橋為例,介紹一種在線讀寫EEPROM 的方法。EEPROM選用的是ATMEL 公司生產的AT93LC66,4Kbit,按512×8bit 組織。

    標簽: PCI-PCI EEPROM 在線讀寫

    上傳時間: 2013-11-08

    上傳用戶:trepb001

  • pci e PCB設計規范

    This document provides practical, common guidelines for incorporating PCI Express interconnect layouts onto Printed Circuit Boards (PCB) ranging from 4-layer desktop baseboard designs to 10- layer or more server baseboard designs. Guidelines and constraints in this document are intended for use on both baseboard and add-in card PCB designs. This includes interconnects between PCI Express devices located on the same baseboard (chip-to-chip routing) and interconnects between a PCI Express device located “down” on the baseboard and a device located “up” on an add-in card attached through a connector. This document is intended to cover all major components of the physical interconnect including design guidelines for the PCB traces, vias and AC coupling capacitors, as well as add-in card edge-finger and connector considerations. The intent of the guidelines and examples is to help ensure that good high-speed signal design practices are used and that the timing/jitter and loss/attenuation budgets can also be met from end-to-end across the PCI Express interconnect. However, while general physical guidelines and suggestions are given, they may not necessarily guarantee adequate performance of the interconnect for all layouts and implementations. Therefore, designers should consider modeling and simulation of the interconnect in order to ensure compliance to all applicable specifications. The document is composed of two main sections. The first section provides an overview of general topology and interconnect guidelines. The second section concentrates on physical layout constraints where bulleted items at the beginning of a topic highlight important constraints, while the narrative that follows offers additional insight.  

    標簽: pci PCB 設計規范

    上傳時間: 2014-01-24

    上傳用戶:s363994250

  • PCI-E8622數據采集卡的功能介紹

    PCI-E是一種高速傳輸總線形式。

    標簽: PCI-E 8622 數據采集卡

    上傳時間: 2013-12-18

    上傳用戶:宋桃子

  • PCI-1734快速安裝使用手冊

    PCI-1734快速安裝使用手冊PCI-1734快速安裝使用手冊PCI-1734快速安裝使用手冊PCI-1734快速安裝使用手冊PCI-1734快速安裝使用手冊PCI-1734快速安裝使用手冊PCI-1734快速安裝使用手冊

    標簽: 1734 PCI 安裝使用

    上傳時間: 2013-10-22

    上傳用戶:ssz1990

  • 基于PCI Express總線高速數據采集卡的設計與實現

    本文介紹一種基于PCI Express 總線的高速數據采集卡的設計方案及功能實現。給出系統的基本結構及單元組成,重點闡述系統硬件設計的關鍵技術和本地總線的控制邏輯,詳細探討了基于DriverWorks 的設備驅動程序的開發以及上層應用軟件的設計。該系統通過實踐驗證,可用于衛星下行高速數據的接收并可適用于其他高速數據采集與處理系統。關鍵詞:PCI Express 總線 PCIE PEX8311 DMA 板卡驅動 隨著空間科學和空間電子學技術的飛速發展,空間科學實驗的種類和數量以及科學實驗所產生的數據量不斷增加。為了使地面接收處理系統能夠實時處理和顯示科學圖像數據,必須要設計出新的地面數據接收處理系統,實現大量高速數據的正確接收采集、處理以及存儲。為了滿足地面系統的要求,并為以后的計算機系統升級提供更廣闊的空間,本系統擬采用第三代I/O 互連技術PCI Express(簡稱PCI-E)作為本數據采集卡的進機總線形式。本文通過對PCI-E 總線專用接口芯片PLX 公司的PEX8311 性能分析,特別是對突發讀、寫和DMA讀操作的時序研究,設計出本地總線的可編程控制邏輯,并詳細討論了整個PCI-E 高速數據采集卡的硬件設計方案,以及WDM 驅動程序和上層應用程序的設計方法。

    標簽: Express PCI 總線 卡的設計

    上傳時間: 2013-10-28

    上傳用戶:tianyi996

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