PF,EPF,UPF的對比仿真代碼,可以很直觀的看出各種算法之間的差別及各自的優缺點。可直接運行。
上傳時間: 2017-01-22
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關于粒子濾波(PF)的matlab程序,說明了粒子濾波的基本算法。
上傳時間: 2014-12-08
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卡爾曼濾波的程序,里面有跟蹤點的,算法有UKF,EKF,PF,蠻好用的。。。。。。。。
標簽: 卡爾曼濾波
上傳時間: 2016-04-10
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PM2026 規格書PM2026是一款高性能、高效率、高PF值的無頻 閃LED線性恒流驅動芯片,電源系統結構簡單, 只需很少的外圍元件就可以實現非常優秀的恒 流特性。在實現精簡的外圍電路、較小的驅動器 體積的同時,大大降低了系統成本。 PM2026內部集成了我司專利的雙路開關恒流源 在實現高PF的同時消除了輸出電流紋波。另外芯 片采用高壓直供電技術,不用外接電阻電容。
上傳時間: 2022-06-10
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隨著工業電力電子技術的發展,電力系統中的非線性負載越來越多,由此帶來的諧波公害越來越嚴重。應用現代技術對諧波等進行經濟、有效地補償是目前急待解決的重要問題之一。消除諧波的方法是加裝濾波裝置。對高壓大容量諧波源國內外目前主要是采用LC諧振型無源濾波器(PassivePowerFilter,PF),這些濾波器還兼有無功和負序補償功能。盡管PF具有初期投資小、運行效率高等優點,但其濾波效果受電力系統阻抗的影響較大,且只能消除特定次數的諧波,對于諧波次數經常變化的負載濾波效果不好,還可能與系統發生串聯、并聯諧振,導致諧波放大,使LC濾波器過載甚至燒毀。進入80年代以后,隨著有源濾波技術的不斷深入和用戶對諧波問題的重視,以及電力電子技術的飛速發展,大功率可關斷器件(GTR,GTO,IGBT等)的不斷進步,有源電力濾波器(ActivePowerFilter,APF)作為抑制電網諧波、補償供電系統無功功率的新型電力電子裝置得到迅速發展,其中又以并聯型有源電力濾波器的使用最為廣泛。 本文以并聯型注入式混合有源濾波器為基礎,就其設計與應用的幾項重要技術進行了研究,論文主要包括以下幾個方面的內容: 1.就國內外有源濾波器的研究現狀和發展概況作了較為全面的綜述,介紹了目前研究的熱點與難點。 2.研究了各型有源濾波器的基本拓撲結構和運行原理,分析了其各自的優缺點。 3.提出了一種適合大容量工程應用的混合型濾波器結構,結合工程實際完成了各組成部分的參數設計。 4.對各種諧波檢測算法進行了比較研究,提出了一種準確性較高、延時較短的新型檢測方法。 5.就APF中逆變器的PWM調制問題,提出了一種基于新的改進規則采樣法的死區補償方法。
上傳時間: 2013-07-06
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近年來,以電池作為電源的微電子產品得到廣泛使用,因而迫切要求采用低電源電壓的模擬電路來降低功耗。目前低電壓、低功耗的模擬電路設計技術正成為微電子行業研究的熱點之一。 在模擬集成電路中,運算放大器是最基本的電路,所以設計低電壓、低功耗的運算放大器非常必要。在實現低電壓、低功耗設計的過程中,必須考慮電路的主要性能指標。由于電源電壓的降低會影響電路的性能,所以只實現低壓、低功耗的目標而不實現優良的性能(如高速)是不大妥當的。 論文對國內外的低電壓、低功耗模擬電路的設計方法做了廣泛的調查研究,分析了這些方法的工作原理和各自的優缺點,在吸收這些成果的基礎上設計了一個3.3 V低功耗、高速、軌對軌的CMOS/BiCMOS運算放大器。在設計輸入級時,選擇了兩級直接共源一共柵輸入級結構;為穩定運放輸出共模電壓,設計了共模負反饋電路,并進行了共模回路補償;在偏置電路設計中,電流鏡負載并不采用傳統的標準共源-共柵結構,而是采用適合在低壓工況下的低壓、寬擺幅共源-共柵結構;為了提高效率,在設計時采用了推挽共源極放大器作為輸出級,輸出電壓擺幅基本上達到了軌對軌;并采用帶有調零電阻的密勒補償技術對運放進行頻率補償。 采用標準的上華科技CSMC 0.6μpm CMOS工藝參數,對整個運放電路進行了設計,并通過了HSPICE軟件進行了仿真。結果表明,當接有5 PF負載電容和20 kΩ負載電阻時,所設計的CMOS運放的靜態功耗只有9.6 mW,時延為16.8ns,開環增益、單位增益帶寬和相位裕度分別達到82.78 dB,52.8 MHz和76°,而所設計的BiCMOS運放的靜態功耗達到10.2 mW,時延為12.7 ns,開環增益、單位增益帶寬和相位裕度分別為83.3 dB、75 MHz以及63°,各項技術指標都達到了設計要求。
標簽: CMOSBiCMOS 低壓 低功耗
上傳時間: 2013-06-29
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反激開關電源設計解析10W以內常用RCC(自激振蕩)拓撲方式 10W-100W以內常用反激式拓撲(75W以上電源有PF值要求)
上傳時間: 2013-05-26
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設計了一種用于高速ADC中的高速高增益的全差分CMOS運算放大器。主運放采用帶開關電容共模反饋的折疊式共源共柵結構,利用增益提高和三支路電流基準技術實現一個可用于12~14 bit精度,100 MS/s采樣頻率的高速流水線(Pipelined)ADC的運放。設計基于SMIC 0.25 μm CMOS工藝,在Cadence環境下對電路進行Spectre仿真。仿真結果表明,在2.5 V單電源電壓下驅動2 PF負載時,運放的直流增益可達到124 dB,單位增益帶寬720 MHz,轉換速率高達885 V/μs,達到0.1%的穩定精度的建立時間只需4 ns,共模抑制比153 dB。
上傳時間: 2014-12-23
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電路如果存在不穩定性因素,就有可能出現振蕩。本文對比分析了傳統LDO和無片電容LDO的零極點,運用電流緩沖器頻率補償設計了一款無片外電容LDO,電流緩沖器頻率補償不僅可減小片上補償電容而且可以增加帶寬。對理論分析結果在Cadence平臺基上于CSMC0.5um工藝對電路進行了仿真驗證。本文無片外電容LDO的片上補償電容僅為3 PF,減小了制造成本。它的電源電壓為3.5~6 V,輸出電壓為3.5 V。當在輸入電源電壓6 V時輸出電流從100 μA到100 mA變化時,最小相位裕度為830,最小帶寬為4.58 MHz
上傳時間: 2014-12-24
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該電源 方案 主要 用于 LED球泡燈 ,成本低廉 PF值0.5左右.文件包含完整的BOM,變壓器參數還有PCB文件,屬于成熟方案
上傳時間: 2013-11-16
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