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PGA

PGA(ProjectofGlobalAccess)是一種國(guó)際課程體系，即全球通用證書項(xiàng)目（或PGA高中國(guó)際課程）。本項(xiàng)目通過引進(jìn)國(guó)際先進(jìn)的課程體系、教學(xué)方法和教學(xué)管理模式，并融合我國(guó)國(guó)內(nèi)高中課程的優(yōu)勢(shì)，使學(xué)生不僅掌握國(guó)內(nèi)高中大綱所要求的必備的知識(shí)要點(diǎn)，而且具備運(yùn)用學(xué)術(shù)英語進(jìn)行學(xué)術(shù)交流和研究的能力，了解熟悉國(guó)外教學(xué)方法、考評(píng)方法以及國(guó)外文化差異，提高個(gè)人綜合能力。

  • 用FPGA實(shí)現(xiàn)數(shù)字復(fù)接?肍PGA實(shí)現(xiàn)數(shù)字復(fù)接

    用FPGA實(shí)現(xiàn)數(shù)字復(fù)接?肍PGA實(shí)現(xiàn)數(shù)字復(fù)接

    標(biāo)簽： FPGA PGA 數(shù)字復(fù)接

    上傳時(shí)間： 2015-06-08

    上傳用戶：wendy15

  • FPGA實(shí)現(xiàn)FFT算法 F PGA實(shí)現(xiàn)FFT算法

    FPGA實(shí)現(xiàn)FFT算法 F PGA實(shí)現(xiàn)FFT算法

    標(biāo)簽： FFT FPGA PGA 算法

    上傳時(shí)間： 2015-12-18

    上傳用戶：mpquest

  • NXP P89V51 PGA硬件生成 PWM 程序...

    NXP P89V51 PGA硬件生成 PWM 程序...

    標(biāo)簽： P89V51 NXP PGA PWM

    上傳時(shí)間： 2013-12-24

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  • FPGAcpld結(jié)構(gòu)分析 PGA的EDA設(shè)計(jì)方法 fPGA中的微程序設(shè)計(jì) 復(fù)雜可編程邏輯器件cpld專題講座(Ⅴ)──cpld的應(yīng)用和實(shí)現(xiàn)數(shù)字邏 一種使用fPGA設(shè)計(jì)的DRAM控制器 用cpld器件實(shí)

    FPGAcpld結(jié)構(gòu)分析 PGA的EDA設(shè)計(jì)方法 fPGA中的微程序設(shè)計(jì) 復(fù)雜可編程邏輯器件cpld專題講座(Ⅴ)──cpld的應(yīng)用和實(shí)現(xiàn)數(shù)字邏 一種使用fPGA設(shè)計(jì)的DRAM控制器 用cpld器件實(shí)現(xiàn)24位同步計(jì)數(shù)器的設(shè)計(jì)

    標(biāo)簽： cpld fPGA FPGAcpld DRAM

    上傳時(shí)間： 2017-07-20

    上傳用戶：ikemada

  • 1參考電壓需要足夠精確,推薦使用外部高精準(zhǔn)參考電壓. 2如果PGA可調(diào),增益系數(shù)一般是越小噪聲越低. 3一般最好用到滿量程,此時(shí)AD精度不浪費(fèi). 4如果有偏置,需要進(jìn)行自校. 5請(qǐng)注意

    1參考電壓需要足夠精確,推薦使用外部高精準(zhǔn)參考電壓. 2如果PGA可調(diào),增益系數(shù)一般是越小噪聲越低. 3一般最好用到滿量程,此時(shí)AD精度不浪費(fèi). 4如果有偏置,需要進(jìn)行自校. 5請(qǐng)注意在使用DEMO板調(diào)試時(shí),會(huì)由調(diào)試口導(dǎo)入PC噪聲,由信號(hào)連接線導(dǎo)入外部噪聲,因此建議使用屏蔽電纜傳輸信號(hào).

    標(biāo)簽： PGA 參考電壓 增益 系數(shù)

    上傳時(shí)間： 2017-07-24

    上傳用戶：tedo811

  • 基于FPGA的自動(dòng)增益控制視頻放大器設(shè)計(jì)

    　　采用自動(dòng)增益控制(AGC)技術(shù)實(shí)現(xiàn)的寬頻帶放大器在雷達(dá)系統(tǒng)及其他相關(guān)電子領(lǐng)域有著廣泛的應(yīng)用。　　本文詳細(xì)討論了基于FPGA和可編程增益放大器(PGA)實(shí)現(xiàn)的自動(dòng)增益控制寬帶視頻放大器的設(shè)計(jì)及實(shí)現(xiàn)方法。首先給出了自動(dòng)增益控制寬帶放大器取樣反饋、數(shù)字控制部分的多種實(shí)現(xiàn)方案，并根據(jù)實(shí)際應(yīng)用情況及性能指標(biāo)要求進(jìn)行了方案論證。接著，分別介紹了模擬通道部分、數(shù)字取樣模塊、FPGA邏輯控制模塊及數(shù)模轉(zhuǎn)換模塊，包括它們的芯片選擇、實(shí)現(xiàn)方法和注意事項(xiàng)等。最后，對(duì)FPGA邏輯控制模塊進(jìn)行了功能分解，并以XilinxISE和Modelsim為開發(fā)平臺(tái)完成了其子模塊的程序設(shè)計(jì)及相關(guān)階段的仿真。　　本文實(shí)現(xiàn)的電路板可對(duì)帶寬達(dá)40M的信號(hào)進(jìn)行平穩(wěn)的放大并輸出較平坦的信號(hào)波形。同時(shí)，該電路板具有自動(dòng)增益及固定增益選擇能力。當(dāng)選擇自動(dòng)增益方式時(shí)，增益的改變通過增益同步脈沖觸發(fā)，觸發(fā)脈沖可由系統(tǒng)內(nèi)部周期產(chǎn)生或外部提供。

    標(biāo)簽： FPGA 自動(dòng)增益控制 放大器設(shè)計(jì) 視頻

    上傳時(shí)間： 2013-06-05

    上傳用戶：acon

  • FPGAcpld結(jié)構(gòu)分析 fPGA的EDA設(shè)計(jì)方法

    FPGAcpld結(jié)構(gòu)分析 PGA的EDA設(shè)計(jì)方法 fPGA中的微程序設(shè)計(jì) 復(fù)雜可編程邏輯器件cpld專題講座(Ⅴ)──cpld的應(yīng)用和實(shí)現(xiàn)數(shù)字邏 一種使用fPGA設(shè)計(jì)的DRAM控制器 用cpld器件實(shí)現(xiàn)24位同步計(jì)數(shù)器的設(shè)計(jì)

    標(biāo)簽： FPGAcpld fPGA EDA 結(jié)構(gòu)分析

    上傳時(shí)間： 2013-08-10

    上傳用戶：yph853211

  • 高精度ADC

    特征： 分辨率： 24 位（無失碼） 有效位數(shù)： 21位（ PGA = 128 特征： 分辨率：24位（無失碼） 有效位數(shù)：21位 輸出碼率：10Hz/80Hz（可選） 通道固定增益：128倍 對(duì)50Hz、60Hz噪聲抑制：-100dB 工作電壓：2.5v – 6v 可選擇的內(nèi)外置晶振 簡(jiǎn)單的SPI接口 應(yīng)用場(chǎng)合： 電子秤、數(shù)字壓力傳感器； 血壓計(jì)等醫(yī)療儀器； 微弱信號(hào)測(cè)量及工業(yè)控制 其他相關(guān)資料需求：18938649401@189.cn 18938649401

    標(biāo)簽： ADC 高精度

    上傳時(shí)間： 2013-11-19

    上傳用戶：英雄

  • IC封裝製程簡(jiǎn)介(IC封裝制程簡(jiǎn)介)

    半導(dǎo)體的產(chǎn)品很多，應(yīng)用的場(chǎng)合非常廣泛，圖一是常見的幾種半導(dǎo)體元件外型。半導(dǎo)體元件一般是以接腳形式或外型來劃分類別，圖一中不同類別的英文縮寫名稱原文為   PDID：Plastic Dual Inline Package SOP：Small Outline Package SOJ：Small Outline J-Lead Package PLCC：Plastic Leaded Chip Carrier QFP：Quad Flat Package PGA：Pin Grid Array BGA：Ball Grid Array         雖然半導(dǎo)體元件的外型種類很多，在電路板上常用的組裝方式有二種，一種是插入電路板的銲孔或腳座，如PDIP、PGA，另一種是貼附在電路板表面的銲墊上，如SOP、SOJ、PLCC、QFP、BGA。    從半導(dǎo)體元件的外觀，只看到從包覆的膠體或陶瓷中伸出的接腳，而半導(dǎo)體元件真正的的核心，是包覆在膠體或陶瓷內(nèi)一片非常小的晶片，透過伸出的接腳與外部做資訊傳輸。圖二是一片EPROM元件，從上方的玻璃窗可看到內(nèi)部的晶片，圖三是以顯微鏡將內(nèi)部的晶片放大，可以看到晶片以多條銲線連接四周的接腳，這些接腳向外延伸並穿出膠體，成為晶片與外界通訊的道路。請(qǐng)注意圖三中有一條銲線從中斷裂，那是使用不當(dāng)引發(fā)過電流而燒毀，致使晶片失去功能，這也是一般晶片遭到損毀而失效的原因之一。   圖四是常見的LED，也就是發(fā)光二極體，其內(nèi)部也是一顆晶片，圖五是以顯微鏡正視LED的頂端，可從透明的膠體中隱約的看到一片方型的晶片及一條金色的銲線，若以LED二支接腳的極性來做分別，晶片是貼附在負(fù)極的腳上，經(jīng)由銲線連接正極的腳。當(dāng)LED通過正向電流時(shí)，晶片會(huì)發(fā)光而使LED發(fā)亮，如圖六所示。     半導(dǎo)體元件的製作分成兩段的製造程序，前一段是先製造元件的核心─晶片，稱為晶圓製造；後一段是將晶中片加以封裝成最後產(chǎn)品，稱為IC封裝製程，又可細(xì)分成晶圓切割、黏晶、銲線、封膠、印字、剪切成型等加工步驟，在本章節(jié)中將簡(jiǎn)介這兩段的製造程序。

    標(biāo)簽： 封裝 IC封裝 制程

    上傳時(shí)間： 2014-01-20

    上傳用戶：蒼山觀海

  • 單片機(jī)快速進(jìn)階-C8051F02X系列單片機(jī)基本應(yīng)用指導(dǎo)系統(tǒng)

    主要特性：1.高速、流水線結(jié)構(gòu)的8051兼容的CIP-51內(nèi)核（可達(dá)25MIPS）2.全速、非侵入式在系統(tǒng)調(diào)試接口（片內(nèi)）3.真正10位、100ksps的8通道ADC，帶PGA和模擬多路開關(guān)4.兩個(gè)12位DAC，可編程更新時(shí)序5.64K字節(jié)可在系統(tǒng)編程的FLASH存儲(chǔ)器6.4352（4096＋256）字節(jié)的片內(nèi)RAM7.可尋址64K字節(jié)地址空間的外部數(shù)據(jù)存儲(chǔ)器接口8.硬件實(shí)現(xiàn)的SPI、SMBUS/I2C和兩個(gè)UART串行接口9.5個(gè)通用的16位定時(shí)器10.具有5個(gè)捕捉/比較模塊的可編程計(jì)數(shù)器/定時(shí)器陣列11.片內(nèi)看門狗定時(shí)器、VDD監(jiān)視器和溫度傳感器

    標(biāo)簽： 8051 單片機(jī) 02 進(jìn)階

    上傳時(shí)間： 2014-12-27

    上傳用戶：neu_liyan

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