這是QuickLogic公司的直接頻率合成（DDS）Verilog代碼
標簽： QuickLogic Verilog DDS 頻率合成
上傳時間： 2013-12-19
上傳用戶：JIUSHICHEN
該文檔是QuickLogic的一篇關于用FPGA實現DDS的設計指導。
標簽： QuickLogic FPGA DDS 文檔
上傳時間： 2013-12-20
上傳用戶：123啊
VHDL examples for counter design, use QuickLogic eclips
標簽： QuickLogic examples counter design
上傳時間： 2016-10-05
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直接頻率合成，QuickLogic提供,部分源文件是QuickLogic 專用文件
標簽： 頻率合成
上傳時間： 2014-02-08
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PCI總線仲裁參考設計，QuickLogic提供的verilog代碼
標簽： PCI 總線仲裁 參考設計
上傳時間： 2015-04-14
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