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RISC-v

RISC-v（發(fā)音為“risk-five”）是一個基于精簡指令集（RISC）原則的開源指令集架構(gòu)（ISA）。

80C51便攜式產(chǎn)品中的低功耗設(shè)計

80C51單片機由于功能全面、開發(fā)工具較為完善、衍生產(chǎn)品豐富、大量的設(shè)計資源可以繼承和共享，得到廣泛的應(yīng)用。我們設(shè)計的一款手持線PDA產(chǎn)品，也選擇80C51單片機作為主、輔CPU，還具備點陣液晶顯示屏、導電橡膠鍵盤、雙IC卡接口、EEPROM存儲器、實時時鐘和串行通信口。由于使用80C51單片機開發(fā)，高級語言編程，大大降低了設(shè)計的技術(shù)風險，產(chǎn)品在較短的時間內(nèi)就推向了市場。但是，同一些低速的微控制器（如4位單片機）和高速的RISC處理器相比，80C51單片機在功耗上沒有優(yōu)勢。為了在PDA類產(chǎn)品中發(fā)揮80C51單片機的上述特長，我們通過采取軟、硬件配合的一系列措施，加強低電壓、低功耗設(shè)計，取得了良好的效果。該機使用一顆3V鈕扣式鋰電池，開機時工作電池小于4mA，瞬間最大工作電流小于20mA,瞬間最大工作電流小于20mA，關(guān)機電流小于2μA。一顆電池可以使用較長的時間，達到滿意的設(shè)計指標。一、低電壓低功耗設(shè)計理論在一個器件中，功耗通常用電流消耗來表示。下式表明消耗的電池與器件特性之間的關(guān)系：Icc = C ∫ Vda ≈ ΔV · C · f （1）式中：Icc是器件消耗的電流；Δ是電壓變化的幅值；C是器件電容和輸出容性負載的大小；f是器件運行頻率。從公式（1）可以得到降低系統(tǒng)功耗的理論依據(jù)。將器件供電電壓從5V降低3V，可以至少降低40%的功耗。降低器件的工作頻率，也能成比例地降低功耗。

標簽： 80C51 便攜式產(chǎn)品低功耗設(shè)計

上傳時間： 2013-10-13

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Cyclone V FPGA：采用低功耗28nm FPGA減少總系統(tǒng)成本

本文主要介紹Cyclone V FPGA的一個很明顯的特性，也可以說是一個很大的優(yōu)勢，即：采用低功耗28nm FPGA減少總系統(tǒng)成本

標簽： FPGA Cyclone 28 nm

上傳時間： 2013-10-26

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Arria V系列 FPGA芯片白皮書（英文）

　　Arria V系列 FPGA芯片基本描述　　（1）28nm FPGA，在成本、功耗和性能上達到均衡；　　（2）包括低功耗6G和10G串行收發(fā)器；　　（3）總功耗比6G Arria II FPGA低40%；　　（4）豐富的硬核IP模塊，提高了集成度　　（5）目前市場上支持10.3125Gbps收發(fā)器技術(shù)、功耗最低的中端FPGA。

標簽： Arria FPGA V系列芯片

上傳時間： 2013-10-26

上傳用戶：wsq921779565
基于Arria V和Cyclone V精度可調(diào)DSP模塊的高性能DSP應(yīng)用與實現(xiàn)

本文是基于Arria V和Cyclone V精度可調(diào)DSP模塊的高性能DSP應(yīng)用與實現(xiàn)（英文資料）

標簽： DSP Cyclone Arria 精度可調(diào)

上傳時間： 2014-12-28

上傳用戶：CHINA526
Altera公司 Cyclone V 28nm FPGA功耗優(yōu)勢

Cyclone V FPGA功耗優(yōu)勢：采用低功耗28nm FPGA活的最低系統(tǒng)功耗（英文資料）

標簽： Cyclone Altera FPGA 28

上傳時間： 2013-11-23

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Stratix V FPGA 28 nm創(chuàng)新技術(shù)超越摩爾定律

　　本白皮書介紹 Stratix V FPGA 是怎樣幫助用戶提高帶寬同時保持其成本和功耗預算不變。在工藝方法基礎(chǔ)上，Altera 利用 FPGA 創(chuàng)新技術(shù)超越了摩爾定律，滿足更大的帶寬要求，以及成本和功耗預算。Altera Stratix ® V FPGA 通過 28-Gbps 高功效收發(fā)器突破了帶寬限制，支持用戶使用嵌入式 HardCopy ®模塊將更多的設(shè)計集成到單片F(xiàn)PGA中，部分重新配置功能還提高了靈活性。

標簽： Stratix FPGA 28 創(chuàng)新技術(shù)

上傳時間： 2013-10-30

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Altera公司 Stratix V GX FPGA開發(fā)板電路圖

本資料是關(guān)于Altera公司 Stratix V GX FPGA開發(fā)板電路圖的資料。資料包括開發(fā)板原理圖、PCB圖。

標簽： Stratix Altera FPGA GX

上傳時間： 2014-01-22

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ACELP在RISC處理器的移植與優(yōu)化

本文首先介紹了語音編碼實現(xiàn)領(lǐng)域發(fā)展狀況，然后對DSP平臺上實現(xiàn)語音標準進行了較為詳細的研究和闡述，最后給出了基于RISC處理器平臺上語音標準的一個系統(tǒng)實現(xiàn).

標簽： ACELP RISC 處理器移植

上傳時間： 2013-10-20

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Arria V系列 FPGA芯片白皮書（英文）

　　Arria V系列 FPGA芯片基本描述　　（1）28nm FPGA，在成本、功耗和性能上達到均衡；　　（2）包括低功耗6G和10G串行收發(fā)器；　　（3）總功耗比6G Arria II FPGA低40%；　　（4）豐富的硬核IP模塊，提高了集成度　　（5）目前市場上支持10.3125Gbps收發(fā)器技術(shù)、功耗最低的中端FPGA。

標簽： Arria FPGA V系列芯片

上傳時間： 2013-10-21

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Altera公司 Cyclone V 28nm FPGA功耗優(yōu)勢

Cyclone V FPGA功耗優(yōu)勢：采用低功耗28nm FPGA活的最低系統(tǒng)功耗（英文資料）

標簽： Cyclone Altera FPGA 28

上傳時間： 2015-01-01

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