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RISC-v

RISC-v（發(fā)音為“risk-five”）是一個(gè)基于精簡指令集（RISC）原則的開源指令集架構(gòu)（ISA）。

Cyclone V FPGA：采用低功耗28nm FPGA減少總系統(tǒng)成本

本文主要介紹Cyclone V FPGA的一個(gè)很明顯的特性，也可以說是一個(gè)很大的優(yōu)勢，即：采用低功耗28nm FPGA減少總系統(tǒng)成本

標(biāo)簽： FPGA Cyclone 28 nm

上傳時(shí)間： 2013-11-11

上傳用戶：aeiouetla
基于Arria V和Cyclone V精度可調(diào)DSP模塊的高性能DSP應(yīng)用與實(shí)現(xiàn)

本文是基于Arria V和Cyclone V精度可調(diào)DSP模塊的高性能DSP應(yīng)用與實(shí)現(xiàn)（英文資料）

標(biāo)簽： DSP Cyclone Arria 精度可調(diào)

上傳時(shí)間： 2013-10-27

上傳用戶：yzy6007
Stratix V FPGA 28 nm創(chuàng)新技術(shù)超越摩爾定律

　　本白皮書介紹 Stratix V FPGA 是怎樣幫助用戶提高帶寬同時(shí)保持其成本和功耗預(yù)算不變。在工藝方法基礎(chǔ)上，Altera 利用 FPGA 創(chuàng)新技術(shù)超越了摩爾定律，滿足更大的帶寬要求，以及成本和功耗預(yù)算。Altera Stratix ® V FPGA 通過 28-Gbps 高功效收發(fā)器突破了帶寬限制，支持用戶使用嵌入式 HardCopy ®模塊將更多的設(shè)計(jì)集成到單片F(xiàn)PGA中，部分重新配置功能還提高了靈活性。

標(biāo)簽： Stratix FPGA 28 創(chuàng)新技術(shù)

上傳時(shí)間： 2013-10-08

上傳用戶：壞天使kk
Altera公司 Stratix V GX FPGA開發(fā)板電路圖

本資料是關(guān)于Altera公司 Stratix V GX FPGA開發(fā)板電路圖的資料。資料包括開發(fā)板原理圖、PCB圖。

標(biāo)簽： Stratix Altera FPGA GX

上傳時(shí)間： 2013-10-25

上傳用戶：風(fēng)為裳的風(fēng)
淺析HDMI CTS v.1.3和兼容測試中的常見問題

為了改進(jìn)產(chǎn)品性能和兼容性，最新的HDMI compliance test specification (HDMI CTS) V.1.3增加了新的測試內(nèi)容和定下了更嚴(yán)格的標(biāo)準(zhǔn)。大多數(shù)現(xiàn)在遞交給HDMI授權(quán)測試中心(ATC) 的帶有HDMI功能的電器都將按照HDMI CTS V.1.3 來測試。Analog Devices (ADI) 分別在美國的綠堡(Greensboro，NC), 東京, 臺灣和北京設(shè)立了四家預(yù)測試中心為客戶提供HDMI CT 測試以縮短客戶產(chǎn)品上市的時(shí)間。在本文中我們將討論HDMI CTS V.1.3新增加的一些重要內(nèi)容。同時(shí)我們也將著重總結(jié)一些典型測試項(xiàng)目失敗的原因和可能的修改方案。

標(biāo)簽： HDMI CTS 1.3 兼容測試

上傳時(shí)間： 2013-12-15

上傳用戶：古谷仁美
V-BY-ONE THCV219-220 參考設(shè)計(jì)

V-BY-ONE THCV219-220 參考設(shè)計(jì)

標(biāo)簽： V-BY-ONE THCV 219 220

上傳時(shí)間： 2013-11-16

上傳用戶：caoyuanyuan1818
V-BY-ONE THCV215-216 參考設(shè)計(jì)

V-BY-ONE THCV215-216 參考設(shè)計(jì)

標(biāo)簽： V-BY-ONE THCV 215 216

上傳時(shí)間： 2013-10-14

上傳用戶：ljmwh2000
V-BY-ONE THCV213-214 參考設(shè)計(jì)

V-BY-ONE THCV213-214 參考設(shè)計(jì)

標(biāo)簽： V-BY-ONE THCV 213 214

上傳時(shí)間： 2013-11-04

上傳用戶：dbs012280
V-BY-ONE應(yīng)用設(shè)計(jì)

V-BY-ONE應(yīng)用設(shè)計(jì) THCV217-218 thine LVDS

標(biāo)簽： V-BY-ONE 應(yīng)用設(shè)計(jì)

上傳時(shí)間： 2013-10-20

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8位RISC　CPU的VERILOG編程　SOURCECODE

8位RISC　CPU的VERILOG編程　SOURCECODE

標(biāo)簽： SOURCECODE VERILOG RISC CPU

上傳時(shí)間： 2015-01-09

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