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Testbench-xilinx

Xilinx FPGA集成電路的動態老化試驗

　　3 FPGA設計流程　　完整的FPGA 設計流程包括邏輯電路設計輸入、功能仿真、綜合及時序分析、實現、加載配置、調試。FPGA 配置就是將特定的應用程序設計按FPGA設計流程轉化為數據位流加載到FPGA 的內部存儲器中，實現特定邏輯功能的過程。由于FPGA 電路的內部存儲器都是基于RAM 工藝的，所以當FPGA電路電源掉電后，內部存儲器中已加載的位流數據將隨之丟失。所以，通常將設計完成的FPGA 位流數據存于外部存儲器中，每次上電自動進行FPGA電路配置加載。　　4 FPGA配置原理　　以Xilinx公司的Qpro Virtex Hi-Rel系列XQV100電路為例，FPGA的配置模式有四種方案可選擇：MasterSerial Mode，Slave Serial Mode，Master selectMAPMode，Slave selectMAP Mode。配置是通過芯片上的一組專/ 復用引腳信號完成的，主要配置功能信號如下：　　(1)M0、M1、M2：下載配置模式選擇; 　　(2)CLK：配置時鐘信號; 　　(3)DONE：顯示配置狀態、控制器件啟動;

標簽： Xilinx FPGA 集成電路動態老化

上傳時間： 2013-11-18

上傳用戶：oojj
基于Xilinx FPGA的溫控風扇的設計(原文設計、源代碼及視頻地址)

　　本設計的整體思路是：以XILINX FPGA作為控制中心，通過提取熱釋電紅外傳感器感應到的人體紅外線信息，并利用溫度傳感器DS18B20檢測環境溫度并直接輸出數字溫度信號給FPGA 進行處理，在LED數碼管上顯示當前環境溫度值以及預設溫度值。通過獨立鍵盤輸入預設溫度值，其中預設溫度值只能為整數形式，檢測到的當前環境溫度可精確到小數點后一位。同時采用PWM脈寬調制方式來改變直流風扇電機的轉速。并通過兩個按鍵改變預設溫度值，一個提高預設溫度，另一個降低預設溫度值。系統結構框圖如下：

標簽： Xilinx FPGA 溫控地址

上傳時間： 2013-11-12

上傳用戶：cjf0304
Xilinx可編程邏輯器件的高級應用與設計技巧（孫航）

　　Xilinx可編程邏輯器件的高級應用與設計技巧　　作者：孫航；出版社：電子工業出版社　　內容簡介：介紹了Xilinx器件的結構和特性；以及ISE及其輔助設計工具，嵌入式處理器的原理與設計，高速串行接口設計等內容。是一本比較全面介紹最新Xilinx器件和軟件發展的書籍。

標簽： Xilinx 可編程邏輯器件設計技巧

上傳時間： 2013-11-12

上傳用戶：笨小孩
深入剖析賽靈思（Xilinx）All Programmable三大創新器件

深入剖析賽靈思（Xilinx）All Programmable三大創新器件:賽靈思在 28nm 節點上推出的多種新技術為客戶帶來了重大的超前價值，并使賽靈思領先競爭對手整整一代。賽靈思并不是簡單地將現有的 FPGA 架構遷移到新的技術節點上，而是力求引領多種 FPGA 創新，并率先推出了 All Programmable 3D IC 和 SoC。　　今天推出的 All Programmable 產品采用了各種形式的可編程技術，包括可編程硬件和軟件、數字信號和模擬混合信號（AMS）、單晶片和多片 3D IC 方案（圖 1）。有了這些全新的 All Programmable 器件，設計團隊就能進一步提升可編程系統的集成度，提高整體系統性能，降低 BOM 成本，并以更快的速度向市場推出更具創新性的智能產品。

標簽： Programmable Xilinx All 賽靈思

上傳時間： 2013-10-29

上傳用戶：1427796291
xilinx_v5sx95t_schematics(xilinx v5 95t 開發板原理圖)

xilinx v5 95t 開發板原理圖，xilinx_v5sx95t_schematics(xilinx v5 95t 開發板原理圖)。

標簽： t_schematics xilinx_v xilinx 95t

上傳時間： 2013-10-21

上傳用戶：dljwq
Create a 1-Wire Master with Xilinx PicoBlaze

Abstract: Designers who must interface 1-Wire temperature sensors with Xilinx field-programmable gate arrays(FPGAs) can use this reference design to drive a DS28EA00 1-Wire slave device. The downloadable softwarementioned in this document can also be used as a starting point to connect other 1-Wire slave devices. The systemimplements a 1-Wire master connected to a UART and outputs temperature to a PC from the DS28EA00 temperaturesensor. In addition, high/low alarm outputs are displayed from the DS28EA00 PIO pins using LEDs.

標簽： PicoBlaze Create Master Xilinx

上傳時間： 2013-11-12

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基于Xilinx公司的SOPC的以太網設計

　　1．設計（論文）的主要任務及目標　　（1）研究SOPC理論如何應用于以太網終端設計；　　（2）研究如何使用EDK軟件和IP核搭建整個設計硬件結構；　　（3）在開發板上實現以太網終端設計，驗證整個結論。　　2．設計（論文）的基本要求和內容　　（1）符合以太網設計的基本概念和原理；　　（2）能準確運用EDK軟件在嵌入式系統設計中的優勢；　　（3）選取合適的對象，并構造合理的以太網模型。圖 Xilinx的SOPC設計流程

標簽： Xilinx SOPC 以太網

上傳時間： 2013-12-20

上傳用戶：qwer0574
verilog testbench設計技巧和策略

verilog testbench設計技巧和策略

標簽： testbench verilog 設計技巧策略

上傳時間： 2013-12-24

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編寫高效率的testbench

編寫高效率的testbench

標簽： testbench 編寫高效率

上傳時間： 2013-10-29

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FPGA全局時鐘約束(Xilinx)

FPGA全局時鐘約束(Xilinx)

標簽： Xilinx FPGA 全局時鐘約束

上傳時間： 2013-10-10

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