關(guān)于FPGA的一些常識(shí)及含IP核的VHDL設(shè)計(jì)源代碼。
標(biāo)簽： FPGA VHDL 常識(shí) IP核
上傳時(shí)間： 2013-12-11
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VHDL中IP核之參數(shù)化觸發(fā)器中文使用介紹
標(biāo)簽： VHDL IP核 參數(shù) 觸發(fā)器
上傳時(shí)間： 2014-01-16
上傳用戶：宋桃子
VHDL中IP核之參數(shù)化加減法器中文使用介紹
標(biāo)簽： VHDL IP核 參數(shù) 減法器
上傳時(shí)間： 2014-01-15
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VHDL中LPM（參數(shù)化）庫(kù)中文使用介紹
標(biāo)簽： VHDL LPM 參數(shù)
上傳時(shí)間： 2013-12-20
上傳用戶：mhp0114
《Digital Logic And Microprocessor Design With VHDL》，CPU設(shè)計(jì)經(jīng)典參考書(shū)
標(biāo)簽： Microprocessor Digital Design Logic
上傳時(shí)間： 2013-11-29
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vhdl波形發(fā)生程序.實(shí)現(xiàn)4種常見(jiàn)波形正弦、三角、鋸齒、方波（A、B）的頻率、幅度可控輸出（方波 A的占空比也是可控的），可以存儲(chǔ)任意波形特征數(shù)據(jù)并能重現(xiàn)該波形，還可完成 各種波形的線形疊加輸出。
標(biāo)簽： vhdl 方波 波形發(fā)生 波形
上傳時(shí)間： 2015-07-10
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三十個(gè)vhdl源碼，對(duì)于剛開(kāi)始學(xué)習(xí)vhdl的很有幫助，可以幫助理解數(shù)字電路
標(biāo)簽： vhdl 源碼
上傳時(shí)間： 2014-01-21
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ddr_sdram控制器的vhdl代碼,里面的地址和數(shù)據(jù)長(zhǎng)度可配置,能滿足不同用戶的需要.
標(biāo)簽： ddr_sdram vhdl 控制器 代碼
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crack for ModelSim, a Verilog, VHDL and mixed VHDL / Verilog CAD simulator for FPGA, board and IC design.
標(biāo)簽： Verilog VHDL and for
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數(shù)字系統(tǒng)與VHDL程序設(shè)計(jì)語(yǔ)言[PPT教程] ， 非常有用．
標(biāo)簽： VHDL 數(shù)字系統(tǒng) 教程
上傳時(shí)間： 2014-01-09
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