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Veriloghdl

  • 基于FPGA的CAN總線控制器

    基于FPGA的CAN總線控制器,Veriloghdl源代碼,Q2仿真實現。可用。

    標簽: FPGA CAN 總線控制器

    上傳時間: 2013-12-15

    上傳用戶:kernaling

  • 在信息信號處理過程中

    在信息信號處理過程中,如對信號的過濾、檢測、預測等,都要使用濾波器,數字濾波器是數字信號處理(DSP,DigitalSignalProcessing)中使用最廣泛的一種器件。常用的濾波器有無限長單位脈沖響應(ⅡR)濾波器和有限長單位脈沖響應(FIR)濾波器兩種[1],其中,FIR濾波器能提供理想的線性相位響應,在整個頻帶上獲得常數群時延從而得到零失真輸出信號,同時它可以采用十分簡單的算法實現,這兩個優點使FIR濾波器成為明智的設計工程師的首選,在采用VHDL或Veriloghdl等硬件描述語言設計數字濾波器時,由于程序的編寫往往不能達到良好優化而使濾波器性能表現一般。而采用調試好的IPCore需要向Altera公司購買。筆者采用了一種基于DSPBuilder的FPGA設計方法,使FIR濾波器設計較為簡單易行,并能滿足設計要求。

    標簽: 信號處理 過程

    上傳時間: 2014-01-21

    上傳用戶:ruan2570406

  • 對PCM編碼的多路復用與解復用程序

    對PCM編碼的多路復用與解復用程序,Veriloghdl源程序

    標簽: PCM 編碼 多路復用 程序

    上傳時間: 2015-12-05

    上傳用戶:wendy15

  • 介紹了積分梳狀濾波器(CIC)設計

    介紹了積分梳狀濾波器(CIC)設計,壓縮包里面有程序的流程圖,采用Veriloghdl編寫,在modelsim上可以實現仿真結果,非常不錯

    標簽: CIC 積分 梳狀濾波器

    上傳時間: 2016-02-04

    上傳用戶:yxgi5

  • 介紹了CORDIC數字計算機的設計

    介紹了CORDIC數字計算機的設計,采用的是Veriloghdl,在modelsim上可以實現仿真驗證,壓縮包中包含CORDIC的工作結構圖,比較詳細

    標簽: CORDIC 數字 計算機

    上傳時間: 2014-01-03

    上傳用戶:lps11188

  • 介紹了carry_chain_adder

    介紹了carry_chain_adder,carry_skip_adder,ipple_carry_adder三種常用的加法器,采用Veriloghdl語言,利用modelsim軟件仿真驗證,壓縮包中包含有流程圖

    標簽: carry_chain_adder

    上傳時間: 2014-01-20

    上傳用戶:sunjet

  • 介紹了除法器的設計

    介紹了除法器的設計,采用Veriloghdl語言,利用modelsim仿真驗證,壓縮包中包含了流程圖

    標簽: 除法器

    上傳時間: 2016-02-04

    上傳用戶:chenlong

  • 介紹了幾種常用的乘法器的設計

    介紹了幾種常用的乘法器的設計,carry_save_mult,ripple_carry_mult等,壓縮包中包含結構流程圖,用Veriloghdl語言,采用modelsim仿真驗證

    標簽: 乘法器

    上傳時間: 2013-12-19

    上傳用戶:pompey

  • UART轉I2C的Verilog HDL代碼

    UART轉I2C的Verilog HDL代碼,由北京郵電大學《Veriloghdl設計與EDA技術基礎》教師編寫

    標簽: Verilog UART I2C HDL

    上傳時間: 2014-08-03

    上傳用戶:zhuoying119

  • 24C01A的Verilog HDL仿真代碼

    24C01A的Verilog HDL仿真代碼,用于I2C接口模塊的測試,由北京郵電大學《Veriloghdl設計與EDA技術基礎》教師編寫

    標簽: Verilog 24C01A HDL 仿真

    上傳時間: 2016-03-03

    上傳用戶:jkhjkh1982

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