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Virtex

  • Gold Code Generators in Virtex Devices

    Gold Code Generators in Virtex Devices

    標簽: Generators Devices Virtex Gold

    上傳時間: 2013-12-08

    上傳用戶:hasan2015

  • 這個設計是使用Virtex-4實現DDR的控制器的

    這個設計是使用Virtex-4實現DDR的控制器的,設計分為三個主要模塊:Front-End FIFOs,DDR SDRAM Controller和Datapath Module。其中主要是DDR SDRAM Controller,當然還有測試模塊。

    標簽: Virtex DDR 控制器

    上傳時間: 2017-05-20

    上傳用戶:llandlu

  • EDK 9.1 MicroBlaze Tutorial in Virtex-4

    EDK 9.1 MicroBlaze Tutorial in Virtex-4

    標簽: MicroBlaze Tutorial Virtex EDK

    上傳時間: 2013-11-26

    上傳用戶:xiaodu1124

  • audio file on Virtex

    audio file on Virtex

    標簽: Virtex audio file on

    上傳時間: 2013-12-20

    上傳用戶:gououo

  • interface pc to Virtex

    interface pc to Virtex

    標簽: interface Virtex pc to

    上傳時間: 2014-07-05

    上傳用戶:cx111111

  • interface on Virtex test ram

    interface on Virtex test ram

    標簽: interface Virtex test ram

    上傳時間: 2017-07-29

    上傳用戶:xuan‘nian

  • Xilinx FPGA Virtex-7 全系列(AD集成封裝庫) IntLib后綴文件 PCB封裝

    Xilinx FPGA Virtex-7 全系列(AD集成封裝庫),IntLib后綴文件,PCB封裝帶3D視圖,拆分后文件為PcbLib+SchLib格式,Altium Designer原理圖庫+PCB封裝庫,集成封裝型號列表:Library Component Count : 157Name                Description----------------------------------------------------------------------------------------------------XC7V2000T-1FHG1761C Virtex-7 FPGA, 1200 User I/Os, 36 GTX, 1760-Ball BGA, Speed Grade 1, Commerical Grade, Pb-FreeXC7V2000T-1FHG1761I Virtex-7 FPGA, 1200 User I/Os, 36 GTX, 1760-Ball BGA, Speed Grade 1, Industrial Grade, Pb-FreeXC7V2000T-1FLG1925C Virtex-7 FPGA, 1200 User I/Os, 16 GTX, 1924-Ball BGA, Speed Grade 1, Commercial Grade, Pb-FreeXC7V2000T-1FLG1925I Virtex-7 FPGA, 1200 User I/Os, 16 GTX, 1924-Ball BGA, Speed Grade 1, Industrial Grade, Pb-FreeXC7V2000T-2FHG1761C Virtex-7 FPGA, 1200 User I/Os, 36 GTX, 1760-Ball BGA, Speed Grade 2, Commerical Grade, Pb-FreeXC7V2000T-2FLG1925C Virtex-7 FPGA, 1200 User I/Os, 16 GTX, 1924-Ball BGA, Speed Grade 2, Commercial Grade, Pb-FreeXC7V2000T-2GFHG1761EVirtex-7 FPGA, 1200 User I/Os, 36 GTX, 1760-Ball BGA, Speed Grade 2G, Extended Grade, Pb-FreeXC7V2000T-2GFLG1925EVirtex-7 FPGA, 1200 User I/Os, 16 GTX, 1924-Ball BGA, Speed Grade 2G, Extended Grade, Pb-FreeXC7V2000T-2LFHG1761EVirtex-7 FPGA, 1200 User I/Os, 36 GTX, 1760-Ball BGA, Speed Grade 2L, Extended Grade, Pb-FreeXC7V2000T-2LFLG1925EVirtex-7 FPGA, 1200 User I/Os, 16 GTX, 1924-Ball BGA, Speed Grade 2L, Extended Grade, Pb-FreeXC7V585T-1FFG1157C  Virtex-7 FPGA, 850 User I/Os, 20 GTX, 1156-Ball BGA, Speed Grade 1, Commercial Grade, Pb-FreeXC7V585T-1FFG1157I  Virtex-7 FPGA, 850 User I/Os, 20 GTX, 1156-Ball BGA, Speed Grade 1, Industrial Grade, Pb-FreeXC7V585T-1FFG1761C  Virtex-7 FPGA, 850 User I/Os, 36 GTX, 1760-Ball BGA, Speed Grade 1, Commercial Grade, Pb-FreeXC7V585T-1FFG1761I  Virtex-7 FPGA, 850 User I/Os, 36 GTX, 1760-Ball BGA, Speed Grade 1, Industrial Grade, Pb-FreeXC7V585T-2FFG1157C  Virtex-7 FPGA, 850 User I/Os, 20 GTX, 1156-Ball BGA, Speed Grade 2, Commercial Grade, Pb-FreeXC7V

    標簽: xilinx fpga Virtex-7 封裝

    上傳時間: 2021-12-22

    上傳用戶:aben

  • 基于FPGA的嵌入式系統SerialATA大容量數據存儲控制器的研究.rar

    隨著信息技術的飛速發展,數據吞吐量急劇增長,要求有更高的傳輸速度,來滿足大量數據的傳輸,而原有的并行數據傳輸總線結構上存在自身無法克服的缺陷,在高頻環境下容易串擾,而增大誤碼率。SATA串行總線技術應運而生。作為一種新型的總線接口,它提供了高達3.0Gbps的數據傳輸速率,使用8B/10B編碼格式,采用LVDS NRZ串行數據傳輸方式,有良好的抗干擾性能,有更強的達到32位的循環冗余校驗,并且提供了良好的物理接口特性,支持熱拔插,代表著計算機總線接口技術的發展方向。FPGA作為一種低功耗的半導體器件,在高頻工作環境中有優良的性能,將處理器與低功耗FPGA結合起來使用是數據存儲應用的趨勢,這樣能夠使得接口方案更加靈活。而在眾多FPGA器件中,Xilinx公司的Virtex-4平臺內部集成了PowerPC高性能處理器,并且其中提供了Rocket IO MGT這種嵌入式的多速率串行收發器,能夠以6.25-622Mb/s的速度傳送數據,并且支持包括SATA協議在內的多種串行通信協議。 本文從物理層、鏈路層、傳輸層分析了SATA1.0技術的接口協議,在此基礎提出滿足協議需求和適合FPGA設計的設計方案,并給出總體設計框圖,依照FPGA的設計方法,采用Xilinx公司的Virtex-4設計了一個符合SATA1.0接口協議的嵌入式存儲裝置,實現數據的存儲,仿真運行結果正常。

    標簽: SerialATA FPGA 嵌入式系統

    上傳時間: 2013-04-24

    上傳用戶:sz_hjbf

  • 基于FPGA的圖像處理平臺及3D加速引擎的設計.rar

    3D加速引擎是3D圖形加速系統的重要組成部分,以往在軟件平臺上對3D引擎的研究,實現了復雜的渲染模型和渲染算法,但這些復雜算法與模型在FPGA上綜合實現具有一定難度,針對FPGA的3D加速引擎設計及其平臺實現需要進一步研究。 本文在研究3D加速引擎結構的基礎上,實現了基于FPGA的圖像處理平臺,使用模塊化的思想,利用IP核技術分析設計實現了3D加速管道及其他模塊,并進行了仿真、驗證、實現。 圖像處理平臺選用Virtex-Ⅳ FPGA為核心器件,并搭載了Hynix HY5DU573222F-25、AT91FR40162S、XCF32P VO48及其他組件。 為滿足3D加速引擎的實現與驗證,設計搭建的圖像處理平臺還實現了DDR-SDRAM控制器模塊、VGA輸出模塊、總線控制器模塊、命令解釋模塊、指令寄存器模塊及控制寄存器模塊。 3D加速引擎設計包含3D加速渲染管道、視角變換管道、基元讀取、頂點FIFO、基元FIFO、寫內存等模塊。針對FPGA的特性,簡化、設計、實現了光照管道、紋理管道、著色管道和Alpha融合管道。 最后使用Modelsim進行了仿真測試和圖像處理平臺上的驗證,其結果表明3D加速引擎設計的大部分功能得到實現,結果令人滿意。

    標簽: FPGA 3D加速 圖像

    上傳時間: 2013-07-30

    上傳用戶:lepoke

  • FPGA中多標準可編程IO端口的設計.rar

    現場可編程門陣列(FPGA,Field Programmable Gate Array)是可編程邏輯器件的一種,它的出現是隨著微電子技術的發展,設計與制造集成電路的任務已不完全由半導體廠商來獨立承擔。系統設計師們更愿意自己設計專用集成電路(ASIC,Application Specific Integrated Circuit).芯片,而且希望ASIC的設計周期盡可能短,最好是在實驗室里就能設計出合適的ASIC芯片,并且立即投入實際應用之中。現在,FPGA已廣泛地運用于通信領域、消費類電子和車用電子。 本文中涉及的I/O端口模塊是FPGA中最主要的幾個大模塊之一,它的主要作用是提供封裝引腳到CLB之間的接口,將外部信號引入FPGA內部進行邏輯功能的實現并把結果輸出給外部電路,并且根據需要可以進行配置來支持多種不同的接口標準。FPGA允許使用者通過不同編程來配置實現各種邏輯功能,在IO端口中它可以通過選擇配置方式來兼容不同信號標準的I/O緩沖器電路。總體而言,可選的I/O資源的特性包括:IO標準的選擇、輸出驅動能力的編程控制、擺率選擇、輸入延遲和維持時間控制等。 本文是關于FPGA中多標準兼容可編程輸入輸出電路(Input/Output Block)的設計和實現,該課題是成都華微電子系統有限公司FPGA大項目中的一子項,目的為在更新的工藝水平上設計出能夠兼容單端標準的I/O電路模塊;同時針對以前設計的I/O模塊不支持雙端標準的缺點,要求新的電路模塊中擴展出雙端標準的部分。文中以低壓雙端差分標準(LVDS)為代表構建雙端標準收發轉換電路,與單端標準比較,LVDS具有很多優點: (1)LVDS傳輸的信號擺幅小,從而功耗低,一般差分線上電流不超過4mA,負載阻抗為100Ω。這一特征使它適合做并行數據傳輸。 (2)LVDS信號擺幅小,從而使得該結構可以在2.5V的低電壓下工作。 (3)LVDS輸入單端信號電壓可以從0V到2.4V變化,單端信號擺幅為400mV,這樣允許輸入共模電壓從0.2V到2.2V范圍內變化,也就是說LVDS允許收發兩端地電勢有±1V的落差。 本文采用0.18μm1.8V/3.3V混合工藝,輔助Xilinx公司FPGA開發軟件ISE,設計完成了可以用于Virtex系列各低端型號FPGA的IOB結構,它有靈活的可配置性和出色的適應能力,能支持大量的I/O標準,其中包括單端標準,也包括雙端標準如LVDS等。它具有適應性的優點、可選的特性和考慮到被文件描述的硬件結構特征,這些特點可以改進和簡化系統級的設計,為最終的產品設計和生產打下基礎。設計中對包括20種IO標準在內的各電器參數按照用戶手冊描述進行仿真驗證,性能參數已達到預期標準。

    標簽: FPGA 標準 可編程

    上傳時間: 2013-05-15

    上傳用戶:shawvi

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