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Virtex

  • xilinx Virtex fpga設計指南

    xilinx Virtex fpga

    標簽: xilinx Virtex fpga 設計指南

    上傳時間: 2013-09-05

    上傳用戶:448949

  • XAPP946-適用于Virtex-4 RocketIO MGT的開關電源

      This document presents design techniques and reference circuits that power Virtex™-4 FXRocketIO™ multi-gigabit transceivers (MGTs) operating at data rates below 3.125 Gb/s.When using multiple transceivers, it is sometimes preferred to power them from a switchingpower supply. However, switching power supplies generate noise that affects transceiver

    標簽: RocketIO Virtex XAPP 946

    上傳時間: 2013-11-18

    上傳用戶:huang111

  • Virtex-5, Spartan-DSP FPGAs Ap

    Virtex-5, Spartan-DSP FPGAs Application Note This application note demonstrates how efficient implementations of Digital Up Converters(DUC) and Digital Down Converters (DDC) can be done by leveraging the Xilinx DSP IPportfolio for increased productivity and reduced time to development. Step-by-step instruction is given on how to perform system-level trade off analysis and develop the most efficient FPGA implementation, thus allowing engineers a flexible, low-cost and low-power alternative to ASSP technologies.

    標簽: Spartan-DSP Virtex FPGAs Ap

    上傳時間: 2013-10-23

    上傳用戶:raron1989

  • WP245 - 使用Virtex-5系列FPGA獲得更高系統性能

    Virtex™-5 器件包括基于第二代高級硅片組合模塊 (ASMBL™) 列架構的多平臺 FPGA 系列。集成了為獲得最佳性能、更高集成度和更低功耗設計的若干新型架構元件,Virtex-5 器件達到了比以往更高的系統性能水平。

    標簽: Virtex FPGA 245 WP

    上傳時間: 2013-10-29

    上傳用戶:long14578

  • XAPP228 -Virtex器件內的四端口存儲器

    This application note describes how the existing dual-port block memories in the Spartan™-IIand Virtex™ families can be used as Quad-Port memories. This essentially involves a dataaccess time (halved) versus functionality (doubled) trade-off. The overall bandwidth of the blockmemory in terms of bits per second will remain the same.

    標簽: Virtex XAPP 228 器件

    上傳時間: 2013-11-08

    上傳用戶:lou45566

  • DS306-PPC405 Virtex-4 Wrapper

    The PPC405 Virtex-4 is a wrapper around the Virtex-4PowerPC™ 405 Processor Block primitive. For detailsregarding the PowerPC 405, see the PowerPC 405 ProcessorBlock Reference Guide.

    標簽: Wrapper Virtex 306 405

    上傳時間: 2014-12-05

    上傳用戶:flg0001

  • WP373-賽靈思推出Virtex-7,Kintex-7,Artix-7三大全新系列FPGA

        賽靈思推出的三款全新產品系列不僅發揮了臺積電28nm 高介電層金屬閘 (HKMG) 高性能低功耗 (HPL) 工藝技術前所未有的功耗、性能和容量優勢,而且還充分利用 FPGA 業界首款統一芯片架構無與倫比的可擴展性,為新一代系統提供了綜合而全面的平臺基礎。目前,隨著賽靈思 7 系列 (Virtex®-7、Kintex™-7 和Artix™-7 系列) 的推出,賽靈思將系統功耗、性價比和容量推到了全新的水平,這在很大程度上要歸功于臺積電 28nm HKMG 工藝出色的性價比優勢以及芯片和軟件層面上的設計創新。結合業經驗證的 EasyPath™成本降低技術,上述新系列產品將為新一代系統設計人員帶來無與倫比的價值

    標簽: Virtex Kintex Artix FPGA

    上傳時間: 2013-11-15

    上傳用戶:chenhr

  • WWP248 - 移植到Virtex-5 FPGA的指南

      由于Virtex-5 器件的基礎架構與以往的FPGA 器件不同,因此,要為特定設計選擇合適的Virtex-5 器件并非易事。大多數情況下,設計應采用類似的陣列大小(器件數量)并且比以前的目標器件至少低一個速度級別(如從中速級別到慢速級別)。但是,這種建議對于有些情況卻并不適用。本節將介紹一些會影響Virtex-5 FPGA 器件選擇標準的設計風格和特征。

    標簽: Virtex FPGA WWP 248

    上傳時間: 2013-10-18

    上傳用戶:yuyizhixia

  • Virtex-6 的HDL設計指南

    針對Virtex-6 給出了HDL設計指南,其中,賽靈思為每個設計元素給出了四個設計方案元素,并給出了Xilinx認為是最適合你的解決方案。這4個方案包括:實例,推理,CORE Generator或者其他Wizards,宏支持.

    標簽: Virtex HDL 設計指南

    上傳時間: 2013-11-07

    上傳用戶:gy592333

  • Virtex-5 GTP Transceiver Wizar

    The LogiCORE™ GTP Wizard automates the task of creating HDL wrappers to configure the high-speed serial GTP transceivers in Virtex™-5 LXT and SXT devices. The menu-driven interface allows one or more GTP transceivers to be configured using pre-definedtemplates for popular industry standards, or from scratch, to support a wide variety of custom protocols.The Wizard produces a wrapper, an example design, and a testbench for rapid integration and verification of the serial interface with your custom function Features• Creates customized HDL wrappers to configureVirtex-5 RocketIO™ GTP transceivers• Users can configure Virtex-5 GTP transceivers toconform to industry standard protocols usingpredefined templates, or tailor the templates forcustom protocols• Included protocol templates provide support for thefollowing specifications: Aurora, CPRI, FibreChannel 1x, Gigabit Ethernet, HD-SDI, OBSAI,OC3, OC12, OC48, PCI Express® (PCIe®), SATA,SATA II, and XAUI• Automatically configures analog settings• Each custom wrapper includes example design, testbench; and both implementation and simulation scripts

    標簽: Transceiver Virtex Wizar GTP

    上傳時間: 2013-10-23

    上傳用戶:leyesome

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