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cmmI-DEV-v

  • 微星865PE-Neo2-V主板使用手冊(cè)-SC6788v2.0.pdf

    專輯類-網(wǎng)絡(luò)及電腦相關(guān)專輯-114冊(cè)-4.31G 微星865PE-Neo2-V主板使用手冊(cè)-SC6788v2.0.pdf

    標(biāo)簽: PE-Neo 6788 865

    上傳時(shí)間: 2013-04-24

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  • 用一片CPLD實(shí)現(xiàn)數(shù)字鎖相環(huán),用VHDL或V語言.rar

    用一片CPLD實(shí)現(xiàn)數(shù)字鎖相環(huán),用VHDL或V語言

    標(biāo)簽: CPLD VHDL 數(shù)字鎖相環(huán)

    上傳時(shí)間: 2013-05-27

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  • Dev C++0

    Dev-C++是一個(gè)Windows下的C和C++程序的集成開發(fā)環(huán)境。它使用MingW32/GCC編譯器,遵循C/C++標(biāo)準(zhǔn)。開發(fā)環(huán)境包括多頁面窗口、工程編輯器以及調(diào)試器等,在工程編輯器中集合了編輯器、編譯器、連接程序和執(zhí)行程序,提供高亮度語法顯示的,以減少編輯錯(cuò)誤

    標(biāo)簽: Dev

    上傳時(shí)間: 2013-07-31

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  • TMS320C32 CPU DEV Board

    TMS320C32 CPU DEV Board

    標(biāo)簽: Board 320C TMS 320

    上傳時(shí)間: 2013-09-09

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  • 分比功率架構(gòu)和V•I晶片靈活、優(yōu)越的功率系統(tǒng)方案

    當(dāng)今電子系統(tǒng)如高端處理器及記憶體,對(duì)電源的需求是趨向更低電壓、更高電流的應(yīng)用。同時(shí)、對(duì)負(fù)載的反應(yīng)速度也要提高。因此功率系統(tǒng)工程師要面對(duì)的挑戰(zhàn),是要設(shè)計(jì)出符合系統(tǒng)要求的細(xì)小、價(jià)廉但高效率的電源系統(tǒng)。而這些要求都不是傳統(tǒng)功率架構(gòu)能夠完全滿足的。Vicor提出的分比功率架構(gòu)(Factorized Power Architecture FPA)以及一系列的整合功率元件,可提供革命性的功率轉(zhuǎn)換方案,應(yīng)付以上提及的各項(xiàng)挑戰(zhàn)。這些功率元件稱為V•I晶片。

    標(biāo)簽: 8226 功率架構(gòu) 功率

    上傳時(shí)間: 2013-11-15

    上傳用戶:yan2267246

  • 3-V TO 5.5-V MULTICHANNEL RS-2

    The MAX3243E device consists of three line drivers, five line receivers, and a dual charge-pump circuit with±15-kV ESD (HBM and IEC61000-4-2, Air-Gap Discharge) and ±8-kV ESD (IEC61000-4-2, Contact Discharge)protection on serial-port connection pins. The device meets the requirements of TIA/EIA-232-F and provides theelectrical interface between an asynchronous communication controller and the serial-port connector. Thiscombination of drivers and receivers matches that needed for the typical serial port used in an IBM PC/AT, orcompatible. The charge pump and four small external capacitors allow operation from a single 3-V to 5.5-Vsupply. In addition, the device includes an always-active noninverting output (ROUT2B), which allowsapplications using the ring indicator to transmit data while the device is powered down. The device operates atdata signaling rates up to 250 kbit/s and a maximum of 30-V/ms driver output slew rate.

    標(biāo)簽: MULTICHANNEL 5.5 TO RS

    上傳時(shí)間: 2013-10-19

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  • SPMC75F2413A在三相交流感應(yīng)電機(jī)的開環(huán)V/F控制的

    SPMC75F2413A在三相交流感應(yīng)電機(jī)的開環(huán)V/F控制的應(yīng)用:系統(tǒng)輸入電源電壓為AC110V/AC220V,經(jīng)全波整流后供系統(tǒng)使用。系統(tǒng)使用Sunplus公司的SPMC75F2413A產(chǎn)生AC三相異步電機(jī)的VVVF控制所需的SPWM信號(hào),并完成系統(tǒng)控制。使用三菱公司的智能功率模塊PS21865實(shí)現(xiàn)電機(jī)的功率驅(qū)動(dòng)。在AC220V輸入時(shí),系統(tǒng)最大能驅(qū)動(dòng)1.5KW的負(fù)載。系統(tǒng)的變頻區(qū)間為2Hz~200Hz。

    標(biāo)簽: 2413A F2413 SPMC 2413

    上傳時(shí)間: 2013-11-06

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  • Cyclone V FPGA:采用低功耗28nm FPGA減少總系統(tǒng)成本

            本文主要介紹Cyclone V FPGA的一個(gè)很明顯的特性,也可以說是一個(gè)很大的優(yōu)勢(shì),即:采用低功耗28nm FPGA減少總系統(tǒng)成本

    標(biāo)簽: FPGA Cyclone 28 nm

    上傳時(shí)間: 2013-10-26

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  • Arria V系列 FPGA芯片白皮書(英文)

      Arria V系列 FPGA芯片基本描述   (1)28nm FPGA,在成本、功耗和性能上達(dá)到均衡;   (2)包括低功耗6G和10G串行收發(fā)器;   (3)總功耗比6G Arria II FPGA低40%;   (4)豐富的硬核IP模塊,提高了集成度   (5)目前市場(chǎng)上支持10.3125Gbps收發(fā)器技術(shù)、功耗最低的中端FPGA。

    標(biāo)簽: Arria FPGA V系列 芯片

    上傳時(shí)間: 2013-10-26

    上傳用戶:wsq921779565

  • 基于Arria V和Cyclone V精度可調(diào)DSP模塊的高性能DSP應(yīng)用與實(shí)現(xiàn)

         本文是基于Arria V和Cyclone V精度可調(diào)DSP模塊的高性能DSP應(yīng)用與實(shí)現(xiàn)(英文資料)

    標(biāo)簽: DSP Cyclone Arria 精度可調(diào)

    上傳時(shí)間: 2014-12-28

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