verilog hdl實(shí)現(xiàn)先進(jìn)先出棧，不含測(cè)試文件
標(biāo)簽： verilog hdl 棧
上傳時(shí)間： 2015-08-20
上傳用戶：rocwangdp
不錯(cuò)的Vhdl講義?淮淼腣hdl講義
標(biāo)簽： Vhdl hdl 講義
上傳時(shí)間： 2014-11-24
上傳用戶：開(kāi)懷常笑
Verilog hdl是一種硬件描述語(yǔ)言，用于從算法級(jí)、門(mén)級(jí)到開(kāi)關(guān)級(jí)的多種抽象設(shè)計(jì)層次的數(shù)字系統(tǒng)建模，想學(xué)習(xí)的這個(gè)資料對(duì)你有用。
標(biāo)簽： Verilog hdl 硬件描述語(yǔ)言
上傳時(shí)間： 2015-09-02
上傳用戶：zhaoq123
Verilog hdl硬件描述語(yǔ)言，徐振林編著。pdf格式。
上傳時(shí)間： 2014-12-04
上傳用戶：tianyi223
利用EDA工具和硬件描述語(yǔ)言（hdl），根據(jù)產(chǎn)品的特定要求設(shè)計(jì)性能價(jià)格比高的片上系統(tǒng)，是目前國(guó)際上廣泛使用的方法。與傳統(tǒng)的設(shè)計(jì)方法不同，在設(shè)計(jì)開(kāi)始階段并不一定需要具體的單片微控制器（MCU）和開(kāi)發(fā)系統(tǒng)(仿真器)以及帶有外圍電路的線路板來(lái)進(jìn)行調(diào)試，所需要的只是由集成電路制造廠家提供的用hdl描述的MCU核和各種外圍器件的hdl模塊。設(shè)計(jì)人員在EDA工具提供的虛擬環(huán)境下，不但可以編寫(xiě)和調(diào)試匯編程序，也可以用hdl設(shè)計(jì)、仿真和調(diào)試具有自己特色的快速算法電路和接口，并通過(guò)綜合和布線工具自動(dòng)轉(zhuǎn)換為電路結(jié)構(gòu)，與制造廠家的單元庫(kù)、宏庫(kù)及硬核對(duì)應(yīng)起來(lái)，通過(guò)仿真驗(yàn)證后，即可投片制成專用的片上系統(tǒng)（SOC)集成電路。
標(biāo)簽： EDA hdl 硬件描述語(yǔ)言
上傳時(shí)間： 2015-09-05
上傳用戶：cmc_68289287
verilog hdl 編寫(xiě)的PWM，是初學(xué)CPLD者入門(mén)Z資源，epm7128stc100-10
標(biāo)簽： verilog hdl PWM 編寫(xiě)
上傳用戶：gdgzhym
Verilog hdl硬件描述語(yǔ)言 01簡(jiǎn)介.PDF 02hdl指南.PDF 03語(yǔ)言要素.PDF 04表達(dá)式.PDF 05門(mén)電平模型化.PDF 06用戶定義原語(yǔ).PDF 07數(shù)據(jù)流模型化.PDF 08行為建模.PDF 09結(jié)構(gòu)建模.PDF 10其它論題.PDF 11驗(yàn)證.PDF 12建模實(shí)例.PDF 13語(yǔ)法參考.PDF
標(biāo)簽： hdl Verilog 模型
上傳時(shí)間： 2013-12-28
上傳用戶：Andy123456
ActivH71sp1pch有關(guān)active hdl得.好像.
標(biāo)簽： ActivH active 1pch pch
上傳時(shí)間： 2013-12-25
上傳用戶：lxm
王金明的Verilog hdl程序集合，包含各個(gè)常用的程序
標(biāo)簽： Verilog hdl 程序
上傳時(shí)間： 2013-11-26
上傳用戶：星仔
基于Verilog-hdl的硬件電路的實(shí)現(xiàn) 9.1 簡(jiǎn)單的可編程單脈沖發(fā)生器 9.1.1 由系統(tǒng)功能描述時(shí)序關(guān)系 9.1.2 流程圖的設(shè)計(jì) 9.1.3 系統(tǒng)功能描述 9.1.4 邏輯框圖 9.1.5 延時(shí)模塊的詳細(xì)描述及仿真 9.1.6 功能模塊Verilog-hdl描述的模塊化方法 9.1.7 輸入檢測(cè)模塊的詳細(xì)描述及仿真 9.1.8 計(jì)數(shù)模塊的詳細(xì)描述 9.1.9 可編程單脈沖發(fā)生器的系統(tǒng)仿真 9.1.10 可編程單脈沖發(fā)生器的硬件實(shí)現(xiàn) 9.1.11 關(guān)于電路設(shè)計(jì)中常用的幾個(gè)有關(guān)名詞
標(biāo)簽： Verilog-hdl 9.1 功能描述
上傳時(shí)間： 2015-09-16
上傳用戶：chfanjiang
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