第一章 數字信號處理、計算、程序、算法和硬線邏輯的基本概念 第二章 Verilog hdl設計方法概述 第三章 Verilog hdl的基本語法 第四章 不同抽象級別的Verilog hdl模型 第五章 基本運算邏輯和它們的Verilog hdl模型 第六章 運算和數據流動控制邏輯 第七章 有限狀態機和可綜合風格的Verilog hdl
標簽： Verilog hdl 數字信號處理 基本概念
上傳時間： 2016-02-08
上傳用戶：ardager
非常號的Verilog hdl教學源碼，大家多
標簽： Verilog hdl 源碼
上傳時間： 2014-01-06
上傳用戶：plsee
Verilog hdl 高級數字設計源碼 _chapter4
標簽： Verilog chapter hdl 數字設計
上傳時間： 2014-01-03
上傳用戶：cooran
Verilog hdl 高級數字設計源碼 _chapter5
上傳時間： 2013-12-26
上傳用戶：agent
Veriloghdl_advanced_digital_design_code_Ch6 Verilog hdl 高級數字設計源碼ch6
標簽： Veriloghdl_advanced_digital_desig n_code_Ch Verilog hdl
上傳時間： 2016-02-12
上傳用戶：lmeeworm
Veriloghdl_advanced_digital_design_code_Ch7 Verilog hdl 高級數字設計 源碼ch7
上傳時間： 2013-12-23
上傳用戶：ghostparker
實現簡單的UART功能,在QUARTUS4.0下編譯通過,采用VERILOG hdl編寫.
標簽： QUARTUS VERILOG UART 4.0
上傳時間： 2013-12-18
上傳用戶：hfmm633
用verilog hdl編寫的一些例程，包括加法器/減法器等等，例子較多就不一一列舉了
標簽： verilog hdl 編寫
上傳時間： 2013-12-20
上傳用戶：fhzm5658
Generic FIFO, writen in verilog hdl
標簽： Generic verilog writen FIFO
上傳時間： 2016-02-18
上傳用戶：zwei41
Design and Test_Verilog hdl——EDA先鋒工作室《設計與驗證—Verilog hdl》配書源代碼，很多使用的實例，并有說明，是學習Verilog 不可多得的好資料。
標簽： Test_Verilog hdl Verilog Design
上傳用戶：youlongjian0
蟲蟲下載站版權所有 京ICP備2021023401號-1
