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max保姆

  • 基于CPLD的QDPSK調制解調電路設計

    為了在CDMA系統中更好地應用QDPSK數字調制方式,在分析四相相對移相(QDPSK)信號調制解調原理的基礎上,設計了一種QDPSK調制解調電路,它包括串并轉換、差分編碼、四相載波產生和選相、相干解調、差分譯碼和并串轉換電路。在MAX+PLUSⅡ軟件平臺上,進行了編譯和波形仿真。綜合后下載到復雜可編程邏輯器件EPM7128SLC84-15中,測試結果表明,調制電路能正確選相,解調電路輸出數據與QDPSK調制輸入數據完全一致,達到了預期的設計要求。 Abstract:  In order to realize the better application of digital modulation mode QDPSK in the CDMA system, a sort of QDPSK modulation-demodulation circuit was designed based on the analysis of QDPSK signal modulation-demodulation principles. It included serial/parallel conversion circuit, differential encoding circuit, four-phase carrier wave produced and phase chosen circuit, coherent demodulation circuit, difference decoding circuit and parallel/serial conversion circuit. And it was compiled and simulated on the MAX+PLUSⅡ software platform,and downloaded into the CPLD of EPM7128SLC84-15.The test result shows that the modulation circuit can exactly choose the phase,and the output data of the demodulator circuit is the same as the input data of the QDPSK modulate. The circuit achieves the prospective requirement of the design.

    標簽: QDPSK CPLD 調制解調 電路設計

    上傳時間: 2013-10-28

    上傳用戶:jyycc

  • FPGA連接DDR2的問題討論

    我采用XC4VSX35或XC4VLX25 FPGA來連接DDR2 SODIMM和元件。SODIMM內存條選用MT16HTS51264HY-667(4GB),分立器件選用8片MT47H512M8。設計目標:當客戶使用內存條時,8片分立器件不焊接;當使用直接貼片分立內存顆粒時,SODIMM內存條不安裝。請問專家:1、在設計中,先用Xilinx MIG工具生成DDR2的Core后,管腳約束文件是否還可更改?若能更改,則必須要滿足什么條件下更改?生成的約束文件中,ADDR,data之間是否能調換? 2、對DDR2數據、地址和控制線路的匹配要注意些什么?通過兩只100歐的電阻分別連接到1.8V和GND進行匹配 和 通過一只49.9歐的電阻連接到0.9V進行匹配,哪種匹配方式更好? 3、V4中,PCB LayOut時,DDR2線路阻抗單端為50歐,差分為100歐?Hyperlynx仿真時,那些參數必須要達到那些指標DDR2-667才能正常工作? 4、 若使用DDR2-667的SODIMM內存條,能否降速使用?比如降速到DDR2-400或更低頻率使用? 5、板卡上有SODIMM的插座,又有8片內存顆粒,則物理上兩部分是連在一起的,若實際使用時,只安裝內存條或只安裝8片內存顆粒,是否會造成信號完成性的影響?若有影響,如何控制? 6、SODIMM內存條(max:4GB)能否和8片分立器件(max:4GB)組合同時使用,構成一個(max:8GB)的DDR2單元?若能,則布線阻抗和FPGA的DCI如何控制?地址和控制線的TOP圖應該怎樣? 7、DDR2和FPGA(VREF pin)的參考電壓0.9V的實際工作電流有多大?工作時候,DDR2芯片是否很燙,一般如何考慮散熱? 8、由于多層板疊層的問題,可能頂層和中間層的銅箔不一樣后,中間的夾層后度不一樣時,也可能造成阻抗的不同。請教DDR2-667的SODIMM在8層板上的推進疊層?

    標簽: FPGA DDR2 連接 問題討論

    上傳時間: 2013-10-21

    上傳用戶:jjq719719

  • GAL使用教程

    9.1  通用可編程邏輯器件GAL 9.2  ABEL-HDL硬件描述語言 9.3  開發軟件ISP Synario操作簡介 9.4 可編程邏輯器件CPLD/FPGA 9.5  MAX+PLUSII開發軟件 邏輯器件,即可用來實現特定邏輯功能的電子器件。最基本的邏輯關系有“與”、“或”、“非”等。門電路等都是邏輯器件,如74LS08(2輸入四與門)實現“與”邏輯,74LS32(2輸入四或門)實現“或”邏輯,這是實現簡單邏輯功能,還有很多電路實現復雜邏輯功能,如微處理器等,這類是定制器件。

    標簽: GAL 使用教程

    上傳時間: 2013-10-26

    上傳用戶:jiangshandz

  • 3DMax 2010官方簡體中文版下載安裝及注冊激活方法

      1、安裝3DMAX2010   2、輸入序列號: 666-69696969或者667-98989898或者400-45454545   3、輸入產品密鑰:Max用128B1,Design用495B1   4、完成安裝后重啟軟件   5、選擇“激活”

    標簽: 3DMax 2010 簡體中文

    上傳時間: 2014-03-20

    上傳用戶:glxcl

  • < 波形聲音控件函數使用說明>> **************************************************************************

    < 波形聲音控件函數使用說明>> ****************************************************************************************************************** 函數名 功能 說明 ------------------------------------------------------------------------------------------------------------------ GetData() 獲取評分數據 當調用GetData()時WVGetData事件會自動 觸發,參數Data也就是得到的數據 GetLength() 獲取文件總長度 函數返回文件的長度 OpenFile(CString filename) 打開聲音文件自 動分析波形 RECPFstart(long Max) 長度限制錄制 當錄制的長度大于Max時自動停止,并返回 RECPFstop事件 RECstart() 開始錄音 RECstop() 停止錄音 RECpause(bool REC_STATE) 繼續/暫停錄音 當REC_STATEO為TRUE時暫停有效,相反繼續 play() 播放 replay(int dounum) 重復播放 dounum為重復次數 pause() 暫停 stop() 停止播放

    標簽: gt lt 波形 控件

    上傳時間: 2014-01-16

    上傳用戶:cjl42111

  • 軟件測試:一個編譯器測試軟件

    軟件測試:一個編譯器測試軟件,支持下列C語言運算符:+ - * / % ^(乘方) 負 (int) (double) "字符串" [](數組) > < == >= <= != && ! ++ -- = += -= *= /= %= ^=,支持下列關鍵字:void int double string if else for while do goto break continue return,支持下列數據類型:int double string int[] double[] string[],支持下列系統函數:int max(int,int),double max(double,double),int[] newint(int),double[] newdouble(int),string[] newstring(int),void delete(int[]),void delete(double[]),void delete(string[]),支持任意用戶定義函數,支持函數重載。不支持全局變量。如果發現錯誤,請告訴我

    標簽: 軟件測試 編譯器 測試軟件

    上傳時間: 2013-12-15

    上傳用戶:sy_jiadeyi

  • 此程序實現的是一個運算器

    此程序實現的是一個運算器,是在一個程序的基礎上進行改進的,計算器中需要的運算以及操作對象: IF,AND,OR,<,<=,>,>=,<>,=,== 數字0-9,(,),+,-,*,/, SIN,COS,TAN,POW,EXP,ABS,SQRT,INT,LN,LOG,MIN,MAX.

    標簽: 程序 運算器

    上傳時間: 2015-04-09

    上傳用戶:love1314

  • 個人硬件課程設計

    個人硬件課程設計,簡單實現了FPGA平臺的路口交通燈管理,開發環境為MAX+plus

    標簽: 硬件

    上傳時間: 2015-04-20

    上傳用戶:D&L37

  • 運籌學中

    運籌學中,用單純性算法來實現最優化max準則的源程序。 因為是初學者, 可能有些不標準請諒解

    標簽: 運籌學

    上傳時間: 2015-04-25

    上傳用戶:cx111111

  • .數據結構 假設有M個進程N類資源

    .數據結構 假設有M個進程N類資源,則有如下數據結構: MAX[M*N] M個進程對N類資源的最大需求量 AVAILABLE[N] 系統可用資源數 ALLOCATION[M*N] M個進程已經得到N類資源的資源量 NEED[M*N] M個進程還需要N類資源的資源量 2.銀行家算法 設進程I提出請求Request[N],則銀行家算法按如下規則進行判斷。 (1)如果Request[N]<=NEED[I,N],則轉(2);否則,出錯。 (2)如果Request[N]<=AVAILABLE,則轉(3);否則,出錯。 (3)系統試探分配資源,修改相關數據: AVAILABLE=AVAILABLE-REQUEST ALLOCATION=ALLOCATION+REQUEST NEED=NEED-REQUEST (4)系統執行安全性檢查,如安全,則分配成立;否則試探險性分配作廢,系統恢復原狀,進程等待。 3.安全性檢查 (1)設置兩個工作向量WORK=AVAILABLE;FINISH[M]=FALSE (2)從進程集合中找到一個滿足下述條件的進程, FINISH[i]=FALSE NEED<=WORK 如找到,執行(3);否則,執行(4) (3)設進程獲得資源,可順利執行,直至完成,從而釋放資源。 WORK=WORK+ALLOCATION FINISH=TRUE GO TO 2 (4)如所有的進程Finish[M]=true,則表示安全;否則系統不安全。

    標簽: 數據結構 進程 資源

    上傳時間: 2014-01-05

    上傳用戶:moshushi0009

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